宏力半导体（Grace）和SYNOPSYS携手开发参考设计流程

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《半导体技术》 CAS CSCD 北大核心 2005年第2期78-78,共1页

半导体设计软件的全球领先企业Synopsys公司与上海宏力半导体制造有限公司日前宣布，Synopsys的专业服务部和宏力已经联合开发出了一个用于宏力的0．18微米的参考设计流程。这个RTLto—GDSII的设计流程建立在经Synopsys验证的Galaxy^TM... 半导体设计软件的全球领先企业Synopsys公司与上海宏力半导体制造有限公司日前宣布，Synopsys的专业服务部和宏力已经联合开发出了一个用于宏力的0．18微米的参考设计流程。这个RTLto—GDSII的设计流程建立在经Synopsys验证的Galaxy^TM设计和Discovery^TM验证平台的基础之上。最终用户可以通过下载预先验证的参考设计流程，迅速开始集成电路(IC)的设计和验证， 展开更多

关键词 参考设计流程 半导体设计 验证平台 IC 集成电路 Synopsys公司 RTL 企业 上海宏力半导体制造有限公司 专业服务

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Synopsys与华虹NEC共同推出参考设计流程

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《电子产品世界》 2004年第05A期89-89,共1页

关键词 Synopsys公司 华虹NEC公司 参考设计流程 0.25微米芯片生产线

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Synopsys与华虹NEC共同推出参考设计流程

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作者 王冰 《邮电设计技术》 2004年第4期31-31,共1页

关键词 Synopsys公司 华虹NEC公司 参考设计流程 集成电路设计

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联电与Synopsys携手开发0．13微米参考设计流程

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《集成电路应用》 2004年第6期26-27,共2页

关键词 联电公司 Synopsys公司 0.13微米工艺 参考设计流程

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Synopsys与华虹NEC共同推出参考设计流程

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《中国集成电路》 2004年第4期63-63,共1页

关键词 Synopsys公司 华虹NEC公司 参考设计流程 片上系统

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CADENCE与UMC合作推出基于CPF的65纳米低功耗参考设计流程

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《集成电路应用》 2008年第7期14-14,共1页

Cadence与UMC宣布，推出基于通用功率格式（CPF）的低功耗参考设计流程，面向UMC65纳米工艺。该参考流程让客户能够在使用UMC的低功耗套件时实现最佳的65纳米低功耗设计，该套件中包含了基于CPF的库和其他知识产权。

关键词 低功耗设计 参考设计流程 纳米工艺 CADENCE CPF CADENCE 合作 参考流程

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Synopsys与华虹NEC共同推出参考设计流程

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《集成电路应用》 2004年第4期51-52,共2页

关键词 Synopsys公司 华虹NEC公司 参考设计流程 复杂片上系统

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华虹NEC与Synopsys携手开发参考设计流程2.0

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《电子与电脑》 2006年第11期73-73,共1页

关键词 参考设计流程 NEC Discovery验证平台 开发 PROFESSIONAL Galaxy设计平台 SERVICES 标准单元库

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华力微电子基于Cadence公司Encounter数字技术开发55纳米平台的参考设计流程

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《中国集成电路》 2013年第9期10-10,共1页

Cadence设计系统公司（NASDAQ：CDNS）与上海华力微电子有限公司日前共同宣布，华力微电子基于Cadence Encounter 数字技术交付出55纳米平台的参考设计流程。从现在起，华力微电子首次在其已建立的55纳米工艺平台上实现了从RTL到GDSII... Cadence设计系统公司（NASDAQ：CDNS）与上海华力微电子有限公司日前共同宣布，华力微电子基于Cadence Encounter 数字技术交付出55纳米平台的参考设计流程。从现在起，华力微电子首次在其已建立的55纳米工艺平台上实现了从RTL到GDSII的完整流程，这也是Cadence与上海华力紧密合作的结果。 展开更多

关键词 Cadence公司 参考设计流程 纳米工艺 Cadence设计系统公司 平台 技术开发 子基 数字技术

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华虹NEC与Synopsys公司携手开发参考设计流程2．0

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《电子与封装》 2006年第11期43-43,共1页

全球领先的电子设计自动化（EDA）软件工具领导厂商Synopsys与中国最先进的集成电路制造商之一上海华虹NEC电子有限公司于2006年10月13日宣布。双方将携手开发应用于华虹NEC 0．18μm工艺的参考设计流程2.0。华虹NEC选择Synopsys作为其... 全球领先的电子设计自动化（EDA）软件工具领导厂商Synopsys与中国最先进的集成电路制造商之一上海华虹NEC电子有限公司于2006年10月13日宣布。双方将携手开发应用于华虹NEC 0．18μm工艺的参考设计流程2.0。华虹NEC选择Synopsys作为其首选EDA供应商后，将充分利用Synopsys Professional Services开发基于Synopsys Galaxy^TM设计平台和Discovery^TM验证平台，以及华虹NEC I／O和标准单元库的完整RTL—to—GDSII参考设计流程。 展开更多

关键词 上海华虹NEC电子有限公司 参考设计流程 Synopsys公司 开发 PROFESSIONAL SERVICES 电子设计自动化 标准单元库

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宏力和SYNOPSYS携手开发参考设计流程

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《中国集成电路》 2005年第3期21-21,共1页

Synopsys公司与上海宏力半导体制造有限公司(Grace)近日宣布，Synopsys的专业服务部和宏力已经联合开发出了一个用于宏力的0．18微米的参考设计流程。这个RTL—to—GDSII的设计流程建立在经Synopsys验证的Galaxy设计和Discovery验证平... Synopsys公司与上海宏力半导体制造有限公司(Grace)近日宣布，Synopsys的专业服务部和宏力已经联合开发出了一个用于宏力的0．18微米的参考设计流程。这个RTL—to—GDSII的设计流程建立在经Synopsys验证的Galaxy设计和Discovery验证平台的基础之上。最终用户可以通过下载预先验证的参考设计流程．迅速开始IC的设计和验证．用户相信使用这个设计流程能够迅速达到预期的最优结果。该参考设计流程将很快由宏力推出。 展开更多

关键词 参考设计流程 IC Discovery验证平台 Synopsys公司 RTL 微米 最优 上海宏力半导体制造有限公司 预期 专业服务

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上海多项目晶圆支援计划推出0．6um数字电路参考设计流程

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《集成电路应用》 2002年第9期33-33,共1页

关键词 上海多项目晶圆支援计划 数字电路参考设计流程 上海集成电路设计研究中心 0.6um工艺

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新思科技与中芯国际携手推出增强型90纳采参考流程，以降低集成电路的设计和测试成本

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《电子质量》 2008年第3期75-75,共1页

中芯国际集成电路制造有限公司日前宣布，共同推出一个支持层次化设计及多电压设计的增强型90纳米RTL-to-GDsII参考设计流程。该流程受益于当前最先进的逻辑综合、可测性设计（DFT）和可制造性设计（DFM）技术，其主要特性包括：Design ... 中芯国际集成电路制造有限公司日前宣布，共同推出一个支持层次化设计及多电压设计的增强型90纳米RTL-to-GDsII参考设计流程。该流程受益于当前最先进的逻辑综合、可测性设计（DFT）和可制造性设计（DFM）技术，其主要特性包括：Design Compiler TM Ultra产品的拓扑综合（topographical synthesis） 展开更多

关键词 中芯国际集成电路制造有限公司 参考设计流程 增强型 参考流程 测试成本 科技 可制造性设计 层次化设计

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Cadence发布针对IBM——特许工艺的90纳米设计流程

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《集成电路应用》 2004年第7期26-27,共2页

Cadence设计系统公司近日宣布，一个合格的设计参考流程通过了可用性验证，该参考流程可与IBM-Chartered 90纳米工艺平台兼容。Cadence设计参考流程可与由Artisan公司为IBM-Chartered跨平台设计合作计划(design enablement program)提... Cadence设计系统公司近日宣布，一个合格的设计参考流程通过了可用性验证，该参考流程可与IBM-Chartered 90纳米工艺平台兼容。Cadence设计参考流程可与由Artisan公司为IBM-Chartered跨平台设计合作计划(design enablement program)提供的知识产权(IP）无缝结合。 展开更多

关键词 Cadence公司 设计参考流程 90纳米设计 IBM公司

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Cadence与TSMC共推纳米混合信号／射频参考设计“锦囊”

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《中国集成电路》 2009年第5期2-2,共1页

Cadence设计系统公司与台积电公司最近共同宣布推出业界第一款的混合信号／射频参考设计”锦囊”（MS／RFRDK）。这款锦囊采用Cadence Virtuoso混合信号技术研发完成，可提供矽芯片特性行为模型（silicon-characterized behavioral mod... Cadence设计系统公司与台积电公司最近共同宣布推出业界第一款的混合信号／射频参考设计”锦囊”（MS／RFRDK）。这款锦囊采用Cadence Virtuoso混合信号技术研发完成，可提供矽芯片特性行为模型（silicon-characterized behavioral models）以及完整的教学内容，展示经验证的高效混合信号／射频IC参考设计流程， 展开更多

关键词 Cadence设计系统公司 参考设计流程 混合信号 射频 TSMC VIRTUOSO 纳米 台积电公司

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Cadencel低功耗设计流程（CPF）支持Tensilica多媒体IP

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《电子与电脑》 2008年第11期99-100,共2页

Tensilica日前宣布与Cadence合作。根据Tensilica受欢迎的330HiFi音频处理器和388VDO视频引擎，为其多媒体子系统建立一个通用功耗格式（CPF）的低功耗参考设计流程。Cadence和Tensilica公司的工程师合作使用完整的Cadence低功耗解决方... Tensilica日前宣布与Cadence合作。根据Tensilica受欢迎的330HiFi音频处理器和388VDO视频引擎，为其多媒体子系统建立一个通用功耗格式（CPF）的低功耗参考设计流程。Cadence和Tensilica公司的工程师合作使用完整的Cadence低功耗解决方案（包括Encounter RTL Compiler全局综合， 展开更多

关键词 参考设计流程 低功耗 多媒体 Tensilica公司 CADENCE IP 音频处理器 全局综合

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业界动态

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《半导体技术》 CAS CSCD 北大核心 2006年第11期875-876,共2页

北京微电子国际研讨会隆重召开；华虹NEC与Synopsys公司携手开发参考设计流程2．0；KLA-TENCoR的PUMA 91XX暗场检测系统提供成功的PUMA9000生产能力；业界首款四通道PMU带有内置DAC；

关键词 Synopsys公司 参考设计流程 国际研讨会 PUMA 生产能力 检测系统 微电子 NEC

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华力微电子与Cadence紧密合作

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《电子技术应用》 北大核心 2013年第9期37-37,共1页

日前，全球电子设计创新领先企业Cadence设计系统公司与上海华力微电子有限公司共同宣布华力微电子基于Cadence Encounter数字技术交付出55纳米平台的参考设计流程。从现在起，华力微电子首次在其已建立的55纳米工艺平台上实现了从RTL到... 日前，全球电子设计创新领先企业Cadence设计系统公司与上海华力微电子有限公司共同宣布华力微电子基于Cadence Encounter数字技术交付出55纳米平台的参考设计流程。从现在起，华力微电子首次在其已建立的55纳米工艺平台上实现了从RTL到GDSII的完整流程。 展开更多

关键词 Cadence公司 参考设计流程 纳米工艺 微电子 Cadence设计系统公司 技术开发 合作 设计创新

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中芯国际和新思科技扩展40nm低功耗Reference Flow5．0

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《电子设计工程》 2012年第14期34-34,共1页

全球领先的半导体设计、验证和制造软件及知识产权（IP）供应商新思科技公司，与世界领先半导体代工企业之一中芯国际集成电路制造有限公司今日宣布：从即日起推出其40nmRTL—to—GDSII参考设计流程的5．0版本。此款经过生产验证的流程... 全球领先的半导体设计、验证和制造软件及知识产权（IP）供应商新思科技公司，与世界领先半导体代工企业之一中芯国际集成电路制造有限公司今日宣布：从即日起推出其40nmRTL—to—GDSII参考设计流程的5．0版本。此款经过生产验证的流程借助Synopsys的完整工具套件，将多样化的自动化低功耗和高性能功能整合在其中，给中芯国际的客户带来了目前芯片设计所需要的差异化性能和功耗结果。 展开更多

关键词 中芯国际集成电路制造有限公司 新思科技公司 REFERENCE 低功耗 半导体设计 参考设计流程 知识产权 工具套件

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lmagination与TSMC合作开发高级IoTIP平台

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《中国集成电路》 2015年第7期11-11,共1页

Imagination和台积电（TSMC）宣布，两家公司将合作开发一系列针对物联网（IoT）的高级IP子系统，以帮助双方共同客户加速产品上市并简化设计流程。这些IP平台，补充以高度优化的参考设计流程，将Imagination丰富的IP与台积电从55nm到1... Imagination和台积电（TSMC）宣布，两家公司将合作开发一系列针对物联网（IoT）的高级IP子系统，以帮助双方共同客户加速产品上市并简化设计流程。这些IP平台，补充以高度优化的参考设计流程，将Imagination丰富的IP与台积电从55nm到10nm的先进生产工艺相结合。 展开更多

关键词 IP平台 合作开发 TSMC IOT 参考设计流程 生产工艺 台积电 子系统

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