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CCSDS-RS(255,223)码高速译码器的硬件实现研究 被引量:4
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作者 张拯宁 李集林 +1 位作者 战勇杰 刘长柱 《中国空间科学技术》 EI CSCD 北大核心 2009年第5期75-83,共9页
研究了空间通信用高速Reed-Solomon(255,223)码硬判决译码器的FPGA实现方法,提出一种新的纠错算法实现结构以最大程度提高译码器性能。设计中采用RiBM算法求解关键方程,并通过应用高速比特并行乘法器以及流水线和并行处理方法提高译码... 研究了空间通信用高速Reed-Solomon(255,223)码硬判决译码器的FPGA实现方法,提出一种新的纠错算法实现结构以最大程度提高译码器性能。设计中采用RiBM算法求解关键方程,并通过应用高速比特并行乘法器以及流水线和并行处理方法提高译码通过率。综合和测试验证结果显示,该译码器译码通过速率为1.7Gbit/s,译码延迟为296个时钟周期,优于目前同类型的RS译码器性能指标。 展开更多
关键词 译码器算法 有限域 里德-索洛蒙码 空间数据系统体制 空间通信
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