基于Cortex-M3处理器的时间交替采样系统的设计 被引量：1

1

作者 赵祥 周建斌 +2 位作者 周靖 喻杰 郝宽 《仪表技术与传感器》 CSCD 北大核心 2015年第12期100-102,共3页

设计了一种基于Cortex-M3处理器的时间交替采样系统,阐述了抗混叠滤波调理电路和STM32F103VET6处理器等软硬件设计的技术要点。此外,基于处理器内部集成的两个ADC模块,系统实现了对信号的时间交替采集。测试结果表明,系统在原有12位精度... 设计了一种基于Cortex-M3处理器的时间交替采样系统,阐述了抗混叠滤波调理电路和STM32F103VET6处理器等软硬件设计的技术要点。此外,基于处理器内部集成的两个ADC模块,系统实现了对信号的时间交替采集。测试结果表明,系统在原有12位精度、1MSPS的采样基础上,将数据采样率提升到了2MSPS。 展开更多

关键词 时间交替采样 抗混叠滤波器 32位处理器 直接存储器存取

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时间交替采样系统的误差测量与FPGA实现 被引量：7

2

作者 朱子翰 吕幼新 《电子测量技术》 2011年第3期54-56,共3页

时间交替采样结构是模数转换中提高采样率的1种有效方法。但由于器件工艺限制,每个通道的不一致性会引入通道失配误差,而这些误差会导致信号存在较大的杂散分量,将会严重影响ADC的性能。通道误差包括增益误差、时间误差、偏置误差。提... 时间交替采样结构是模数转换中提高采样率的1种有效方法。但由于器件工艺限制,每个通道的不一致性会引入通道失配误差,而这些误差会导致信号存在较大的杂散分量,将会严重影响ADC的性能。通道误差包括增益误差、时间误差、偏置误差。提出了一种频域的方法通过对单路采样信号做快速傅里叶变换并由固定位置方法找出误差的频域值,对此频域值做相应数学变换得到3种误差并且对这种方法进行了FPGA仿真实现,通过ISE仿真2路AD拼接系统的误差测量,验证了其有效性。 展开更多

关键词 时间交替采样 通道失配误差 模数转换

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基于混合滤波器组的时间交替采样技术 被引量：2

3

作者 刘进军 陈颖 《电讯技术》 2007年第6期155-157,共3页

时间交替采样技术对通道失配误差十分敏感,而基于混合滤波器组的采样技术降低了对通道失配误差的敏感,但前端模拟分析滤波器的稳定性难于设计限制了其工程应用。结合时间交替和混合滤波器组采样技术,提出了一种易于工程实现的基于混合... 时间交替采样技术对通道失配误差十分敏感,而基于混合滤波器组的采样技术降低了对通道失配误差的敏感,但前端模拟分析滤波器的稳定性难于设计限制了其工程应用。结合时间交替和混合滤波器组采样技术,提出了一种易于工程实现的基于混合滤波器组的时间交替采样技术。仿真结果表明,该技术能显著提高采样系统的精度。 展开更多

关键词 模数转换器 混合滤波器组 时间交替采样 通道失配误差

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一种时间交替采样的非均匀时延估计技术

4

作者 陈颖 邓洁 杨丽 《电讯技术》 2006年第6期139-141,共3页

给出了一种时间交替采集系统各通道非均匀采样时延偏差的估计方法,分析了非均匀采样信号的频谱特性,介绍了非均匀采样信号时延估计原理。仿真结果表明,该算法可显著提高数据采集系统的性能。

关键词 侦察系统 数据采集 时间交替并行采样 非均匀采样 时延估计

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混合并行交替最优采样技术研究 被引量：1

5

作者 郑彦泽 周乃馨 +2 位作者 赵贻玖 孙思成 梅思涛 《电子测量与仪器学报》 CSCD 北大核心 2023年第4期18-26,共9页

时间交替采样(TIADC)与量化交替采样技术(QIADC)分别是提升采集系统采样率与分辨率的有效方案。基于TIADC与QIADC的混合并行采集系统可以提供不同采样率与分辨率的组合,但由于采集系统的高采样率与高分辨率不能兼顾,因此本文首先研究该... 时间交替采样(TIADC)与量化交替采样技术(QIADC)分别是提升采集系统采样率与分辨率的有效方案。基于TIADC与QIADC的混合并行采集系统可以提供不同采样率与分辨率的组合,但由于采集系统的高采样率与高分辨率不能兼顾,因此本文首先研究该系统的最佳采集性能。通过分析系统采样率与分辨率对输入噪声及量化噪声的影响,得出在系统可用ADC数量一定的情况下,存在最优的采样率和分辨率,使得系统达到最佳采集精度。另外,本文对偏移量不匹配导致QIADC系统精度降低的影响进行了分析,建立了量化偏移误差与采集系统量化提升位数之间的关系模型。理论分析与实验结果均表明,当输入噪声能量与量化噪声能量相等时,采样率与分辨率的组合是最优的,且此时系统的输出信噪比取得最大值,说明系统具有最佳的采集性能。 展开更多

关键词 时间交替采样 量化交替采样 最优配置 量化噪声 量化偏移误差

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基于FFT的TIADC时间误差自适应校准算法 被引量：3

6

作者 刘卓华 龚向阳 +1 位作者 刘伟 王佐才 《计算机应用》 CSCD 北大核心 2018年第A02期344-348,共5页

TIADC是一种广泛使用的基于时间交替技术的高采样率ADC,然而由于TIADC中各子ADC非一致性而引入的偏置、增益及时间误差大大降低了系统性能。其中,时间误差在三个误差中对整个系统性能影响最大,也最难以校准。对于高速TIADC系统,很小的... TIADC是一种广泛使用的基于时间交替技术的高采样率ADC,然而由于TIADC中各子ADC非一致性而引入的偏置、增益及时间误差大大降低了系统性能。其中,时间误差在三个误差中对整个系统性能影响最大,也最难以校准。对于高速TIADC系统,很小的时间误差都会导致明显的误差谱分量。提出了一种基于FFT的时间误差自适应校准方法,算法根据TIADC输出信号频谱特点,以时间误差导致的误差谱幅度为校准依据,调节采样时钟相位使得误差谱幅度最小,实现自适应校准。该算法无需单独测量时间误差即可实现校准,相对于已有自适应算法迭代次数少、校准时间短,无需在系统内部额外产生参考信号,容易实现。仿真和实际系统中的实验结果证明了该算法具有良好的性能:校准之后,残余相对时间误差小于0. 001;在实际的2. 5 GS/s的TIADC系统中,即使输入1 GHz的高频正弦信号,由时间误差导致的误差谱都能得以完全消除。 展开更多

关键词 时间交替采样数模转换 时间误差 时间交替采样 自适应校准

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并行A/D采集系统的时间延迟测量及待测信号的复原 被引量：2

7

作者 陈刚 杨青川 《仪表技术与传感器》 CSCD 北大核心 2010年第5期77-79,共3页

并行时间交替采样是提高采样率的一种有效方法,但并行通道间的失配将使拼接后的信号成为非均匀采样,严重降低了整个A/D采集系统的性能。在对非均匀周期采样信号的数字谱进行了深入研究的基础上,提出了各通道时间延迟值的测量方法,及复... 并行时间交替采样是提高采样率的一种有效方法,但并行通道间的失配将使拼接后的信号成为非均匀采样,严重降低了整个A/D采集系统的性能。在对非均匀周期采样信号的数字谱进行了深入研究的基础上,提出了各通道时间延迟值的测量方法,及复原待测信号的方法。结合实例,在MATLAB环境下的仿真实验证实了方法的可行性和可靠性。 展开更多

关键词 时间交替采样 延迟时间 非均匀采样信号 多路A/D

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并行ADC采集系统的时间误差测量与校正 被引量：6

8

作者 刘进军 吕幼新 王洪 《电子科技大学学报》 EI CAS CSCD 北大核心 2005年第6期736-738,758,共4页

并行时间交替采样是提高采样率的一种有效方法,但并行通道间的失配将使拼接后的信号成为非均匀采样,严重降低了整个系统的性能。该文在分析并行时间交替采样信号频谱的基础上,给出了时间误差的测量方法,并采用FARROW结构的全通滤波器实... 并行时间交替采样是提高采样率的一种有效方法,但并行通道间的失配将使拼接后的信号成为非均匀采样,严重降低了整个系统的性能。该文在分析并行时间交替采样信号频谱的基础上,给出了时间误差的测量方法,并采用FARROW结构的全通滤波器实现时间误差校正。仿真结果表明该方法能有效提高信号频谱质量,实现了对非均匀采样信号的时间误差校正。 展开更多

关键词 时间交替采样 时间误差 FARROW结构 校正

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基于国产ADC芯片的TIADC系统时间误差自适应校准算法 被引量：14

9

作者 崔文涛 李杰 +1 位作者 张德彪 薛璐瑶 《仪器仪表学报》 EI CAS CSCD 北大核心 2021年第11期132-139,共8页

武器及其测试系统的高精度与国产化是我们国家现在不得不面对的严峻问题,当数据采集系统的采样率达到GSPS量级时,目前的国产ADC芯片很难达到,因此在不降低采样精度的前提下,提出多片ADC进行阵列化采样的方法提高系统的采样率。针对TIAD... 武器及其测试系统的高精度与国产化是我们国家现在不得不面对的严峻问题,当数据采集系统的采样率达到GSPS量级时,目前的国产ADC芯片很难达到,因此在不降低采样精度的前提下,提出多片ADC进行阵列化采样的方法提高系统的采样率。针对TIADC系统存在的通道失配问题,提出了基于一阶统计量的自适应误差估计算法与改进Farrow时延滤波器的校正方法,并对4通道TIADC系统的时间误差估计提出新的估计策略。仿真与实验结果表明,该算法能够对时间失配误差进行精确估计,同时能够有效地抑制杂散分量,相比校正前的数据,无杂散动态范围提高20 dB,对解决高速高精度数据采集装备国产化问题具有重要的现实意义。 展开更多

关键词 国产ADC芯片 时间交替采样 自适应校准 估计策略 拉格朗日插值 改进的Farrow延时滤波器

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一种超高速并行采样技术的研究与实现 被引量：30

10

作者 黄武煌 王厚军 曾浩 《电子测量与仪器学报》 CSCD 2009年第8期67-71,共5页

并行采样技术是提高实时采样率的一种重要手段。基于时间交替并行采样技术,设计了一种由3Gsps采样率的模数转换器实现双通道6Gsps采样率的数据采集系统,重点对高速采样时钟分相延迟控制与同步时钟传输处理、基于IDDR的高速数据流分相处... 并行采样技术是提高实时采样率的一种重要手段。基于时间交替并行采样技术,设计了一种由3Gsps采样率的模数转换器实现双通道6Gsps采样率的数据采集系统,重点对高速采样时钟分相延迟控制与同步时钟传输处理、基于IDDR的高速数据流分相处理、基于FIFO高速缓存与基于DDR2深存储的双重构架、板级设计的信号完整性等关键技术进行了详细探讨,同时对系统的软件架构也进行了介绍,最后给出信号实时数据采集的实验结果,并对系统的信噪比和有效位数进行了详细分析,得出系统的性能指标达到了同类产品水平。 展开更多

关键词 高速模数转换器 时间交替并行采样 数据流分相处理 深存储

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TIADC高速数据捕获和时间失配补偿的FPGA实现 被引量：6

11

作者 张尚良 邹月娴 《数据采集与处理》 CSCD 北大核心 2011年第5期601-608,共8页

时间交错并行采样模拟数字转换器(TIADC)模拟前端特有的多通道分时交替采样结构不可避免地引入了通道失配问题,并且给其后端多通道高速数据的捕获、缓存和处理带来了很大的设计挑战。本文针对上述技术难题,利用FPGA和SoPC技术特点,着重... 时间交错并行采样模拟数字转换器(TIADC)模拟前端特有的多通道分时交替采样结构不可避免地引入了通道失配问题,并且给其后端多通道高速数据的捕获、缓存和处理带来了很大的设计挑战。本文针对上述技术难题,利用FPGA和SoPC技术特点,着重开展模块化TIADC通用数字后端系统设计技术研究。分别实现了对TIADC系统模拟前端多通道分时交替高速输出数据的实时捕获、多通道拉格朗日时间失配实时数字后补偿、数据的存储及传输等功能。分析表明,本文提出的数字后端系统设计方案具有良好的通用性,其模块化特性易于拓展并适用于不同的TIADC系统架构。测试结果表明本文实现的4*80MS/s12bit TIADC数字后端系统工作稳定,采用6阶拉格朗日插值滤波器使系统获得了平均25dB的SFDR性能提高。 展开更多

关键词 时间交替并行采样 时间失配 数字后补偿 TIADC数字后端系统

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高速数据采集系统中触发点同步技术研究 被引量：37

12

作者 郭连平 田书林 +1 位作者 蒋俊 曾浩 《电子测量与仪器学报》 CSCD 2010年第3期224-229,共6页

在高速数据采集系统中,并行时间交替采样会引起触发抖动,导致系统整体性能的下降。本文首先分析了触发抖动出现的原因,接着提出了一种基于FPGA硬件,利用时间扩展电路的触发点同步技术来降低触发抖动,最后进行了误差分析,并给出了采用该... 在高速数据采集系统中,并行时间交替采样会引起触发抖动,导致系统整体性能的下降。本文首先分析了触发抖动出现的原因,接着提出了一种基于FPGA硬件,利用时间扩展电路的触发点同步技术来降低触发抖动,最后进行了误差分析,并给出了采用该技术的实验结果。结果表明,触发点同步技术可以有效的降低触发抖动,同时相比较以往的软件查询算法,可以并行于采集过程完成触发点同步,因此不需要耗费额外的时间,并且也不会影响系统的整机性能。 展开更多

关键词 高速并行采集系统 并行时间交替采样 时间扩展电路 触发点同步 触发抖动

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一种并行AD采集系统的通道匹配误差研究 被引量：5

13

作者 邵星灵 杨卫 +1 位作者 王正言 张文栋 《压电与声光》 CSCD 北大核心 2011年第2期332-335,共4页

随着现代宽带雷达通讯的发展,对雷达回波信号的采集和目标的特征提取成为研究者关注的焦点。由于雷达回波的高频信号高达几十兆赫兹,时间交替采样模数转换器(ADC)系统便可在其中发挥重要作用,但这种结构会引入时间、增益和偏置3种主要... 随着现代宽带雷达通讯的发展,对雷达回波信号的采集和目标的特征提取成为研究者关注的焦点。由于雷达回波的高频信号高达几十兆赫兹,时间交替采样模数转换器(ADC)系统便可在其中发挥重要作用,但这种结构会引入时间、增益和偏置3种主要的通道失配误差。该文对通道失配误差作了分析,建立了3种误差并存的非均匀采样信号频谱的数学模型,并在此基础上提出了该文的误差联合测量高效实时校正算法,最后在现场可编程门阵列(FPGA)中完成了整个算法的实现。 展开更多

关键词 宽带雷达通讯 现场可编程门阵列(FPGA) 时间交替采样ADC 实时校正算法

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基于时钟树机制的超高速数字锁相放大系统 被引量：4

14

作者 邱亮 茆亚洲 +1 位作者 彭滟 朱亦鸣 《数据采集与处理》 CSCD 北大核心 2019年第4期715-722,共8页

在超高速数字锁相系统中,虽然可以采用时间交替并行模数转换(Analog-to-digital converter,ADC)结构解决采样速率和采样精度的矛盾,但系统极易受各通道采样时钟抖动的影响。在分析采样时钟抖动与采样有效位数及动态范围关系的基础上,设... 在超高速数字锁相系统中,虽然可以采用时间交替并行模数转换(Analog-to-digital converter,ADC)结构解决采样速率和采样精度的矛盾,但系统极易受各通道采样时钟抖动的影响。在分析采样时钟抖动与采样有效位数及动态范围关系的基础上,设计了一种基于时钟树机制的并联ADC交替采样结构的超高速数字锁相放大系统。实验结果表明,在相同的测试条件下,该系统比国外主流厂商的商用锁相放大器信噪比提高了约17.5 dB。 展开更多

关键词 时间交替采样 时钟抖动 模数转换器 锁相放大器 信噪比

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高速深存储数据采集系统研究与设计 被引量：35

15

作者 宋鹏飞 王厚军 曾浩 《仪器仪表学报》 EI CAS CSCD 北大核心 2011年第4期903-912,共10页

存储深度表征了示波器在最高实时采样率下连续采集并存储采样点的能力。提高存储深度有助于提高系统分析波形细节的能力,但同时也会导致系统响应速度的下降。基于超高速并行采样和波形快速定位与缩放等技术,设计了实时采样率高达6 Gs/s... 存储深度表征了示波器在最高实时采样率下连续采集并存储采样点的能力。提高存储深度有助于提高系统分析波形细节的能力,但同时也会导致系统响应速度的下降。基于超高速并行采样和波形快速定位与缩放等技术,设计了实时采样率高达6 Gs/s,存储深度高达512 Mpts的高速深存储数据采集系统,重点提出了一种深度存储条件下的波形快速定位与缩放技术,以解决提高深度存储所带来的响应速度慢、波形捕获率低等问题。最后给出信号实时数据采集的实验结果。结果表明运用波形快速定位与缩放技术,系统响应速度大幅提高,可以快速定位并显示用户所关心的波形细节,提高示波器的性能。 展开更多

关键词 深存储 波形快速定位与缩放 波形捕获率 时间交替并行采样

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用于中红外痕量气体检测的光电信号高速采集系统设计 被引量：10

16

作者 吕默 陈晨 王一丁 《激光杂志》 北大核心 2016年第2期26-29,共4页

在中红外波段,大多数气体分子吸收光谱的线宽都很窄,因此红外光电探测器输出信号为窄脉冲信号。对此脉冲信号的处理要求前置放大器必须兼具精度与速度,而对放大器输出信号的采集也需要在保证带宽的情况下尽量提高数字化的精度。本文中... 在中红外波段,大多数气体分子吸收光谱的线宽都很窄,因此红外光电探测器输出信号为窄脉冲信号。对此脉冲信号的处理要求前置放大器必须兼具精度与速度,而对放大器输出信号的采集也需要在保证带宽的情况下尽量提高数字化的精度。本文中设计了高速并行采样电路,利用两片双通道高速ADC实现了1GSPS的采样速度与12bit的垂直分辨率。信号链的最后一环是FPGA数据处理电路,我们应用CORDIC算法对采集系统的时间误差进行了校正。本文最后给出了光电信号高速采集电路的设计与测试结果,在输入参考信号频率为100MHz时,采集系统整体信噪比达到60d B,无杂散动态范围达到70d B。 展开更多

关键词 痕量气体检测 时间交替并行采样系统 Farrow滤波器 CORDIC算法

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基于光学时钟技术的高速ADC系统的研究 被引量：4

17

作者 吕方兴 《电子测量技术》 北大核心 2021年第6期17-22,共6页

时间交替模数转换器(time-interleaved analog-to-digital converter, TIADC)是一种有效地提高模数转换器采样频率的方法,但是通道间的采样时间相对误差严重影响了系统性能。基于光学时钟技术的高速ADC技术主要是利用光脉冲信号的高重... 时间交替模数转换器(time-interleaved analog-to-digital converter, TIADC)是一种有效地提高模数转换器采样频率的方法,但是通道间的采样时间相对误差严重影响了系统性能。基于光学时钟技术的高速ADC技术主要是利用光脉冲信号的高重频、窄脉宽和低时间抖动特性。提出了一种基于光学时钟技术的TIADC系统的设计方案,利用不同的光纤长度产生精准时间间隔的采样信号,并通过搭建一个四通道TIADC来验证方案的可行性。实验结果表明,该光时钟分配系统可以提供小于16 ps的四通道时钟信号,能够很好地实现四通道高速ADC系统。 展开更多

关键词 高速ADC 时间交替采样 光纤延时线 光学时钟技术 时间抖动

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