时序逻辑电路失效分析 被引量：4

1

作者 龚欣 王旭 《半导体技术》 CAS CSCD 北大核心 2009年第10期974-977,共4页

利用液晶热点定位和电压衬度像等技术手段,准确定位了一时序逻辑电路的失效部位,结合电路原理分析以及芯片版图,详细解释了器件失效模式与失效现象的关系,并对其失效原因进行了实验验证。结果显示,电压衬度技术可以直观地显示逻辑电路... 利用液晶热点定位和电压衬度像等技术手段,准确定位了一时序逻辑电路的失效部位,结合电路原理分析以及芯片版图,详细解释了器件失效模式与失效现象的关系,并对其失效原因进行了实验验证。结果显示,电压衬度技术可以直观地显示逻辑电路内部某点的逻辑状态,在失效定位以及失效模式确认方面起重要作用;时序逻辑电路失效后存在电势竞争现象,本失效案例表明,当电路中某点出现"1"和"0"的电势竞争时,该点表现为"1"。 展开更多

关键词 时序逻辑电路 失效分析 电压衬度像 电势竞争

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几种常见BCD码在同步时序逻辑电路中的对比分析 被引量：3

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作者 严李强 郭玉萍 刘重显 《电子设计工程》 2014年第3期129-132,135,共5页

BCD码也称二进码十进数。根据实际需求,BCD码产生了多种编码形式。选择不同的BCD码来完成电路设计,则逻辑电路会呈现出不同的结构和工作过程。本文选择同步时序逻辑电路设计中的一个具体实例,采用常见BCD码的六种形式分别完成一次完整设... BCD码也称二进码十进数。根据实际需求,BCD码产生了多种编码形式。选择不同的BCD码来完成电路设计,则逻辑电路会呈现出不同的结构和工作过程。本文选择同步时序逻辑电路设计中的一个具体实例,采用常见BCD码的六种形式分别完成一次完整设计,对比分析各种编码形式对逻辑电路设计的可靠性、自启动能力、电路结构和元器件利用率的影响。 展开更多

关键词 BCD码 同步时序逻辑电路 有权码 无权码

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时序逻辑电路设计的新方法——控制卡诺图法 被引量：3

3

作者 杨莲红 王超 +1 位作者 杨奇 兰文红 《昌吉学院学报》 2009年第1期93-97,共5页

本文主要是阐明时序逻辑电路设计的新方法——控制卡诺图法。对用控制卡诺图法设计时序逻辑电路的原理方法及步骤作了详细的阐述,并通过实例讲解设计方法的具体应用,归纳总结了控制卡诺图法的特点。

关键词 时序逻辑电路 控制卡诺图 触发器 设计

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时序逻辑电路中若干问题的探讨 被引量：1

4

作者 杜轩华 张岳 《电子技术应用》 北大核心 1998年第1期21-24,共4页

根据数字逻辑电路设计的经验，对时序逻辑电路部分的一些概念和方法问题提出了看法，并举例作了详细的讨论。

关键词 逻辑电路 时序逻辑电路 设计

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Multisim在时序逻辑电路实验教学中的应用 被引量：2

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作者 谢燕江 刘灵丽 《信息技术》 2011年第9期38-41,共4页

以特殊十二进制计数器(数字钟里的时位)为例,结合Multisim设计了《数字逻辑》课程的时序逻辑电路的实验教学内容,通过Multisim仿真,让学生直观地观察逻辑电路运行时各个关键点的波形变化,加深了理解,同时也提高了实验的效果。

关键词 MULTISIM 数字逻辑 时序逻辑电路 实验教学

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次态卡诺图在时序逻辑电路中的应用 被引量：2

6

作者 吴恒玉 唐民丽 《南京工业职业技术学院学报》 2006年第2期71-73,共3页

基于逻辑电路的设计中经常涉及到用卡诺图化简逻辑函数的过程,给出了利用次态卡诺图设计逻辑电路的方法及不同触发器的状态方程在次态卡诺图上的表示,并举例加以说明。

关键词 次态卡诺图 时序逻辑电路 触发器

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异步时序逻辑电路分析方法的研究 被引量：2

7

作者 齐耀辉 《现代电子技术》 2008年第6期14-18,共5页

首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的... 首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的分析。通过实例分别阐述3种分析方法,并进行对比,在保证分析结果的前提下,改进的计算分析法分析异步时序逻辑电路时不用考虑时钟信号,使分析变得简单;而卡诺图分析法使分析过程思路清晰,状态转换更加直观化。 展开更多

关键词 异步时序逻辑电路 触发器 计算分析法 卡诺图分析法

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EDA技术在时序逻辑电路实验中的应用 被引量：4

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作者 王忠林 韩敬伟 《滨州学院学报》 2013年第6期84-87,共4页

以时序电路中十进制计数器、寄存器和扭环型计数器为例,采用EDA设计方法,通过实现原理分析和实验过程设计,高效地完成实际电子系统的设计、验证与实现,重在培养学生的工程素质、分析问题解决问题的能力、动手能力和创新意识.

关键词 数字电路 时序逻辑电路 EDA 计数器 扭环型计数器

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基于次态卡诺图的JK驱动方程的改进方法进行时序逻辑电路的设计 被引量：2

9

作者 高美蓉 《电子设计工程》 2016年第8期152-154,共3页

在应用次态卡诺图得到JK驱动方程时,为了达到时序逻辑电路设计最简化。论文在分析JK触发器的特性,及求取JK触发器驱动方程的传统方法中存在的问题,提出了用次态卡诺图求取JK驱动方程的改进方法。并通过示例说明利用该方法进行时序逻辑... 在应用次态卡诺图得到JK驱动方程时,为了达到时序逻辑电路设计最简化。论文在分析JK触发器的特性,及求取JK触发器驱动方程的传统方法中存在的问题,提出了用次态卡诺图求取JK驱动方程的改进方法。并通过示例说明利用该方法进行时序逻辑电路设计的过程。由此得出所提出的改进方法是可行的。 展开更多

关键词 卡诺图 JK触发器 驱动方程 时序逻辑电路

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CMOS时序逻辑电路功耗估计的一种新方法

10

作者 朱宁 周润德 羊性滋 《微电子学与计算机》 CSCD 北大核心 1999年第2期5-9,共5页

MOS时序逻辑电路由于存在时序反馈环，使功耗分析变得相当复杂。文章提出了一种采用电路化简加速功耗估计的方法。对ISCAS’89和ISCAS’93基本测试电路的实验结果表明，此方法具有较好的计算精度和较短的计算时间。

关键词 时序逻辑电路 功耗估计 SMOS 数字电路 逻辑电路

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关于同步时序逻辑电路设计中“状态简化”方法的探索 被引量：1

11

作者 徐兵 《昌吉学院学报》 2004年第1期119-122,共4页

作者根据多年教学经验提出一种在同步时序逻辑电路的设计过程中“通过直接观察电路必须记忆的各个状态所产生的效果而合并状态”进行“状态简化”的方法。

关键词 同步时序逻辑电路 电路设计教学 无效状态 等价状态 有效状态

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简单同步时序逻辑电路设计教学内容的优化

12

作者 李爱华 王建斌 +1 位作者 张飞龙 李伟 《中国冶金教育》 2011年第6期28-32,共5页

常规同步时序逻辑电路设计步骤存在状态化简繁琐,自启动检查滞后等问题,导致电路设计工作量增大,极易出错。为此,对教学内容进行调整优化,给出了详细的优化步骤,并通过实例讲解设计方法的具体应用,原理简单,易于理解,使时序逻辑电路的... 常规同步时序逻辑电路设计步骤存在状态化简繁琐,自启动检查滞后等问题,导致电路设计工作量增大,极易出错。为此,对教学内容进行调整优化,给出了详细的优化步骤,并通过实例讲解设计方法的具体应用,原理简单,易于理解,使时序逻辑电路的设计过程更加直观、清楚。 展开更多

关键词 同步时序逻辑电路 教学内容 优化 状态表 隐含表 自启动能力

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同步时序逻辑电路设计方法的研究

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作者 史庆军 曾长安 张颖 《佳木斯大学学报（自然科学版）》 CAS 2001年第3期240-242,共3页

提出一种设计同步时序逻辑电路的新方法 .根据触发器 ( FF)基本特性 ,可从电路的状态转换图上直接求得触发器置位、复位函数 ,进而确定触发器的激励方程 .具体设计实例表明该方法简捷、高效 。

关键词 同步时序逻辑电路 触发器 状态转换图 设计方法

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基于动态卡诺图对时序逻辑电路设计方法的优化

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作者 王芳 黄德聪 +2 位作者 裴楠 杨千城 邹雨欣 《科技通报》 2022年第5期27-30,共4页

在传统数字电路设计中,在保证逻辑功能正确的前提下,尽可能简化逻辑函数表达式以获得最简的电路。在目前国内的一些主要教材中,介绍时序逻辑电路设计时,当获得触发器的状态方程后,都是将状态方程和所选用的触发器的特性方程进行人为比较... 在传统数字电路设计中,在保证逻辑功能正确的前提下,尽可能简化逻辑函数表达式以获得最简的电路。在目前国内的一些主要教材中,介绍时序逻辑电路设计时,当获得触发器的状态方程后,都是将状态方程和所选用的触发器的特性方程进行人为比较,得到触发器的驱动方程,这样获得的激励函数并不能保证一定是最简的,常常还需要进行某些修正。本文提出动态卡诺图的概念,利用触发器的状态变化来填写卡诺图,给出了J、K触发器的动态卡诺图化简技术和设计方法,这种设计方法解决了传统时序电路设计中卡诺图画包围圈不能遵循包围圈最大原则的问题。 展开更多

关键词 时序逻辑电路 动态卡诺图 驱动方程 状态方程

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利用冗余态参与状态分配设计时序逻辑电路

15

作者 王淑芝 梁海峰 《大连铁道学院学报》 2002年第1期48-50,58,共4页

在时序逻辑电路的设计中，利用电路所存在的冗余态来参与状态分配，更符合“Ａ－Ｈ规则”，从而获得较简单的电路结构，并且消除了无效状态和所谓的自校正问题．是值得推广应用的一种新的状态分配技术．

关键词 设计 时序逻辑电路 冗余态 状态分配 A-H规则 自校正

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时序逻辑电路设计法在数字图像显示控制器中的应用 被引量：1

16

作者 林益平 晏磊 《电视技术》 北大核心 2000年第2期9-11,共3页

关键词 时序逻辑电路 图像显示控制器 数字图像显示

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同步时序逻辑电路设计步骤研究

17

作者 褚徳欣 王艳荣 《电子科技》 2013年第4期169-170,172,共3页

通过对时序逻辑电路设计部分教学过程的设计步骤分析研究,强化了原始状态的确定在设计过程中的重要性,在清晰设计思路,强化时序逻辑电路经典的设计方法的同时,补充了与实践应用相关的设计实例,完善了时序逻辑电路的设计步骤。

关键词 时序逻辑电路 原始状态 电路设计

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用数字集成电路实现时序逻辑电路的功能 被引量：1

18

作者 涂金龙 《电子工程师》 1999年第5期22-23,共2页

介绍了时序逻辑电路的概念以及用ＣＤ４０２８数字集成电路设计时序电路的实例。

关键词 时序逻辑电路 异步电路 数字集成电路 设计

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时序逻辑电路的自启动设计

19

作者 郭建英 《濮阳教育学院学报》 2003年第2期27-28,共2页

本文介绍了时序逻辑电路的自启动设计方法。

关键词 时序逻辑电路 自启动设计 状态转换图 卡诺图 状态方程 触发器

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一种基于时序逻辑电路的延时开关设计

20

作者 冯家鹏 《现代电子技术》 2011年第15期177-178,182,共3页

时序逻辑电路设计是《数字电子技术》课程中一个难度大、综合性高的部分,它综合了组合逻辑电路和时序逻辑电路的内容。在进行状态机设计时,随着输入逻辑变量的增加,状态数目将呈指数倍急剧增加,这会使整个设计变得复杂且容易出错。以一... 时序逻辑电路设计是《数字电子技术》课程中一个难度大、综合性高的部分,它综合了组合逻辑电路和时序逻辑电路的内容。在进行状态机设计时,随着输入逻辑变量的增加,状态数目将呈指数倍急剧增加,这会使整个设计变得复杂且容易出错。以一个延时开关控制器的设计为例,提出了一种状态机输入变量简化的方法,降低了设计过程的复杂程度。 展开更多

关键词 时序逻辑电路 延时开关 状态机化简 D触发器

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