一种基于Nios Ⅱ软核的嵌入式图像采集处理系统设计 被引量：10

1

作者 龚向东 刘春平 +1 位作者 黄虹宾 曾振兴 《电子测量技术》 2010年第2期75-78,94,共5页

提出了一种基于Nios Ⅱ软核处理器的嵌入式图像采集处理系统架构,在图像采集缓存区、图像处理缓存区和图像显示缓冲区之间通过Avalon总线流模式管道实现了数据的高速传输,着重介绍了该系统中组件模块的定制与设计,并给出了该系统的一个... 提出了一种基于Nios Ⅱ软核处理器的嵌入式图像采集处理系统架构,在图像采集缓存区、图像处理缓存区和图像显示缓冲区之间通过Avalon总线流模式管道实现了数据的高速传输,着重介绍了该系统中组件模块的定制与设计,并给出了该系统的一个应用实例。 展开更多

关键词 软核处理器 嵌入式系统 图像采集 图像处理 流模式管道

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嵌入式CPU软核综述 被引量：16

2

作者 孙恺 王田苗 +1 位作者 魏洪兴 陈友东 《计算机工程》 CAS CSCD 北大核心 2006年第7期6-9,共4页

随着FPGA和SoPC(SystemonProgrammableChip)技术的迅速发展,基于FPGA的嵌入式系统得到了广泛的研究和应用。该文针对目前比较有影响和特点的4款嵌入式CPU软核Nios/Nios2、MicroBlaze、Leon2/Leon3和OpenRISC1200进行了性能分析和对比,... 随着FPGA和SoPC(SystemonProgrammableChip)技术的迅速发展,基于FPGA的嵌入式系统得到了广泛的研究和应用。该文针对目前比较有影响和特点的4款嵌入式CPU软核Nios/Nios2、MicroBlaze、Leon2/Leon3和OpenRISC1200进行了性能分析和对比,最后分析了各个CPU软核的特点。 展开更多

关键词 嵌入式系统 CPU 软核 FPGA

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基于嵌入式PLC软核的通用保护平台设计与实现 被引量：16

3

作者 郭玮 田录林 +2 位作者 张永良 崔葛安 杨芸 《电力系统保护与控制》 EI CSCD 北大核心 2014年第16期122-126,共5页

提出了基于嵌入式PLC软核的通用配网保护平台设计方案。针对传统保护软件编程灵活性差,现场可配置能力弱的问题,在分析嵌入式PLC软核的特性并讨论了基于PLC软核技术实现110 kV及以下配网综合保护的可行性和优势的基础上,实现了基于嵌入... 提出了基于嵌入式PLC软核的通用配网保护平台设计方案。针对传统保护软件编程灵活性差,现场可配置能力弱的问题,在分析嵌入式PLC软核的特性并讨论了基于PLC软核技术实现110 kV及以下配网综合保护的可行性和优势的基础上,实现了基于嵌入式PLC软核的通用保护平台。设计了基于PLC软核的保护平台系统结构,然后在以ARM9200芯片为核心的硬件平台上实现了PLC软核的移植和调试。采用模块化设计思路,通过结构化文本语言(Structure Text)实现了差动保护、零序电压保护、反时限电流保护等面向配网主设备的保护功能。最后,以10 kV电动机为被保护对象,从保护特性和电磁兼容性等方面进行测试。实验分析表明,所实现的保护平台具有配置灵活,通用性好的优点,各保护参数满足GB/T 7261-2008和GB/T 14598国标要求。 展开更多

关键词 嵌入式 PLC软核 ARM9200 配网综合保护

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嵌入式系统软硬件协同设计中的快速样机平台 被引量：9

4

作者 吴百锋 彭澄廉 孙晓光 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2003年第7期778-782,共5页

提出一种嵌入式系统软硬件协同设计的快速样机平台设计方案 ,该方案使用系统级可编程芯片和处理机软核技术来构成快速样机平台所需的FPGA阵列和规模可调的处理机 ,以此实现软硬件的更紧密灵活的耦合和更小的通信延迟 可重构逻辑的应用... 提出一种嵌入式系统软硬件协同设计的快速样机平台设计方案 ,该方案使用系统级可编程芯片和处理机软核技术来构成快速样机平台所需的FPGA阵列和规模可调的处理机 ,以此实现软硬件的更紧密灵活的耦合和更小的通信延迟 可重构逻辑的应用使得该快速样机平台具有简单规整的结构 ,一方面使得快速样机平台之间的扩展连接更为容易 。 展开更多

关键词 嵌入式系统 软硬件协同设计 处理器 硬核 软核

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软硬件协同的RapidIO接口带宽测试方法

5

作者 刘淑涛 张宗森 +1 位作者 魏璇 张卜方 《现代电子技术》 北大核心 2025年第1期163-167,共5页

RapidIO是一种高性能嵌入式系统互联技术。FPGA的SRIO控制器实现了RapidIO二代协议,在工程中经常需要得到其实际带宽性能以确定其是否满足应用需求。采用FPGA的嵌入式软核,配合FPGA内部硬件电路可搭建软硬件协同SOPC测试系统。该系统既... RapidIO是一种高性能嵌入式系统互联技术。FPGA的SRIO控制器实现了RapidIO二代协议,在工程中经常需要得到其实际带宽性能以确定其是否满足应用需求。采用FPGA的嵌入式软核,配合FPGA内部硬件电路可搭建软硬件协同SOPC测试系统。该系统既具有硬件可裁剪、可定制、扩展性强的特点,又具备软件灵活性的特点。此系统在硬件层面设计了周期采样单元、周期配置接口、锁存接口、上传接口;软件层面具备采样参数配置、采样控制、采样数据分析、结果呈现功能。通过软硬件代码的编写和验证,表明此方法可实时监测接口的带宽及抖动性能指标。 展开更多

关键词 RAPIDIO 嵌入式软核 SOPC 带宽测试 抖动 AXI-Stream接口

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基于FPGA嵌入式的多通道功率监测处理器设计 被引量：4

6

作者 董亮 汪敏 +1 位作者 苗爱敏 陈瑶玲 《电子测量技术》 2010年第3期58-63,105,共7页

在天文观测中,实时监测整个频带和易感频段内输入信号功率的变化是判断当前观测频段内是否受到RFI(Radio Frequency Interference,无线电干扰)的重要手段。本设计通过基于FPGA的嵌入式处理器Nios Ⅱ+DSP单元模式,通过帕斯瓦尔关系实时... 在天文观测中,实时监测整个频带和易感频段内输入信号功率的变化是判断当前观测频段内是否受到RFI(Radio Frequency Interference,无线电干扰)的重要手段。本设计通过基于FPGA的嵌入式处理器Nios Ⅱ+DSP单元模式,通过帕斯瓦尔关系实时判断易感干扰频段内信号流量的变化,通过在嵌入式采取相应的控制策略,达到消除突发性RFI的目的。最后通过实验板检测输入信号发生产生信号验证了该程序。 展开更多

关键词 无线电干扰RFI 嵌入式软核Niosⅱ 帕斯瓦尔关系

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基于嵌入式FPGA的数字化便携式LaBr_3(Ce)γ谱仪 被引量：5

7

作者 胡颖睿 肖无云 +1 位作者 梁卫平 李京伦 《核电子学与探测技术》 CAS CSCD 北大核心 2013年第8期928-931,976,共5页

介绍了一种采用嵌入式FPGA完成数字梯形滤波成形等核脉冲数字信号处理,NIOSII软核完成数字稳谱、核素识别等数据处理的4K道数字化便携式LaBr3(Ce)谱仪。测试表明,该数字化谱仪的能谱分辨率小于3%,最大脉冲通过率可达200 kcps以上。

关键词 嵌入式现场可编程门阵列 梯形滤波成形 数字稳谱 NIOSII软核 LaBr3(Ce)

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基于SoPC的嵌入式语音处理系统的设计与实现 被引量：4

8

作者 李颖宏 赵俊桃 《现代电子技术》 2009年第2期33-35,38,共4页

介绍一种基于SoPC技术实现的语音处理系统的设计方法。系统主要由CycloneⅡFPGA内嵌NiosⅡ软核处理器及音频编/解码芯片构成;通过构建嵌入式Linux操作系统来实现对音频信号的采集和回放处理。详细介绍通过SoPCBuilder配置NiosⅡ嵌入式... 介绍一种基于SoPC技术实现的语音处理系统的设计方法。系统主要由CycloneⅡFPGA内嵌NiosⅡ软核处理器及音频编/解码芯片构成;通过构建嵌入式Linux操作系统来实现对音频信号的采集和回放处理。详细介绍通过SoPCBuilder配置NiosⅡ嵌入式处理器、外围设备及接口的过程,以及嵌入式Linux操作系统在SoPC系统上的移植过程。利用SoPC系统的可裁减性以及嵌入式系统的可移植性,可使该设计作为一个子系统应用在如网络会议的视频电话中,该方法对SoPC系统的开发研究具有较高的参考价值。 展开更多

关键词 片上系统 嵌入式LINUX 音频编码 音频解码 软核处理器

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用于嵌入式系统多路SPI Master接口设计 被引量：3

9

作者 方承志 李元 李明栋 《电子测量技术》 2004年第2期3-4,共2页

文中根据嵌入式系统的特点,探讨多路 SPI总线接口的设计,该设计作为一个 IP软核,略作修改后,可以被无缝整合到各种形式的嵌入式系统中。

关键词 嵌入式系统 SPI Master接口 IP软核

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基于FPGA的大容量语音记录嵌入式系统设计 被引量：1

10

作者 李鸿强 苗长云 曹小东 《天津工业大学学报》 CAS 2006年第1期41-44,共4页

设计了一种新型的基于FPGA的大容量语音记录嵌入式系统,这一系统利用Altera公司的Nios软核处理器、高性能Stratix FPGA、IDE硬盘等作为硬件,并基于QuartusII 5．0、SOPC Builder等实现了系统的软件设计．

关键词 可编程逻辑器件 语音记录 嵌入式系统 软核处理器

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基于嵌入式MPMC接口的内存访问机制

11

作者 常振超 张兴明 +1 位作者 杨镇西 张丽 《计算机工程》 CAS CSCD 2012年第13期231-233,共3页

为满足用户不同的设计需求,采用将MicroBlaze软核的嵌入式子系统与综合软件环境设计相结合的设计方式。在现场可编程门阵列设计中,需要反复访问较大数据模板,在板级调试时因板上资源限制,数据模板不能进行板级功能验证。为此,利用嵌入... 为满足用户不同的设计需求,采用将MicroBlaze软核的嵌入式子系统与综合软件环境设计相结合的设计方式。在现场可编程门阵列设计中,需要反复访问较大数据模板,在板级调试时因板上资源限制,数据模板不能进行板级功能验证。为此,利用嵌入式系统提供的多端口存储控制器(MPMC)接口将数据文件下载到目标板的指定位置,访问已下载的数据并完成功能验证。实验结果表明,该架构设计合理,板上资源占用少,能够满足设计的时序和逻辑要求,较好地完成内存调度。 展开更多

关键词 嵌入式系统 软核 多端口存储控制器 内存访问 功能验证

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基于NIOS软核CPU技术的多路电话计费系统的设计与实现

12

作者 魏毅 柯赓 《现代电子技术》 2005年第9期76-78,共3页

随着CPU性能的大幅提升,嵌入式系统的设计已经进入了更广范的领域,在单一芯片上采用更合理的设计工艺、集成更多的逻辑功能,已经成为技术发展趋势。介绍了一套基于Altera公司的NIOS嵌入式CPU开发的多路电话计费系统。该系统充分体现了SO... 随着CPU性能的大幅提升,嵌入式系统的设计已经进入了更广范的领域,在单一芯片上采用更合理的设计工艺、集成更多的逻辑功能,已经成为技术发展趋势。介绍了一套基于Altera公司的NIOS嵌入式CPU开发的多路电话计费系统。该系统充分体现了SOPC(System On Programmable Chip)的设计理念,采用Altera公司的Cyclone芯片实现了多路电话的计费、管理等功能,获得了最优的性价比。从硬件设计与软件设计2个方面介绍了系统的开发流程,尤其是对片内资源的配置部分做了详细地说明。 展开更多

关键词 片上可编程系统 知识产权 软核处理器 嵌入式系统

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基于MicroBlaze软核处理器的Bootloader设计 被引量：5

13

作者 戴岳 苗长云 荣锋 《工矿自动化》 2009年第11期20-23,共4页

文章介绍了基于MicroBlaze软核处理器的Bootloader程序的设计,详细介绍了适用该程序的FPGA嵌入式系统的硬件配置及Bootloader程序设计的硬件逻辑设计流程和软件设计流程。该程序是在FPGA硬件配置完毕之后,在内部处理器上运行的一段启动... 文章介绍了基于MicroBlaze软核处理器的Bootloader程序的设计,详细介绍了适用该程序的FPGA嵌入式系统的硬件配置及Bootloader程序设计的硬件逻辑设计流程和软件设计流程。该程序是在FPGA硬件配置完毕之后,在内部处理器上运行的一段启动代码,用来将FLASH中的用户程序传输至外部RAM,并引导嵌入式系统从用户程序中开始运行。它解决了使用大规模复杂应用程序的嵌入式系统的引导问题,已在实际中应用,具有良好的适应性。 展开更多

关键词 嵌入式系统 BOOTLOADER程序 MicroBlaze软核处理器 硬件逻辑设计 软件设计 FPGA SPI FLASH

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基于μCOS-II的软定时器算法的研究与实现 被引量：1

14

作者 文远保 黄志葵 《计算机工程与科学》 CSCD 2006年第12期77-79,共3页

在嵌入式系统应用领域,软件代码日益复杂,但存储器、定时器等硬件资源相对有限。本文设计了一种在硬件资源紧张的情况下提供软定时器的算法。该算法不需要引入操作系统的支持,可以向多任务系统提供足够多的定时服务,并且不影响中断处理... 在嵌入式系统应用领域,软件代码日益复杂,但存储器、定时器等硬件资源相对有限。本文设计了一种在硬件资源紧张的情况下提供软定时器的算法。该算法不需要引入操作系统的支持,可以向多任务系统提供足够多的定时服务,并且不影响中断处理时间。 展开更多

关键词 μCOS-ⅱ软定时器 任务调度 定时精度 嵌入式系统 存储器资源 操作系统 软定时器资源

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基于SOPC的深空目标实时跟踪系统 被引量：5

15

作者 叶有时 唐林波 +1 位作者 赵保军 蔡晓芳 《系统工程与电子技术》 EI CSCD 北大核心 2009年第12期3002-3006,共5页

提出一种用可编程片上系统技术实现深空目标检测跟踪系统的方法,该系统采用单片FPGA构建双核系统,其中一个CPU进行检测跟踪,另一个CPU进行通信控制,将软硬件设计有机融为一体。根据不同算法对数据精度要求的不同,将浮点运算和定点运算... 提出一种用可编程片上系统技术实现深空目标检测跟踪系统的方法,该系统采用单片FPGA构建双核系统,其中一个CPU进行检测跟踪,另一个CPU进行通信控制,将软硬件设计有机融为一体。根据不同算法对数据精度要求的不同,将浮点运算和定点运算结合在一起,并使用定制指令、自定义逻辑和C2H等硬件加速技术,减少了处理时间。实测结果表明,该系统可对深空红外目标进行实时检测跟踪。 展开更多

关键词 深空目标检测 可编程片上系统 嵌入式软核处理器 双核 硬件加速

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基于SOPC的扩频接收机设计与实现 被引量：3

16

作者 魏敬法 胡永辉 李滚 《计算机工程》 CAS CSCD 北大核心 2009年第18期224-226,共3页

采用FPGA+DSP模式实现的扩频接收机存在开发周期长、实现难度大等缺点。针对该问题,基于可编程片上系统,利用FPGA内的嵌入式软核NiosⅡ代替DSP处理器和通用控制器,在单片FPGA内实现整个BD/GLONASS组合导航定位接收机。阐述匹配滤波器、... 采用FPGA+DSP模式实现的扩频接收机存在开发周期长、实现难度大等缺点。针对该问题,基于可编程片上系统,利用FPGA内的嵌入式软核NiosⅡ代替DSP处理器和通用控制器,在单片FPGA内实现整个BD/GLONASS组合导航定位接收机。阐述匹配滤波器、相关器、载波跟踪环和码跟踪环的算法理论与实现方法。在24h内的静态定位结果表明,该接收机的定位精度满足要求。 展开更多

关键词 导航 BD/GLONASS接收机 可编程片上系统 嵌入式软核Niosⅱ

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