基于FPGA的IRIG-B标准DC code编码器VHDL设计 被引量：2

1

作者 王丽秋 《现代电子技术》 2013年第3期119-121,共3页

为了实现靶场时统终端输出IRIG B标准DC code信号,采用VHDL语言在FPGA逻辑电路中设计了DC code编码器硬件电路,通过QuartusⅡ软件建立工程文件对VHDL语言DC code编码器电路进行编译和仿真,获得了符合IRIG B标准的DC code信号。经过实践... 为了实现靶场时统终端输出IRIG B标准DC code信号,采用VHDL语言在FPGA逻辑电路中设计了DC code编码器硬件电路,通过QuartusⅡ软件建立工程文件对VHDL语言DC code编码器电路进行编译和仿真,获得了符合IRIG B标准的DC code信号。经过实践验证,该电路具有实现方法简单、电路稳定性好、精度高的特点,实测同步精度小于1μs。 展开更多

关键词 irig—b DC code FPGA VHDL

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一种光IRIG-B/FT3码自适应技术及其在智能变电站测试仪器中的应用 被引量：5

2

作者 石光 赵勇 +4 位作者 杨经超 孔圣立 张道农 韩伟 张克声 《电力系统保护与控制》 EI CSCD 北大核心 2014年第18期110-115,共6页

为适应电力设备测试仪器的低成本、智能化、便携化需求,提出了一种光IRIG-B/FT3码自适应技术。该技术利用高频时钟对光串口IRIG-B/FT3码流进行处理,并根据两种输入码在编码特征和码流速率上的差异,自动识别光IRIG-B码报文和IEC60044-8(F... 为适应电力设备测试仪器的低成本、智能化、便携化需求,提出了一种光IRIG-B/FT3码自适应技术。该技术利用高频时钟对光串口IRIG-B/FT3码流进行处理,并根据两种输入码在编码特征和码流速率上的差异,自动识别光IRIG-B码报文和IEC60044-8(FT3)采样值报文,扩展了智能变电站测试仪器的功能。基于该技术研制的手持式智能变电站测试仪器,已成功应用于多个国内变电站的系统联调和现场测试。实测结果表明该技术的有效性和实用性,从而达到了减少测试仪器接口的数量、降低测试仪器功耗和成本的目的。 展开更多

关键词 智能变电站 光irig-b码 光FT3报文 自适应技术 测试仪器

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基于FPGA的IRIG-B(DC)解码编码器设计 被引量：6

3

作者 李盘文 高志远 《电子测量技术》 2016年第6期107-110,共4页

针对机载测试系统以IRIG-B(DC)码作为整个系统的时间源,提出一种基于FPGA的解码编码器设计。该设计采用FPGA为主控制器,实现IRIG-B(DC)码的解码、秒脉冲生成、IRIG-B码编码等功能,当外部IRIG-B码输入中断时,可按系统时间产生IRIG-B码输... 针对机载测试系统以IRIG-B(DC)码作为整个系统的时间源,提出一种基于FPGA的解码编码器设计。该设计采用FPGA为主控制器,实现IRIG-B(DC)码的解码、秒脉冲生成、IRIG-B码编码等功能,当外部IRIG-B码输入中断时,可按系统时间产生IRIG-B码输出。主要阐述了IRIG-B(DC)码的格式,详细介绍了IRIG-B(DC)码解码编码器的软硬件设计,在实验室搭建测试环境对该设计进行了测试验证,结果表明该设计能够稳定可靠运行。 展开更多

关键词 irig-b(DC)码 FPGA 解码 编码 秒脉冲

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数字化变电站IRIG-B码对时解码方案研究 被引量：3

4

作者 何小庆 杨训 徐皇清 《陕西电力》 2013年第6期39-42,共4页

为满足数字化变电站中IEC 61850标准对时钟同步的要求,通过比较常见的变电站时钟对时方法,重点介绍了IRIG-B码对时的解码实现方案,提出了一种通过调用延时来辨别码元的方法,并在CPLE上完成仿真测试,仿真表明这种方法具有较强的抗干扰性... 为满足数字化变电站中IEC 61850标准对时钟同步的要求,通过比较常见的变电站时钟对时方法,重点介绍了IRIG-B码对时的解码实现方案,提出了一种通过调用延时来辨别码元的方法,并在CPLE上完成仿真测试,仿真表明这种方法具有较强的抗干扰性与实用性。 展开更多

关键词 数字化变电站 时钟对时 irig—b码 CPLD

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基于MSP430＋FPGA的IRIG-B码时统设计 被引量：4

5

作者 佟刚 曹永刚 陈涛 《电光与控制》 北大核心 2009年第5期93-96,共4页

MSP430系列单片机是集成度高、超低功耗的16位单片机。Cyclone系列芯片是Altera公司推出的低价格、RAM可达288 kb的高容量的FPGA。IRIG-B码广泛应用于靶场时间信息的传递和各系统的时间同步。详细介绍了IRIG-B码解码电路和调制电路的硬... MSP430系列单片机是集成度高、超低功耗的16位单片机。Cyclone系列芯片是Altera公司推出的低价格、RAM可达288 kb的高容量的FPGA。IRIG-B码广泛应用于靶场时间信息的传递和各系统的时间同步。详细介绍了IRIG-B码解码电路和调制电路的硬件设计。MSP430的软件采用C语言编写,使程序有很强的可移植性。 展开更多

关键词 irig-b码 时间码 时统设计 MSP430 FPGA

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利用FPGA的IRIG-B码解码新方法 被引量：1

6

作者 秦娟 徐月超 李琨 《信号处理》 CSCD 北大核心 2015年第12期1654-1657,共4页

时间统一是现代航天和常规武器试验靶场的重要组成部分,本文提出了一种兼顾准确度和实时性的解码方法。该方法根据IRIG-B码的信号特征,设计了一种新的解码算法。根据脉冲宽度调制波形在寄存器中预设数值,将IRIG-B码和移位寄存器进行移... 时间统一是现代航天和常规武器试验靶场的重要组成部分,本文提出了一种兼顾准确度和实时性的解码方法。该方法根据IRIG-B码的信号特征,设计了一种新的解码算法。根据脉冲宽度调制波形在寄存器中预设数值,将IRIG-B码和移位寄存器进行移位比对,识别码字以及解析时间信息;根据起始标志信息特点预设111111110011111111移位比对,触发秒脉冲并输出1 pps信号。使用Model Sim进行了仿真,并下载到在Xilinx的XC3S1000芯片上实现。实验测试结果,秒脉冲触发误差小于20 ns。本文提出的方法具有精度高、简单实用、效率高等优点,具有较强的抗干扰性。 展开更多

关键词 时间统一 irig-b码 FPGA设计 解码

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IRIG-B码编码与时间解析显示机制分析与研究 被引量：5

7

作者 刘洪源 《电子测量技术》 北大核心 2021年第4期86-90,共5页

针对不同解码显示机制的跨整10年过程时间显示异常问题,分析研究了IRIG-B时间码编码规则和时间解析机制。重点通过跨整10年的时间段时间跳变试验对问题剖析,结合不同解码显示机制原理,使用比对方法,得出年信息显示跳变现象,是解码显示... 针对不同解码显示机制的跨整10年过程时间显示异常问题,分析研究了IRIG-B时间码编码规则和时间解析机制。重点通过跨整10年的时间段时间跳变试验对问题剖析,结合不同解码显示机制原理,使用比对方法,得出年信息显示跳变现象,是解码显示机制与现有时间信息编码机制不协调的结论。通过多组时间跳变试验验证了分析的正确性。结果表明,根据不同终端对时间解析显示需求的不同,研究并选择最佳的时间解析显示机制,对判读时间信息显示是否正确具有重要意义。 展开更多

关键词 irig-b 码元 时间信息 跳时

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IRIG-B时间格式码产生解调电路的设计 被引量：2

8

作者 周国平 屈少君 韩亮 《陕西科技大学学报（自然科学版）》 2012年第2期87-89,93,共4页

IRIG-B码作为一种国际通用的时间编码,在时间信息传输方面已得到广泛应用.通过介绍IRIG-B格式码的格式与规范,给出了应用于对时终端的IRIG-B格式时间码,产生解调电路的设计及相应的软件程序流程.

关键词 irig-b码 对时终端 编码解调

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IRIG-B码对时在保护测控装置中的实现 被引量：9

9

作者 刘浩 苏理 丁敏 《江苏电机工程》 2007年第1期48-50,共3页

介绍了IRIG-B码对时的概念、IRIG-B码对时模块的组成,其组成部分包括微处理器、电平转换器件、光耦隔离器。从IRIG-B码时间码元提取、帧参考点的提取和抗干扰3方面提出一种内嵌式IRIG-B码对时模块的设计方法,设计出的模块适用于各种电... 介绍了IRIG-B码对时的概念、IRIG-B码对时模块的组成,其组成部分包括微处理器、电平转换器件、光耦隔离器。从IRIG-B码时间码元提取、帧参考点的提取和抗干扰3方面提出一种内嵌式IRIG-B码对时模块的设计方法,设计出的模块适用于各种电压等级的保护及测控装置,具有较高的可靠性、准确性和实用性。 展开更多

关键词 电力系统 irig—b码 对时 保护测控装置

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机载设备IRIG-B(AC)码的滤波及其数字相位补偿 被引量：7

10

作者 张学明 张振娅 +1 位作者 戴明 孙敬辉 《光学精密工程》 EI CAS CSCD 北大核心 2009年第1期213-219,共7页

为了解决机载环境下交流B码信号中的噪声和畸变问题,提高解码的精度和稳定性,设计了中心频率在1 kHz的带通滤波器对IRIG-B码信号进行滤波;然后,针对滤波后所引入的相位差设计了一个数字补偿电路,对1 PPS信号进行相位校准,消除相位误差... 为了解决机载环境下交流B码信号中的噪声和畸变问题,提高解码的精度和稳定性,设计了中心频率在1 kHz的带通滤波器对IRIG-B码信号进行滤波;然后,针对滤波后所引入的相位差设计了一个数字补偿电路,对1 PPS信号进行相位校准,消除相位误差。实验结果表明:滤波有效地抑制了信号中的噪声,还将失真的信号还原成真实的信号,无用的频率信号以-34 dB/十倍频率的水平得到抑制;经过数字相位补偿后,不仅消除了由于滤波所引入的相位差,而且消除了由于过零器的过零精度等所引入的相位差,1 PPS准时点的精度由文献[1]的优于10μs提高到了优于3μs。该设计满足机载环境下交流时间码的解码要求,消除了噪声的干扰和信号的失真,提高了解码的精度和稳定性。 展开更多

关键词 机载设备 irig-b(AC)码 滤波 相位补偿

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IRIG-B码的时间信号产生器设计 被引量：3

11

作者 秦艺力 穆道生 《兵工自动化》 2005年第6期80-81,共2页

IRIG-B码的时间信号产生器,以频率源频标,从分频链上取得不同频率的信号,提供本地标准频率和标准时间信号。该产生器由输入整形、分频器、数字开关移相器、延迟秒形成、本地秒形成等电路组成。其设计包括方案确立、底层分析、顶层综合... IRIG-B码的时间信号产生器,以频率源频标,从分频链上取得不同频率的信号,提供本地标准频率和标准时间信号。该产生器由输入整形、分频器、数字开关移相器、延迟秒形成、本地秒形成等电路组成。其设计包括方案确立、底层分析、顶层综合、仿真等步骤。其中底层分析又分为分频单元及延时脉冲产生单元两部分。 展开更多

关键词 时间信号产生器 irig—b码 移相分频器

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基于边沿捕获的IRIG-B(DC)码解码的研究与应用 被引量：2

12

作者 贾成龙 亓常松 《浙江海洋学院学报（自然科学版）》 CAS 2013年第5期443-447,共5页

通过研究IRIG-B(DC)码原理,提出了基于定时器脉冲边沿捕获技术来实现IRIG-B(DC)码解码的新方法,并选用STM8S103芯片完成了IRIG-B(DC)码解码器的设计。功能仿真和实际测试表明该设计方法是一种解决自动化系统IRIGB码解码对时的有效方案... 通过研究IRIG-B(DC)码原理,提出了基于定时器脉冲边沿捕获技术来实现IRIG-B(DC)码解码的新方法,并选用STM8S103芯片完成了IRIG-B(DC)码解码器的设计。功能仿真和实际测试表明该设计方法是一种解决自动化系统IRIGB码解码对时的有效方案。目前,该设计已经成功应用于某变电站中的GPS&IRIG-B(DC)对时系统。 展开更多

关键词 irig—b(DC)码 边沿捕获 解码 对时

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基于FPGA的IRIG-B编码器实现 被引量：10

13

作者 庞吉耀 《现代电子技术》 2009年第24期113-117,共5页

旨在设计一款基于FPGA的IRIG-B时间系统,该系统采用FPGA作为控制器,GPS引擎M12T作为标准时钟源,利用M12T输出的100 pps信号触发IRIG-B编码模块,完成DC码编码。在DC码的基础上,通过正弦查找表实现了IRIG-B交流码的数字调制,同时设计调制... 旨在设计一款基于FPGA的IRIG-B时间系统,该系统采用FPGA作为控制器,GPS引擎M12T作为标准时钟源,利用M12T输出的100 pps信号触发IRIG-B编码模块,完成DC码编码。在DC码的基础上,通过正弦查找表实现了IRIG-B交流码的数字调制,同时设计调制输出电路。采用VHDL语言进行全数字设计,所有功能都由硬逻辑实现,保证了B码信号边沿的准确;带预进位功能的计时链,保证了B码绝对时间精准。软件仿真和示波器观测以及现场运行表明,系统设计达到了预期目标,定时精确可靠。 展开更多

关键词 授时码 irig-b 数字调制 GPS

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一种IRIG-B码对时系统方案软硬件设计的研究 被引量：3

14

作者 许仁安 黄作兵 吴大珩 《陕西电力》 2014年第7期91-93,共3页

MX3352是TI公司基于ARM Cortex-A8内核32位微控制器。IRIG-B码广泛应用于电力系统继电保护装置的时间同步。对基于MX3352芯片的IRIG-B码解码电路的硬件和软件方案实现过程进行了详细描述,并对软件设计中采用的2种不同方法来识别B码码元... MX3352是TI公司基于ARM Cortex-A8内核32位微控制器。IRIG-B码广泛应用于电力系统继电保护装置的时间同步。对基于MX3352芯片的IRIG-B码解码电路的硬件和软件方案实现过程进行了详细描述,并对软件设计中采用的2种不同方法来识别B码码元方案进行了介绍和比较。MX3352的软件采用C语言编写,程序具有很强的可移植性。 展开更多

关键词 MX3352 irig-b码 继电保护 对时系统

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基于LabVIEW的IRIG-B码实时采集与解析方法

15

作者 张敬礼 刘兴华 +1 位作者 侯朋 代雪峰 《舰船科学技术》 北大核心 2017年第9期151-154,共4页

授时设备是现代舰船噪声综合测试系统的重要组成部分。本文提出一种Lab VIEW平台下的授时设备IRIG-B码采集解析方法。首先利用授时设备产生的秒脉冲作为触发信号控制采集设备采集IRIG-B码,然后对IRIGB码进行门限判别预处理,再与位置识... 授时设备是现代舰船噪声综合测试系统的重要组成部分。本文提出一种Lab VIEW平台下的授时设备IRIG-B码采集解析方法。首先利用授时设备产生的秒脉冲作为触发信号控制采集设备采集IRIG-B码,然后对IRIGB码进行门限判别预处理,再与位置识别标志比对提取信号端点,最后将IRIG-B码与移位寄存器进行移位比对,识别码字以及解析时间信息。试验结果表明,该方法能够有效解决IRIG-B码实时采集解析问题,具有定时精度高、软件开销小、抗电磁干扰能力强等优点,可应用于授时设备的开发设计、工作状态监测、信号质量评估等。 展开更多

关键词 授时设备 irig-b码 LAbVIEW 解码

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提高IRIG—B码编码器时间同步精度方法的研究 被引量：3

16

作者 曾一凡 陈贵军 《计量学报》 CSCD 北大核心 2012年第6期565-568,共4页

提出了以单片微处理器为核心、辅以高速时间同步单元的电路方案，采用软硬件结合方法，设计并实现了IRIG—B码编码器。经验证，该方案结构简单，成本低，同步精度高，符合电力行业标准，满足电力系统运行要求。

关键词 计量学 irig—b码 同步精度 相位同步 单片机

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北斗/GPS双模授时的B码时统终端设计 被引量：9

17

作者 唐彬 徐庆芳 姚善化 《电测与仪表》 北大核心 2013年第8期116-120,共5页

针对B码时统终端的精度、稳定性等问题,结合B码的编解码和北斗/GPS双模授时的原理,从应用角度出发,提出一种利用可编程逻辑器件(FPGA)采集双模授时的时钟和时统终端的设计方法。结果表明:从接收器采集到的秒头和B码的秒头误差控制在纳秒... 针对B码时统终端的精度、稳定性等问题,结合B码的编解码和北斗/GPS双模授时的原理,从应用角度出发,提出一种利用可编程逻辑器件(FPGA)采集双模授时的时钟和时统终端的设计方法。结果表明:从接收器采集到的秒头和B码的秒头误差控制在纳秒级,从而达到同步授时的效果。 展开更多

关键词 北斗 GPS双模授时 FPGA irig—b码 时钟同步

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B码对时在保护测控装置中的实现 被引量：8

18

作者 刘浩 苏理 丁敏 《电网技术》 EI CSCD 北大核心 2006年第S2期63-65,共3页

由于IRIG-B码对时方式对时精确并简化了对时回路,现已在电力系统中得到了日益广泛的应用。该文在介绍了B码码形特点的基础上,提出了一种内嵌式B码对时模块的设计方法,该模块具有较高的可靠性,准确性和实用性。

关键词 b码 对时 保护 测控

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基于SOPC的B码时钟同步装置 被引量：3

19

作者 雷民 熊前柱 +3 位作者 章述汉 李前 胡浩亮 李鹤 《电测与仪表》 北大核心 2012年第11期85-89,共5页

研究了B码校时的原理,设计了B码发生和B码解码功能的时钟同步装置。该系统采用Altera公司的SOPC解决方案,可以准确地同外部输入信号自动保持同步,也可以输出标准的B码和秒脉冲同步信号,向电子式互感器和电子式互感器校验仪提供同步时钟... 研究了B码校时的原理,设计了B码发生和B码解码功能的时钟同步装置。该系统采用Altera公司的SOPC解决方案,可以准确地同外部输入信号自动保持同步,也可以输出标准的B码和秒脉冲同步信号,向电子式互感器和电子式互感器校验仪提供同步时钟。经过多次现场试验表明,该装置达到了设计要求,取得了较好的应用效果。 展开更多

关键词 电子式互感器较验装置 时钟同步 irig-b码 SOPC

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智能设备直接实现B码对时的方法 被引量：12

20

作者 赵文广 任小勇 《电力系统自动化》 EI CSCD 北大核心 2010年第10期113-115,共3页

分析了利用IRIG-B格式的时间码(简称B码)对时的基本原理和变电站智能设备采用B码对时相对传统的全球定位系统(GPS)脉冲对时的优点。给出一种实现B码对时的方法,以及对时接口的硬件电路及软件流程。实际应用表明利用B码对时具有较高的准... 分析了利用IRIG-B格式的时间码(简称B码)对时的基本原理和变电站智能设备采用B码对时相对传统的全球定位系统(GPS)脉冲对时的优点。给出一种实现B码对时的方法,以及对时接口的硬件电路及软件流程。实际应用表明利用B码对时具有较高的准确性及可靠性。 展开更多

关键词 智能设备 irig-b码 对时

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