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用一种新型FPGA逻辑单元实现乘法器
1
作者
李绪诚
龙飞
+2 位作者
徐昊
陆安江
张正平
《重庆工学院学报（自然科学版）》
2008年第5期77-79,98,共4页
提出了一种基于改进进位链的FPGA逻辑单元结构,并用4×4二进制乘法器进行了验证.仿真实验表明,新型逻辑单元结构具有较高性能,实现乘法器只需要18个逻辑单元,而CyclonII器件需要39个逻辑单元,因此新型的逻辑单元性能明显优于目前商...
提出了一种基于改进进位链的FPGA逻辑单元结构,并用4×4二进制乘法器进行了验证.仿真实验表明,新型逻辑单元结构具有较高性能,实现乘法器只需要18个逻辑单元,而CyclonII器件需要39个逻辑单元,因此新型的逻辑单元性能明显优于目前商用的FPGA.
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关键词
FPGA
逻辑单元
进位链
乘法器
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职称材料
题名
用一种新型FPGA逻辑单元实现乘法器
1
作者
李绪诚
龙飞
徐昊
陆安江
张正平
机构
贵州
大学电子科学与信息技术学院
贵州
民族学院数学与计算机学院
贵州通信建设设计资询有限公司
出处
《重庆工学院学报（自然科学版）》
2008年第5期77-79,98,共4页
基金
国家自然科学基金资助项目(60666001)
文摘
提出了一种基于改进进位链的FPGA逻辑单元结构,并用4×4二进制乘法器进行了验证.仿真实验表明,新型逻辑单元结构具有较高性能,实现乘法器只需要18个逻辑单元,而CyclonII器件需要39个逻辑单元,因此新型的逻辑单元性能明显优于目前商用的FPGA.
关键词
FPGA
逻辑单元
进位链
乘法器
Keywords
FPGA
logic cell
carry chains
multiplier
分类号
TN402 [电子电信—微电子学与固体电子学]
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题名
作者
出处
发文年
被引量
操作
1
用一种新型FPGA逻辑单元实现乘法器
李绪诚
龙飞
徐昊
陆安江
张正平
《重庆工学院学报（自然科学版）》
2008
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