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基于 DSP builder 与 FPGA 的数字脉冲处理算法研究
1
作者
李玉英
梁昊
+1 位作者
曾雅丹
刘汉超
《核电子学与探测技术》
CAS
CSCD
北大核心
2014年第2期148-151,共4页
研究了基于DSP builder与FPGA的数字脉冲处理算法,设计了一种基于数字脉冲处理技术的数字实时时间谱仪。谱仪数字恒比定时(dCFD)算法部分最终全部在FPGA中实现,简化了电路。并组建了一套测量22Na放射源的数字化正电子符合谱仪,对其进行...
研究了基于DSP builder与FPGA的数字脉冲处理算法,设计了一种基于数字脉冲处理技术的数字实时时间谱仪。谱仪数字恒比定时(dCFD)算法部分最终全部在FPGA中实现,简化了电路。并组建了一套测量22Na放射源的数字化正电子符合谱仪,对其进行测量得到该系统能量分辨达到3.90%,时间分辨达到157.6 ps,高于传统TDC测得的时间分辨率。
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关键词
数字恒比定时(dCFD)DSP
BUILDER
现场可编程门阵列
数字脉冲处理(DPP)
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职称材料
题名
基于 DSP builder 与 FPGA 的数字脉冲处理算法研究
1
作者
李玉英
梁昊
曾雅丹
刘汉超
机构
核探测与核
电子学
国家
重点
实验室
高能所、中科大
、中国科学技术大学
物理电子学安徽省重点实验室、中国科学技术大学近代物理系
出处
《核电子学与探测技术》
CAS
CSCD
北大核心
2014年第2期148-151,共4页
基金
国家自然科学基金资助项目(10975132)
文摘
研究了基于DSP builder与FPGA的数字脉冲处理算法,设计了一种基于数字脉冲处理技术的数字实时时间谱仪。谱仪数字恒比定时(dCFD)算法部分最终全部在FPGA中实现,简化了电路。并组建了一套测量22Na放射源的数字化正电子符合谱仪,对其进行测量得到该系统能量分辨达到3.90%,时间分辨达到157.6 ps,高于传统TDC测得的时间分辨率。
关键词
数字恒比定时(dCFD)DSP
BUILDER
现场可编程门阵列
数字脉冲处理(DPP)
Keywords
digital constant fraction discrimination
DSP builder
FPGA
digital pulse processing
分类号
TL82 [核科学技术—核技术及应用]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于 DSP builder 与 FPGA 的数字脉冲处理算法研究
李玉英
梁昊
曾雅丹
刘汉超
《核电子学与探测技术》
CAS
CSCD
北大核心
2014
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