基于DSRC协议的5.8 GHz收发电路设计与实现

1

作者 谢星 于玮 +2 位作者 孙玲 管图华 陆高勇 《现代电子技术》 2014年第17期9-12,共4页

提出了一种应用于专用短程通信(DSRC)协议的5.8 GHz收发电路的设计方案,给出了5.8 GHz收发电路的硬件设计方法,包括检波电路、接收电路、唤醒电路和发射电路的设计,最后列出了射频前端的测试方法。测试结果表明,该5.8 GHz收发电路的设... 提出了一种应用于专用短程通信(DSRC)协议的5.8 GHz收发电路的设计方案,给出了5.8 GHz收发电路的硬件设计方法,包括检波电路、接收电路、唤醒电路和发射电路的设计,最后列出了射频前端的测试方法。测试结果表明,该5.8 GHz收发电路的设计完全符合DSRC协议国家标准,并且验证了该设计方案的可行性与成功性,该系统性能稳定、实用性强,具有很好的市场推广价值。 展开更多

关键词 专用短程通信 5 8 GHz收发电路 射频前端 DSRC协议国家标准

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HgCdTe柔性中波红外探测器放大电路设计及噪声分析 被引量：5

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作者 陈鸣 余晨辉 +1 位作者 许金通 李向阳 《红外技术》 CSCD 北大核心 2019年第7期661-665,共5页

设计了一种应用于HgCdTe柔性中波红外探测器的微弱信号放大电路,该电路由电桥电路、调零电路及滤波电路组成。采用平衡电桥与仪表运算放大器INA333相结合的方式搭建电桥电路;并针对探测器直流分量过大问题,设计了可调零、带增益的信号... 设计了一种应用于HgCdTe柔性中波红外探测器的微弱信号放大电路,该电路由电桥电路、调零电路及滤波电路组成。采用平衡电桥与仪表运算放大器INA333相结合的方式搭建电桥电路;并针对探测器直流分量过大问题,设计了可调零、带增益的信号处理电路;最后通过由二阶有源滤波器组成的滤波电路将高频噪声滤除。利用运算放大器的En-In噪声模型,对放大电路进行了噪声分析,并测试了探测器在弯曲状态下的响应性能。实验结果表明,所设计的放大电路增益为86dB,噪声均方根值低于6.1mV;柔性探测器的曲率半径为3mm;当探测器光敏面上的光谱辐照功率为6.75×10^-7W时,产生的光电信号约102.V。 展开更多

关键词 柔性红外探测器 微弱信号放大 噪声分析 弯曲测试

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基于I^2C总线实验设计 被引量：11

3

作者 宣慧 孙佳昊 +2 位作者 程实 蔡艳婧 胡传志 《实验技术与管理》 CAS 北大核心 2020年第1期52-55,共4页

鉴于I^2C总线在嵌入式系统中的重要性,设计I^2C总线实验已成为嵌入式系统实验教学中一个极重要的教学环节。在详细分析I^2C总线工作原理的基础上,以TM4C123GH6PM微控制器和LM75A温度传感器为例,研究I^2C总线的实验设计方法,包括硬件电... 鉴于I^2C总线在嵌入式系统中的重要性,设计I^2C总线实验已成为嵌入式系统实验教学中一个极重要的教学环节。在详细分析I^2C总线工作原理的基础上,以TM4C123GH6PM微控制器和LM75A温度传感器为例,研究I^2C总线的实验设计方法,包括硬件电路设计和软件程序设计。该实验设计在实验教学中取得了良好的效果,提高了嵌入式系统实验教学的水平。 展开更多

关键词 I^2C总线 实验设计 嵌入式系统 微控制器

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采用卷积神经网络的室内可见光定位方法

4

作者 王亮 孙海燕 《导航定位学报》 北大核心 2025年第1期128-136,共9页

针对多径反射与系统噪声导致室内可见光定位精度下降的问题,提出一种基于扩张卷积网络的室内可见光三维定位方法:基于皮尔森相关性系数对采集的接收信号强度向量进行过滤,删除系统噪声引起的非线性失真接收信号强度向量,以提高训练的神... 针对多径反射与系统噪声导致室内可见光定位精度下降的问题,提出一种基于扩张卷积网络的室内可见光三维定位方法:基于皮尔森相关性系数对采集的接收信号强度向量进行过滤,删除系统噪声引起的非线性失真接收信号强度向量,以提高训练的神经网络精度;然后,将接收信号强度向量集建立的指纹库传入神经网络进行训练,利用神经网络较强的三维空间结构表达能力拟合多径反射和系统噪声下的非线性指纹库。仿真结果表明,在7 m×7 m×3 m的室内环境下,所提方法的平均定位误差可达0.91 cm,其中90%样本的定位误差小于1.17 cm;此外,所提方法的平均定位误差较全连接神经网络和卷积神经网络可分别降低0.82 cm和0.56 cm,证明所提方法在多径反射与系统噪声环境下具有较好的定位性能。 展开更多

关键词 可见光通信系统 室内定位 物联网 卷积神经网络(CNN) 可见光定位

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面向全同态加密的有限域FFT算法FPGA设计 被引量：15

5

作者 施佺 韩赛飞 +3 位作者 黄新明 孙玲 谢星 唐天泽 《电子与信息学报》 EI CSCD 北大核心 2018年第1期57-62,共6页

大数乘法是全同态加密算法中一个不可或缺的单元模块,也是其中耗时最多的模块,设计一个性能优良的大数乘法器有助于推进全同态加密的实用化进程。针对SSA大数乘法器的实现需求,该文采用可综合Verilog HDL语言完成了一个16×24 bit... 大数乘法是全同态加密算法中一个不可或缺的单元模块,也是其中耗时最多的模块,设计一个性能优良的大数乘法器有助于推进全同态加密的实用化进程。针对SSA大数乘法器的实现需求,该文采用可综合Verilog HDL语言完成了一个16×24 bit有限域FFT算法的FPGA设计,通过构建树型大数求和单元和并行化处理方法有效提高了FFT算法的速度。与VIM编译环境下的系统级仿真结果比较,验证了有限域FFT算法FPGA设计的正确性。 展开更多

关键词 全同态加密 大数乘法 有限域快速傅里叶变换 现场可编程门阵列

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一种新的8B/10B编解码设计 被引量：3

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作者 刘文杰 施佺 +1 位作者 郭林 孙玲 《光通信技术》 CSCD 北大核心 2012年第12期52-54,共3页

在分析8B/10B编解码规则和输入信号与对应数据间逻辑关系的基础上,提出了一种新的编解码和游程值计算方法,完成了编解码电路的可综合Verilog HDL语言设计,并在Quartus Ⅱ和ModelSim软件环境下实现了电路综合及仿真。仿真结果表明,该方... 在分析8B/10B编解码规则和输入信号与对应数据间逻辑关系的基础上,提出了一种新的编解码和游程值计算方法,完成了编解码电路的可综合Verilog HDL语言设计,并在Quartus Ⅱ和ModelSim软件环境下实现了电路综合及仿真。仿真结果表明,该方法与现有8B/10B编解码方案相比,最大工作频率显著提高,资源占用相对较少且可靠性得到增强。 展开更多

关键词 8B 10B Veri LOG HDL FPGA

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新型流水线ADC的设计与分析 被引量：8

7

作者 程梦璋 景为平 《电子科技大学学报》 EI CAS CSCD 北大核心 2008年第6期930-933,共4页

设计和分析了一种新型的流水线式模数转换器。电路设计主要包括一种开关采样差分折叠式共源共栅增益级、两个时钟控制动态比较器组成的两位模数转换器、两位数模转换器。由于采用了电容下极板采样、全差分和开关栅电压自举,有效地消除... 设计和分析了一种新型的流水线式模数转换器。电路设计主要包括一种开关采样差分折叠式共源共栅增益级、两个时钟控制动态比较器组成的两位模数转换器、两位数模转换器。由于采用了电容下极板采样、全差分和开关栅电压自举,有效地消除了开关管的电荷注入效应、时钟馈通效应引起的采样信号的误差,提高了模数转换器的线性度、信噪比、转换精度和速度。该转换器的设计是在0.6μm CMOS工艺下实现,转换器在采样频率为5MHz、信号频率为500kHz时功耗为70mW;SFDR为80 dB。 展开更多

关键词 折叠式 流水线 采样 呆持电路 信噪比

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一种多芯片封装(MCP)的热仿真设计 被引量：5

8

作者 王金兰 仝良玉 +1 位作者 刘培生 缪小勇 《计算机工程与科学》 CSCD 北大核心 2012年第4期28-31,共4页

集成电路封装热设计的目的在于尽可能地提高封装的散热能力,确保芯片的正常运行。多芯片封装(MCP)可以提高封装的芯片密度,提高处理能力。与传统的单芯片封装相比,由于包含多个热源,多芯片封装的热管理变得更为关键。本文针对一种2维FBG... 集成电路封装热设计的目的在于尽可能地提高封装的散热能力,确保芯片的正常运行。多芯片封装(MCP)可以提高封装的芯片密度,提高处理能力。与传统的单芯片封装相比,由于包含多个热源,多芯片封装的热管理变得更为关键。本文针对一种2维FBGAMCP产品,进行有限元建模仿真,并获得封装的热性能。通过热阻比较的方式,分析了不同的芯片厚度对封装热性能的影响。针对双芯片封装,通过对不同的芯片布局进行建模仿真,获得不同的芯片布局对封装热阻的影响。最后通过封装热阻的比较,对芯片的排列布局进行了优化。分析结果认为芯片厚度对封装热阻的影响并不明显,双芯片在基板中心呈对称排列时封装的热阻最小。 展开更多

关键词 多芯片封装 FBGA 热管理 有限元仿真

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CMOS环型压控振荡器的设计 被引量：7

9

作者 程梦璋 景为平 《电子科技大学学报》 EI CAS CSCD 北大核心 2009年第2期305-308,共4页

设计和分析了一种高稳定度、低噪声的CMOS环型压控振荡器。该电路具有较低的压控增益,较好的线性范围,较低的相位噪声。应用复制偏置电路,对差分环型压控振荡器的控制电压进行复制,通过对压控振荡器相位噪声的计算和分析,以提高对环型... 设计和分析了一种高稳定度、低噪声的CMOS环型压控振荡器。该电路具有较低的压控增益,较好的线性范围,较低的相位噪声。应用复制偏置电路,对差分环型压控振荡器的控制电压进行复制,通过对压控振荡器相位噪声的计算和分析,以提高对环型压控振荡器电源电压噪声和衬底噪声的抑制。该设计和分析是基于上华0.5μmCMOS工艺,当控制电压从1～3V变化时,相应的振荡频率为100～500MHz;在偏离中心频率1kHz、10kHz、100kHz和1MHz频率处得到的相位噪声分别为?50dBc/Hz、?75dBc/Hz、?98dBc/Hz和?120dBc/Hz。 展开更多

关键词 延迟单元 相位噪声 时间抖动 压控振荡器

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基于可信对等的分布式入侵检测通信框架设计 被引量：4

10

作者 金丽 朱浩 《计算机工程与设计》 CSCD 北大核心 2010年第5期969-972,共4页

为了提高分布式入侵检测的实时性和安全性,提出了一种可信对等的分布式入侵检测通信框架的模型。该模型借鉴了P2P和代理技术,不同网络节点中的入侵检测代理是对等的,它们之间通过共享检测信息进行整体协防。该模型还借鉴了安全通信技术... 为了提高分布式入侵检测的实时性和安全性,提出了一种可信对等的分布式入侵检测通信框架的模型。该模型借鉴了P2P和代理技术,不同网络节点中的入侵检测代理是对等的,它们之间通过共享检测信息进行整体协防。该模型还借鉴了安全通信技术,在网络中建立了一个认证服务器,不在同一网络节点的任何两个网络进程的通信必须通过该认证服务器,提高了入侵检测自身的安全性。设计实现了一个原型系统,原型系统的实验结果表明了该模型的正确性和可行性。 展开更多

关键词 分布式 入侵检测 代理 对等 多播

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基于MSP430的双界面读卡器设计 被引量：2

11

作者 杨玲玲 谢星 +1 位作者 孙玲 吴烨 《现代电子技术》 2014年第16期18-20,23,共4页

市场对双界面智能卡的需求不断增多,这也加速了双界面读卡器产业的发展。在此主要介绍一种基于MSP430的双界面读卡器的设计,给出硬件系统的电路设计方法以及软件架构。该系统以MSP430F5418为主控芯片,同时主要对接触式读卡电路和非接触... 市场对双界面智能卡的需求不断增多,这也加速了双界面读卡器产业的发展。在此主要介绍一种基于MSP430的双界面读卡器的设计,给出硬件系统的电路设计方法以及软件架构。该系统以MSP430F5418为主控芯片,同时主要对接触式读卡电路和非接触式读卡电路进行了设计和实现。接触式模块符合ISO7816标准要求,非接触读卡电路模块内嵌CL RC632,采用13.56 MHz非接触射频技术进行读/写。测试结果表明,该读卡器系统性能稳定、实用性强,具有很好的市场推广价值。 展开更多

关键词 双界面智能卡 MSP430F5418 读卡器 CL RC632

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基于高性能数字芯片的多协议可编程接口设计

12

作者 陈磊 陈子晏 +2 位作者 杨华 赖宗声 景为平 《半导体技术》 CAS CSCD 北大核心 2008年第8期730-733,共4页

设计并制作了一种基于SMIC18混合信号工艺,可用于高性能数字芯片中的多协议、可编程输入接口电路。Cadence SPECTRE仿真及测试结果表明,电路可以在多种不同的JEDEC标准协议下工作并自由切换,并加入可控延迟,根据不同协议,电路可以编程... 设计并制作了一种基于SMIC18混合信号工艺,可用于高性能数字芯片中的多协议、可编程输入接口电路。Cadence SPECTRE仿真及测试结果表明,电路可以在多种不同的JEDEC标准协议下工作并自由切换,并加入可控延迟,根据不同协议,电路可以编程选择不同的输入缓冲路径,在同一模块上集成10种JEDEC协议标准。电路同时可以在高至200MHz的HSTL协议下工作,也可以满足LVTTL等协议的5V耐压需求。 展开更多

关键词 输入输出接口模块 可编程控制 JEDEC标准 可编程延迟

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CPU卡虚拟原型验证平台设计

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作者 葛滨 景为平 +1 位作者 鲁华祥 方睿 《计算机应用与软件》 CSCD 北大核心 2014年第5期319-322,333,共5页

针对CPU卡设计规模小以及设计时间和成本有限等特点,选择合适的片上总线互联结构,设计一套虚拟原型验证平台。介绍虚拟原型验证平台的原理,着重分析采用AHB-lite片上总线结构能够极大地减小CPU卡设计的复杂度。运用搭建的CPU卡虚拟原型... 针对CPU卡设计规模小以及设计时间和成本有限等特点,选择合适的片上总线互联结构,设计一套虚拟原型验证平台。介绍虚拟原型验证平台的原理,着重分析采用AHB-lite片上总线结构能够极大地减小CPU卡设计的复杂度。运用搭建的CPU卡虚拟原型验证平台,对CPU卡的架构和自主设计的IP模块进行测试,并在实际的物理原型验证平台上对整个架构进行测试。测试结果表明设计的虚拟原型验证平台可以切实地减少设计的时间和成本。 展开更多

关键词 片上总线 CPU卡 虚拟原型平台 系统架构 功能验证

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一种低硬件开销的高级加密标准设计

14

作者 陈海进 景为平 《计算机工程》 EI CAS CSCD 北大核心 2005年第20期165-167,共3页

在智能卡、PDA等便携式设备中,希望使用面积小的密码芯片。通过对AES算法进行结构优化,有效地减小了硬件实现时的开销。使用Verilog HDL语言设计并在Altera APEX20K器件中验证通过,设计集成了加密/解密模式及所有3种密钥长度,为进一步的... 在智能卡、PDA等便携式设备中,希望使用面积小的密码芯片。通过对AES算法进行结构优化,有效地减小了硬件实现时的开销。使用Verilog HDL语言设计并在Altera APEX20K器件中验证通过,设计集成了加密/解密模式及所有3种密钥长度,为进一步的VLSI实现提供了FPGA原形验证。 展开更多

关键词 高级加密标准 CMOS 逻辑综合 FPGA

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基于ISO15693协议的RFID智能货架管理系统设计 被引量：16

15

作者 张成吉 景为平 《仪表技术与传感器》 CSCD 北大核心 2019年第1期50-54,共5页

针对制造业中待加工物品管理效率低下的问题,设计了一套基于射频识别(RFID)的智能货架管理系统。通过RFID阅读器和手持式智能终端实时进行数据采集,采用复杂事件处理(CEP)进行数据清洗、过滤并传入制造企业生产过程执行系统(MES)。基于I... 针对制造业中待加工物品管理效率低下的问题,设计了一套基于射频识别(RFID)的智能货架管理系统。通过RFID阅读器和手持式智能终端实时进行数据采集,采用复杂事件处理(CEP)进行数据清洗、过滤并传入制造企业生产过程执行系统(MES)。基于ISO15693协议对RFID阅读器实现发送功率可调、网口通信功能设计,借助. NET平台开发RFID中间件程序及网络应用程序,方便用户实时查询物品信息。系统已在制造企业中应用,效果卓著,性能良好。经实际测试,系统能够快速、稳定、高效地工作,实现了对待加工物品的实时监测和生产计划的高效执行。 展开更多

关键词 射频识别(RFID) ISO15693 复杂事件处理(CEP) .NET

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2.45GHz射频识别系统设计 被引量：5

16

作者 丁晗 景为平 《计算机工程与设计》 北大核心 2019年第7期1852-1858,共7页

提出一种基于国标空中接口协议GB/T28925的2.45 GHz射频识别(RFID)读写系统设计,介绍阅读器和有源标签的硬件和软件系统设计。阅读器是基于ARM Cortex-M3内核处理器设计的远距离阅读器,阅读器通过串口或以太网与上位机通信,标签采用超... 提出一种基于国标空中接口协议GB/T28925的2.45 GHz射频识别(RFID)读写系统设计,介绍阅读器和有源标签的硬件和软件系统设计。阅读器是基于ARM Cortex-M3内核处理器设计的远距离阅读器,阅读器通过串口或以太网与上位机通信,标签采用超低功耗芯片实现,解决标签耗电大的问题,借助C#完成控制终端的开发平台设计。采用成帧二进制树算法提高标签防碰撞性能,提高系统对标签的识别率,测试结果表明,阅读器能够快速、稳定、高效地识别标签。 展开更多

关键词 射频识别 2.45G阅读器 有源标签 防碰撞 国标空中接口协议GB/T28925

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基于ISO 15693射频标签的RFID手术器械管理系统设计 被引量：5

17

作者 陆志峰 景为平 《实验室研究与探索》 CAS 北大核心 2017年第9期275-279,共5页

针对手术异物遗留(RSIS)的难题,提出了基于ISO15693射频标签的射频识别(RFID)手术器械管理系统。将ISO15693射频标签内置在手术器械中,采用三通道天线协调工作的RFID阅读器完成对手术器械的登记录入、回收统计和寻找扫描。借助Qt图形界... 针对手术异物遗留(RSIS)的难题,提出了基于ISO15693射频标签的射频识别(RFID)手术器械管理系统。将ISO15693射频标签内置在手术器械中,采用三通道天线协调工作的RFID阅读器完成对手术器械的登记录入、回收统计和寻找扫描。借助Qt图形界面应用程序开发框架,实现对手术器械管理系统的上位机操作界面的设计。实验表明系统能够稳定、快速、准确地实现对手术器械使用和回收的智能化管理,有效地防止了手术器械遗留问题的发生,给手术安全提供了更加高效可靠的保障。系统现已具备实际应用能力,正在进行面向医疗实用的推广。 展开更多

关键词 手术异物遗留 15693国际标准 射频识别 手术器械

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面向PCIE 3.0总线的扰频和去扰频器FPGA设计 被引量：1

18

作者 陆启立 黄新明 +3 位作者 孙玲 谢星 韩赛飞 唐天泽 《现代电子技术》 北大核心 2018年第16期47-50,54,共5页

在分析PCI Express 3.0总线物理层协议的基础上,提出一种实现扰频器和去扰频器的设计方案。利用可综合Verilog HDL语言在Vivado平台下完成电路的设计综合并下载到FPGA开发板进行测试与验证。验证结果表明,设计满足PCI Express 3.0总线... 在分析PCI Express 3.0总线物理层协议的基础上,提出一种实现扰频器和去扰频器的设计方案。利用可综合Verilog HDL语言在Vivado平台下完成电路的设计综合并下载到FPGA开发板进行测试与验证。验证结果表明,设计满足PCI Express 3.0总线物理层的要求,占用逻辑资源少,可应用到总线物理层的总体设计中。 展开更多

关键词 PCI EXPRESS 3.0总线 扰频器 去扰频器 现场可编程门阵列 VIVADO 逻辑资源

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一种自适应图像插值算法及加速引擎的协同设计 被引量：1

19

作者 严忻恺 丁晟 《电子与信息学报》 EI CSCD 北大核心 2023年第9期3284-3294,共11页

为提高高清彩色图像超分辨率重建效果,该文提出了一种基于边缘对比度的新型自适应图像插值算法。使用边缘对比度检测和不同尺度的感受野来自适应选择Lanczos插值的系数,自适应性和不同感受野可以进一步提升图像放大质量,图像质量相比于... 为提高高清彩色图像超分辨率重建效果,该文提出了一种基于边缘对比度的新型自适应图像插值算法。使用边缘对比度检测和不同尺度的感受野来自适应选择Lanczos插值的系数,自适应性和不同感受野可以进一步提升图像放大质量,图像质量相比于双线性插值平均峰值信噪比(PSNR)提高1.1 dB,结构相似度(SSIM)提高0.025,图像感知相似度(LPIPS)提高0.051,相比于双三次插值平均PSNR提高0.34 dB,SSIM提高0.01,LPIPS提高0.033。同时为减少硬件资源以及提高存储效率协同设计了一种高并行、高能效的加速插值引擎架构,通过两级数据重用和系数脉动机制极大提高计算访存比。加速引擎在16 nm工艺库的综合结果达到2 GHz时钟频率;在Xilinx Zynq Ultra scale+xczu15eg FPGA上工作频率达到200 MHz,帧速度(fps)达到60的实时性能。 展开更多

关键词 插值算法 自适应 并行度 高能效 加速引擎

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动态环境下自主机器人的双机制切向避障 被引量：3

20

作者 章一鸣 姚文广 陈海进 《浙江大学学报（工学版）》 EI CAS CSCD 北大核心 2024年第4期779-789,846,共12页

针对机器人工作环境的动态随机性,提出面向双机制切向避障的改进人工势场法.针对传统人工势场法的局部极小值陷阱问题,提出静态避障机制,在规划开始前对地图进行预处理,预测局部极小值点并将障碍物分成连通与非连通障碍物,结合切向避障... 针对机器人工作环境的动态随机性,提出面向双机制切向避障的改进人工势场法.针对传统人工势场法的局部极小值陷阱问题,提出静态避障机制,在规划开始前对地图进行预处理,预测局部极小值点并将障碍物分成连通与非连通障碍物,结合切向避障实现静态切向避障.以静态避障机制为基础,针对动态障碍物,提出动态避障机制,通过实时调整碰撞风险系数并选择系数最大的障碍物进行避障角补偿,实现动态切向避障.通过状态决策统筹静态、动态切向避障机制与全局路径规划,实现混合规划与设计.设计仿真和全向移动平台,对所提方法进行验证测试.结果表明,所提方法在不同环境复杂下均有效解决了传统人工势场法的局部极小值陷阱问题,实现了动态环境下快速自主避障.对比3种方法避开不同类型障碍物的平均耗时,所提方法比动态窗口法(DWA)提升55%,比时间弹性带法(TEB)提升40%;对比3种方法导航不同复杂度地图的平均耗时,所提方法比DWA提升39%,比TEB提升22%. 展开更多

关键词 动态环境 人工势场法 局部极小值陷阱 双机制切向避障 状态决策 混合规划

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