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FPGA/CPLD的管脚设置对信号完整性的影响分析研究
被引量：
1
1
作者
郭利文
邓月明
莫晓山
《现代电子技术》
北大核心
2015年第17期61-64,共4页
随着FPGA以及CPLD在现代电子线路中的出现和使用越来越多,同时电子器件的集成度越来越高、速度越来越快,对电路的稳定性有着越来越严苛的要求,在硬件上表现为对系统电源完整性和信号完整性的严苛要求。从信号完整性的角度出发,通过分析...
随着FPGA以及CPLD在现代电子线路中的出现和使用越来越多,同时电子器件的集成度越来越高、速度越来越快,对电路的稳定性有着越来越严苛的要求,在硬件上表现为对系统电源完整性和信号完整性的严苛要求。从信号完整性的角度出发,通过分析硬件工程师和FPGA/CPLD软件设计工程师容易疏忽的问题,以Altera Cyclone IV系列FPGA进行重点研究,从硬件的角度确保FPGA/CPLD系统的稳定性和鲁棒性。
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关键词
FPGA
CPLD
时序
信号完整性
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职称材料
题名
FPGA/CPLD的管脚设置对信号完整性的影响分析研究
被引量：
1
1
作者
郭利文
邓月明
莫晓山
机构
富士
康
科技
集团
鸿
富锦
精密
工业
(
深圳
)
有限公司
湖南师范大学物理与信息科学学院
湖南省计量检测研究院
出处
《现代电子技术》
北大核心
2015年第17期61-64,共4页
基金
全国工程专业学位研究生教育自选课题(2014-JY-074)
湖南省普通高校教学改革研究项目(湘通教[2012]401号)
+2 种基金
湖南省普通高校实践教学建设项目(湘教通(2013)295号)
湖南省自然科学基金资助项目(13JJ6031)的资助
湖南师范大学第三批产学研合作示范基地项目(20140616-01)
文摘
随着FPGA以及CPLD在现代电子线路中的出现和使用越来越多,同时电子器件的集成度越来越高、速度越来越快,对电路的稳定性有着越来越严苛的要求,在硬件上表现为对系统电源完整性和信号完整性的严苛要求。从信号完整性的角度出发,通过分析硬件工程师和FPGA/CPLD软件设计工程师容易疏忽的问题,以Altera Cyclone IV系列FPGA进行重点研究,从硬件的角度确保FPGA/CPLD系统的稳定性和鲁棒性。
关键词
FPGA
CPLD
时序
信号完整性
Keywords
FPGA
CPLD
timing sequence
signal integrity
分类号
TN911.634 [电子电信—通信与信息系统]
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题名
作者
出处
发文年
被引量
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1
FPGA/CPLD的管脚设置对信号完整性的影响分析研究
郭利文
邓月明
莫晓山
《现代电子技术》
北大核心
2015
1
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