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FC-AE-ASM协议IP核验证方法和技术研究 被引量:5
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作者 陈艇 汪欣 +1 位作者 徐庆阳 沈剑良 《通信学报》 EI CSCD 北大核心 2018年第A02期50-53,共4页
FC-AE-ASM协议被广泛应用于航空电子系统中数据传输和存储,由于协议的复杂性且涉及数模混合电路的设计,FC-AE-ASM协议IP核的协议兼容性是验证重点和难点。提出了使用VIP(verificationIP)仿真验证和基于FC测试仪的FPGA原型验证2种方法相... FC-AE-ASM协议被广泛应用于航空电子系统中数据传输和存储,由于协议的复杂性且涉及数模混合电路的设计,FC-AE-ASM协议IP核的协议兼容性是验证重点和难点。提出了使用VIP(verificationIP)仿真验证和基于FC测试仪的FPGA原型验证2种方法相结合的验证方法,分别搭建了可靠的验证平台,并针对控制器中的关键功能展开了验证技术的研究,使控制器的功能和代码覆盖率达到快速收敛目的。 展开更多
关键词 FC-AE-ASMIP核 验证IP 协议分析仪
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面向软件定义互连系统的多协议交换电路 被引量:4
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作者 董春雷 沈剑良 +3 位作者 李沛杰 王盼 薄光明 路凯 《通信学报》 EI CSCD 北大核心 2024年第5期44-53,共10页
为满足软件定义互连系统中异构协议融合互连的需求,提出一种两级多协议交换电路,该电路通过融合共享缓存与Crossbar这2种交换架构,实现对多种异构协议的报文转发需求的兼顾。同时,提出一种基于时隙的多级仲裁调度方法,实现调度过程中时... 为满足软件定义互连系统中异构协议融合互连的需求,提出一种两级多协议交换电路,该电路通过融合共享缓存与Crossbar这2种交换架构,实现对多种异构协议的报文转发需求的兼顾。同时,提出一种基于时隙的多级仲裁调度方法,实现调度过程中时间与空间的解耦。仿真结果表明,所设计的交换电路能够弹性适应绑定模式变化引起的交换规模及端口缓存、端口带宽需求变化,缓存资源利用率相较传统组合输入输出排队(CIOQ)架构最高提高87.5%,转发时延低至数十纳秒,不仅适用于RapidIO、光纤通道(FC)、Ethernet、外设部件互连快速总线(PCIe)单一协议交换,而且适用于多种协议组合的混合协议交换。 展开更多
关键词 软件定义互连 异构协议 交换结构 时分复用 通道绑定 缓存利用率
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分布式机会阵雷达拟态信号处理方法 被引量:2
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作者 高彦钊 王建明 +2 位作者 雷志勇 张宇 陶常勇 《现代雷达》 CSCD 北大核心 2021年第11期1-8,共8页
针对分布式机会阵雷达多功能一体化条件下信号处理高性能、高效能与高灵活兼顾的需求,基于拟态计算技术,提出了拟态信号处理方法,对算粒抽象、构件实现、互连结构、存储结构以及处理流程等进行了设计,并在由现场可编程门阵列、数字信号... 针对分布式机会阵雷达多功能一体化条件下信号处理高性能、高效能与高灵活兼顾的需求,基于拟态计算技术,提出了拟态信号处理方法,对算粒抽象、构件实现、互连结构、存储结构以及处理流程等进行了设计,并在由现场可编程门阵列、数字信号处理以及PowerPC等组成的异构计算平台上构建了拟态信号处理验证系统,最后针对空时自适应处理、脉冲多普勒以及大斜视合成孔径雷达成像等典型分布式机会阵雷达工作模式对拟态信号处理方法的性能、灵活性、计算正确性以及重构效率等进行了全面验证。验证结果表明:拟态信号处理方法在有效提升信号处理性能的同时,能够获得分布式机会阵雷达多种工作模式下信号处理的高灵活性。 展开更多
关键词 分布式机会阵 拟态计算 雷达信号处理
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信号处理与深度学习硬件加速的一致性计算结构 被引量:3
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作者 高彦钊 陶常勇 《国防科技大学学报》 EI CAS CSCD 北大核心 2023年第2期112-120,共9页
在计算需求层面对多种典型信号处理算法与深度学习算法进行了分析与模块化分解,提取了两类应用共有的且适合并行硬件加速的计算模块,提出了信号处理与深度学习的一致性计算模型,并基于一致性计算模型设计了控制与计算分离的层次化处理... 在计算需求层面对多种典型信号处理算法与深度学习算法进行了分析与模块化分解,提取了两类应用共有的且适合并行硬件加速的计算模块,提出了信号处理与深度学习的一致性计算模型,并基于一致性计算模型设计了控制与计算分离的层次化处理单元与阵列化计算结构。通过对不同应用计算过程的软件定义能够实现信号处理与深度学习的一致性硬件加速计算,基于Zynq计算平台从重构效率与计算性能两个方面对一致性计算模型与计算结构进行了验证,结果表明:基于一致性计算模型的软件定义可重构计算结构,具有较高的计算性能与重构效率。 展开更多
关键词 深度学习 信号处理 硬件加速 计算结构
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面向拟态防御系统的高阶异构度大数判决算法 被引量:5
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作者 魏帅 张辉华 +2 位作者 苏野 薛鹏飞 闻亮 《计算机工程》 CAS CSCD 北大核心 2021年第5期30-35,共6页
异构系统之间的相似性会影响拟态防御系统异构执行体的选择和调度。目前多数针对执行体的异构性分析仍停留在二阶层面,但二阶异构度不适用于执行体数目较多的情况,难以准确评估拟态系统的防御能力。针对该问题,提出高阶异构度的概念,分... 异构系统之间的相似性会影响拟态防御系统异构执行体的选择和调度。目前多数针对执行体的异构性分析仍停留在二阶层面,但二阶异构度不适用于执行体数目较多的情况,难以准确评估拟态系统的防御能力。针对该问题,提出高阶异构度的概念,分析高阶异构的性质,解释高阶异构性在执行体调度及判决中所起的重要作用,并将其用于拟态防御系统安全性的量化分析。在此基础上,设计基于高阶异构度的大数判决算法,同时依据容斥原理计算系统失效率。实验结果表明,该算法可有效分析拟态系统的防御能力,并且随着执行体相似度增大以及执行体数目增多,准确性能够进一步提高。 展开更多
关键词 高阶异构度 拟态防御 大数判决 执行体调度 冗余执行体
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面向拟态判决的可编程语义解析方法 被引量:1
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作者 张文建 宋克 +2 位作者 谭力波 魏帅 董春雷 《通信学报》 EI CSCD 北大核心 2020年第4期62-69,共8页
针对拟态判决领域的应用,提出了一种面向拟态判决的可编程语义解析方法。该方法基于匹配查表思想,通过域指针配置方式进行定制协议解析,解决了针对不同协议的可编程解析问题;采用流水控制的方式保证了协议解析过程无拥塞,提高了协议解... 针对拟态判决领域的应用,提出了一种面向拟态判决的可编程语义解析方法。该方法基于匹配查表思想,通过域指针配置方式进行定制协议解析,解决了针对不同协议的可编程解析问题;采用流水控制的方式保证了协议解析过程无拥塞,提高了协议解析的性能;通过引入哈希运算,降低了子分组基于语义的重排序设计复杂度。性能分析结果表明,所提方法在协议解析方面具有高灵活性、高处理能力及低资源利用率等特点。 展开更多
关键词 拟态判决 可编程 匹配查表 语义解析
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基于拟态防御的以太网交换机内生安全体系结构 被引量:34
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作者 宋克 刘勤让 +2 位作者 魏帅 张文建 谭力波 《通信学报》 EI CSCD 北大核心 2020年第5期18-26,共9页
针对以太网交换机面临的未知漏洞和未知后门安全威胁,提出了一种基于拟态防御理论的交换机内生安全体系结构。介绍了所提体系结构的理论基础、构建方式、安全机理;提出并分析了TAMA的算法策略及安全提升效果;设计实现了拟态交换机原型... 针对以太网交换机面临的未知漏洞和未知后门安全威胁,提出了一种基于拟态防御理论的交换机内生安全体系结构。介绍了所提体系结构的理论基础、构建方式、安全机理;提出并分析了TAMA的算法策略及安全提升效果;设计实现了拟态交换机原型样机并进行了白盒插桩及攻击链安全性测试。理论分析及测试结果表明,在各种攻击场景下,所提体系结构具有良好的未知漏洞和未知后门防御能力。 展开更多
关键词 以太网交换机 拟态防御 动态异构冗余 内生安全
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一种应用于软件定义互连系统的多协议SerDes电路 被引量:8
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作者 李沛杰 沈剑良 +3 位作者 苑红晓 王永胜 夏云飞 张传波 《电子学报》 EI CAS CSCD 北大核心 2021年第4期817-823,共7页
为满足片上系统的柔性互连,提出一种应用于软件定义互连系统的1.0625~10.3125Gbps多协议SerDes电路结构.该电路采用统一架构实现不同协议的规范需求,通过一种1×QPLL+4×Lane PLL的时钟结构实现宽频点和低抖动的时钟输出,通过... 为满足片上系统的柔性互连,提出一种应用于软件定义互连系统的1.0625~10.3125Gbps多协议SerDes电路结构.该电路采用统一架构实现不同协议的规范需求,通过一种1×QPLL+4×Lane PLL的时钟结构实现宽频点和低抖动的时钟输出,通过可编程的发送端前向反馈均衡器和接收端线性均衡器和判决反馈均衡器电路,实现最大32dB的插损补偿.测试结果表明,所设计的SerDes电路在10.3125Gbps速率下发送总抖动为21.2ps,随机抖动均方根值为633.7fs,最大功耗29.33mW/Gbps,发送端眼图和接收端抖动容限及误码率均能够满足FC-PI-4,RapidIO 3.0,10GBase-KR,1000Base-X的协议规范要求. 展开更多
关键词 软件定义互连 SERDES 时钟数据恢复 锁相环 高速串行收发器 数模混合电路
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基于异常值的拟态裁决优化方法 被引量:9
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作者 高振斌 贾广瑞 +1 位作者 张文建 谭力波 《计算机应用研究》 CSCD 北大核心 2021年第7期2066-2071,共6页
针对拟态裁决器多数一致性表决算法的优化方法,提出用异常检测的方法直接量化数据可靠性来提升表决正确率。基于异常值的表决算法,通过构建拟态系统异构执行体输出数据集和训练深度学习异常检测模型量化了执行体输出数据异常值;使用权... 针对拟态裁决器多数一致性表决算法的优化方法,提出用异常检测的方法直接量化数据可靠性来提升表决正确率。基于异常值的表决算法,通过构建拟态系统异构执行体输出数据集和训练深度学习异常检测模型量化了执行体输出数据异常值;使用权值优化算法优化加权分配,在表决时选择最优加权结果作为表决输出结果。实验结果表明,该方法能够提升拟态裁决器的表决输出正确率,具有一定共模逃逸检测能力,提升了系统的安全性和可靠性。 展开更多
关键词 拟态防御 裁决器 表决算法 深度学习 异常检测
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