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基于DSP的二维CFAR检测快速实现 被引量:7
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作者 任磊 陈辉 +1 位作者 陈建文 王永良 《系统工程与电子技术》 EI CSCD 北大核心 2009年第7期1627-1631,共5页
雷达信号的恒虚警率(constant false alarm rate,CFAR)检测技术是雷达目标检测的有效方法,二维CFAR检测利用了频域信息,增加了参考单元,能有效地降低虚警。为了降低传统方法因频繁数据寻址引入的时间开销,提出以空间换时间的策略,通过... 雷达信号的恒虚警率(constant false alarm rate,CFAR)检测技术是雷达目标检测的有效方法,二维CFAR检测利用了频域信息,增加了参考单元,能有效地降低虚警。为了降低传统方法因频繁数据寻址引入的时间开销,提出以空间换时间的策略,通过合理调度数字信号处理器(digital signal processing,DSP)资源,配合优化措施,有效地把传统CFAR检测的逐点实现方法改进为数据块矩阵操作,减少了数据管理复杂度。实测数据实现结果表明处理效率提高8倍以上,验证了方法的有效性。 展开更多
关键词 二维恒虚警概率 数字信号处理TS201 数据寻址
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机载雷达多通道STAP系统设计实现 被引量:3
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作者 任磊 王永良 +1 位作者 陈建文 陈辉 《信号处理》 CSCD 北大核心 2009年第6期967-972,共6页
空时二维自适应处理(STAP)是机载雷达有效抑制杂波和干扰的关键技术,现阶段该技术研究的热点难点之一是大数据流下的高精度实时系统实现问题。本文采用均衡任务处理的方法设计了STAP并行系统,在分析了STAP系统任务特点后,给出了系统任... 空时二维自适应处理(STAP)是机载雷达有效抑制杂波和干扰的关键技术,现阶段该技术研究的热点难点之一是大数据流下的高精度实时系统实现问题。本文采用均衡任务处理的方法设计了STAP并行系统,在分析了STAP系统任务特点后,给出了系统任务和任务级的测试基准,基于多DSP异构处理板提出了四通道STAP系统的设计方案并予以实现,系统级测试结果分析表明系统具有较好的均衡性,最后提出几点STAP系统设计实现中的关键问题。 展开更多
关键词 STAP 基准测试 异构
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海量STAP数据的脉冲压缩快速实现
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作者 任磊 王永良 +1 位作者 母其勇 陈辉 《数据采集与处理》 CSCD 北大核心 2008年第3期342-346,共5页
在空时二维自适应处理系统中对海量数据作脉压处理耗时颇大。本文基于单片数字信号处理器(DSP)从数据级和指令级两个方面进行优化,通过合理调度处理器资源并利用片内并行技术,快速实现了对海量数据的脉冲压缩优化处理。以空时二维自适... 在空时二维自适应处理系统中对海量数据作脉压处理耗时颇大。本文基于单片数字信号处理器(DSP)从数据级和指令级两个方面进行优化,通过合理调度处理器资源并利用片内并行技术,快速实现了对海量数据的脉冲压缩优化处理。以空时二维自适应处理(STAP)系统中单景四重频数据为分析对象,比较了采用商业库优化方法和本文方法优化后的两种情况。实验结果证明,在处理时间上取得了1.801的加速比,误差控制在10-5量级,1 024点脉压处理时间为50.456μs,验证了本文方法的有效性。 展开更多
关键词 脉冲压缩 海量数据 单指令多数据流(SIMD) 超长指令字(VLIW) TS201
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双通道机载雷达STAP紧凑系统设计
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作者 任磊 王永良 +1 位作者 陈辉 母其勇 《数据采集与处理》 CSCD 北大核心 2008年第6期657-662,共6页
大数据流下的高精度实时处理是空时自适应处理(Space-time adaptive processing,STAP)系统实现的难题之一。在机载平台对尺寸、重量和功率(size,weight and power,SWAP)的约束条件下,STAP系统设计的目标是减少系统时延的同时增加数据吞... 大数据流下的高精度实时处理是空时自适应处理(Space-time adaptive processing,STAP)系统实现的难题之一。在机载平台对尺寸、重量和功率(size,weight and power,SWAP)的约束条件下,STAP系统设计的目标是减少系统时延的同时增加数据吞吐率,本文对实测双通道机载雷达采样数据进行了STAP并行系统的紧凑设计研究。基于选型平台设计了狭义局部并行全局串行(Restricted local-parallel-and-global-serial,RLPGS)结构与狭义局部串行全局并行(Restricted local-seiral-and-global-parallel,RLSGP)结构,并验证了任务数据不同调度方法的性能。该设计在单处理板上成功完成STAP处理的测试,结果满足设计要求。 展开更多
关键词 时空自适应处理 紧凑并行系统 双通道
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