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题名一种基于FPGA的高斯随机数生成器的设计与实现
被引量：15
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作者
谷晓忱
张民选
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机构
国防科学技术大学计算机学院PDL重点实验室
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出处
《计算机学报》
EI
CSCD
北大核心
2011年第1期165-173,共9页
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基金
国家"八六三"高技术研究发展计划项目基金(2009AA01Z124
2009AA01Z104
2009AA01Z102)资助
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文摘
基于FPGA的高斯随机数生成器需要满足可重构、高吞吐率和高硬件资源使用效率等要求.文中提出了一种易于硬件实现的状态转换逻辑结构,并给出了均匀分布随机数周期和输出位宽的配置方法和配置原则.文中详细分析了应用"最值分析法"和"静态误差分析法"求解Box Muller算法实现过程中各操作数位宽的具体过程.硬件实现结果在Xilinx Vertex 5上的工作速度为491 MHz,吞吐率为9.82×108samples/second,硬件资源使用效率为2.085×106samples/second/slice.文中作者使用DIEHARD测试集、χ2和K-S方法对产生的随机数质量进行了检测,文中给出了结果.
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关键词
现场可编程门阵列
硬件加速器
高斯随机数产生
均匀分布随机数产生
可重构计算
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Keywords
FPGA
hardware accelerator
Gaussian random number generation
uniform random number generation
reconfigurable computing
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分类号
TP302
[自动化与计算机技术—计算机系统结构]
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题名共享多端口数据Cache结构:SMPDCA
被引量：1
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作者
黄光奇
李子木
周兴铭
窦勇
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机构
国防科学技术大学计算机学院重点实验室
清华大学中国教育和科研计算机网络中心
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出处
《计算机学报》
EI
CSCD
北大核心
2001年第12期1318-1323,共6页
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基金
国家自然科学基金 ( 6 99330 30 )资助
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文摘
随着半导体工艺技术的飞速发展 ,单芯片多处理器 (Single- Chip Multiprocessor,SCMP)结构将是一条提高处理器性能的有效途径 .该文在分析 SCMP结构的特点的基础上 ,提出了 SCMP的一种结构实现 :共享多端口数据 Cache结构 (Shared Multi- Ported Data Cache Architecture,SMPDCA) .SMPDCA结构具有三个突出的优点 :最小的通信延迟、没有 Cache一致性维护开销和数据 Cache命中率提高 .模拟结果表明 ,与数据 Cache私有的结构相比 ,SMPDCA结构的突出优点使得应用程序的性能得到了明显的提高 ,特别是对于改善处理器之间的通信与交互比较多的应用程序的性能具有最为明显的效果 .
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关键词
共享多端口数据Cache
执行时间
SMPDCA
单芯片多处理器
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Keywords
Cache memory
Computer simulation
Data communication equipment
Parallel processing systems
Performance
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分类号
TP332
[自动化与计算机技术—计算机系统结构]
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