基于I^2C总线实验设计 被引量：12

1

作者 宣慧 孙佳昊 +2 位作者 程实 蔡艳婧 胡传志 《实验技术与管理》 CAS 北大核心 2020年第1期52-55,共4页

鉴于I^2C总线在嵌入式系统中的重要性,设计I^2C总线实验已成为嵌入式系统实验教学中一个极重要的教学环节。在详细分析I^2C总线工作原理的基础上,以TM4C123GH6PM微控制器和LM75A温度传感器为例,研究I^2C总线的实验设计方法,包括硬件电... 鉴于I^2C总线在嵌入式系统中的重要性,设计I^2C总线实验已成为嵌入式系统实验教学中一个极重要的教学环节。在详细分析I^2C总线工作原理的基础上,以TM4C123GH6PM微控制器和LM75A温度传感器为例,研究I^2C总线的实验设计方法,包括硬件电路设计和软件程序设计。该实验设计在实验教学中取得了良好的效果,提高了嵌入式系统实验教学的水平。 展开更多

关键词 I^2C总线 实验设计 嵌入式系统 微控制器

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采用卷积神经网络的室内可见光定位方法 被引量：1

2

作者 王亮 孙海燕 《导航定位学报》 北大核心 2025年第1期128-136,共9页

针对多径反射与系统噪声导致室内可见光定位精度下降的问题,提出一种基于扩张卷积网络的室内可见光三维定位方法:基于皮尔森相关性系数对采集的接收信号强度向量进行过滤,删除系统噪声引起的非线性失真接收信号强度向量,以提高训练的神... 针对多径反射与系统噪声导致室内可见光定位精度下降的问题,提出一种基于扩张卷积网络的室内可见光三维定位方法:基于皮尔森相关性系数对采集的接收信号强度向量进行过滤,删除系统噪声引起的非线性失真接收信号强度向量,以提高训练的神经网络精度;然后,将接收信号强度向量集建立的指纹库传入神经网络进行训练,利用神经网络较强的三维空间结构表达能力拟合多径反射和系统噪声下的非线性指纹库。仿真结果表明,在7 m×7 m×3 m的室内环境下,所提方法的平均定位误差可达0.91 cm,其中90%样本的定位误差小于1.17 cm;此外,所提方法的平均定位误差较全连接神经网络和卷积神经网络可分别降低0.82 cm和0.56 cm,证明所提方法在多径反射与系统噪声环境下具有较好的定位性能。 展开更多

关键词 可见光通信系统 室内定位 物联网 卷积神经网络(CNN) 可见光定位

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一种新的8B/10B编解码设计 被引量：3

3

作者 刘文杰 施佺 +1 位作者 郭林 孙玲 《光通信技术》 CSCD 北大核心 2012年第12期52-54,共3页

在分析8B/10B编解码规则和输入信号与对应数据间逻辑关系的基础上,提出了一种新的编解码和游程值计算方法,完成了编解码电路的可综合Verilog HDL语言设计,并在Quartus Ⅱ和ModelSim软件环境下实现了电路综合及仿真。仿真结果表明,该方... 在分析8B/10B编解码规则和输入信号与对应数据间逻辑关系的基础上,提出了一种新的编解码和游程值计算方法,完成了编解码电路的可综合Verilog HDL语言设计,并在Quartus Ⅱ和ModelSim软件环境下实现了电路综合及仿真。仿真结果表明,该方法与现有8B/10B编解码方案相比,最大工作频率显著提高,资源占用相对较少且可靠性得到增强。 展开更多

关键词 8B 10B Veri LOG HDL FPGA

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一种多芯片封装(MCP)的热仿真设计 被引量：5

4

作者 王金兰 仝良玉 +1 位作者 刘培生 缪小勇 《计算机工程与科学》 CSCD 北大核心 2012年第4期28-31,共4页

集成电路封装热设计的目的在于尽可能地提高封装的散热能力,确保芯片的正常运行。多芯片封装(MCP)可以提高封装的芯片密度,提高处理能力。与传统的单芯片封装相比,由于包含多个热源,多芯片封装的热管理变得更为关键。本文针对一种2维FBG... 集成电路封装热设计的目的在于尽可能地提高封装的散热能力,确保芯片的正常运行。多芯片封装(MCP)可以提高封装的芯片密度,提高处理能力。与传统的单芯片封装相比,由于包含多个热源,多芯片封装的热管理变得更为关键。本文针对一种2维FBGAMCP产品,进行有限元建模仿真,并获得封装的热性能。通过热阻比较的方式,分析了不同的芯片厚度对封装热性能的影响。针对双芯片封装,通过对不同的芯片布局进行建模仿真,获得不同的芯片布局对封装热阻的影响。最后通过封装热阻的比较,对芯片的排列布局进行了优化。分析结果认为芯片厚度对封装热阻的影响并不明显,双芯片在基板中心呈对称排列时封装的热阻最小。 展开更多

关键词 多芯片封装 FBGA 热管理 有限元仿真

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基于可信对等的分布式入侵检测通信框架设计 被引量：4

5

作者 金丽 朱浩 《计算机工程与设计》 CSCD 北大核心 2010年第5期969-972,共4页

为了提高分布式入侵检测的实时性和安全性,提出了一种可信对等的分布式入侵检测通信框架的模型。该模型借鉴了P2P和代理技术,不同网络节点中的入侵检测代理是对等的,它们之间通过共享检测信息进行整体协防。该模型还借鉴了安全通信技术... 为了提高分布式入侵检测的实时性和安全性,提出了一种可信对等的分布式入侵检测通信框架的模型。该模型借鉴了P2P和代理技术,不同网络节点中的入侵检测代理是对等的,它们之间通过共享检测信息进行整体协防。该模型还借鉴了安全通信技术,在网络中建立了一个认证服务器,不在同一网络节点的任何两个网络进程的通信必须通过该认证服务器,提高了入侵检测自身的安全性。设计实现了一个原型系统,原型系统的实验结果表明了该模型的正确性和可行性。 展开更多

关键词 分布式 入侵检测 代理 对等 多播

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基于MSP430的双界面读卡器设计 被引量：2

6

作者 杨玲玲 谢星 +1 位作者 孙玲 吴烨 《现代电子技术》 2014年第16期18-20,23,共4页

市场对双界面智能卡的需求不断增多,这也加速了双界面读卡器产业的发展。在此主要介绍一种基于MSP430的双界面读卡器的设计,给出硬件系统的电路设计方法以及软件架构。该系统以MSP430F5418为主控芯片,同时主要对接触式读卡电路和非接触... 市场对双界面智能卡的需求不断增多,这也加速了双界面读卡器产业的发展。在此主要介绍一种基于MSP430的双界面读卡器的设计,给出硬件系统的电路设计方法以及软件架构。该系统以MSP430F5418为主控芯片,同时主要对接触式读卡电路和非接触式读卡电路进行了设计和实现。接触式模块符合ISO7816标准要求,非接触读卡电路模块内嵌CL RC632,采用13.56 MHz非接触射频技术进行读/写。测试结果表明,该读卡器系统性能稳定、实用性强,具有很好的市场推广价值。 展开更多

关键词 双界面智能卡 MSP430F5418 读卡器 CL RC632

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基于高性能数字芯片的多协议可编程接口设计

7

作者 陈磊 陈子晏 +2 位作者 杨华 赖宗声 景为平 《半导体技术》 CAS CSCD 北大核心 2008年第8期730-733,共4页

设计并制作了一种基于SMIC18混合信号工艺,可用于高性能数字芯片中的多协议、可编程输入接口电路。Cadence SPECTRE仿真及测试结果表明,电路可以在多种不同的JEDEC标准协议下工作并自由切换,并加入可控延迟,根据不同协议,电路可以编程... 设计并制作了一种基于SMIC18混合信号工艺,可用于高性能数字芯片中的多协议、可编程输入接口电路。Cadence SPECTRE仿真及测试结果表明,电路可以在多种不同的JEDEC标准协议下工作并自由切换,并加入可控延迟,根据不同协议,电路可以编程选择不同的输入缓冲路径,在同一模块上集成10种JEDEC协议标准。电路同时可以在高至200MHz的HSTL协议下工作,也可以满足LVTTL等协议的5V耐压需求。 展开更多

关键词 输入输出接口模块 可编程控制 JEDEC标准 可编程延迟

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CPU卡虚拟原型验证平台设计

8

作者 葛滨 景为平 +1 位作者 鲁华祥 方睿 《计算机应用与软件》 CSCD 北大核心 2014年第5期319-322,333,共5页

针对CPU卡设计规模小以及设计时间和成本有限等特点,选择合适的片上总线互联结构,设计一套虚拟原型验证平台。介绍虚拟原型验证平台的原理,着重分析采用AHB-lite片上总线结构能够极大地减小CPU卡设计的复杂度。运用搭建的CPU卡虚拟原型... 针对CPU卡设计规模小以及设计时间和成本有限等特点,选择合适的片上总线互联结构,设计一套虚拟原型验证平台。介绍虚拟原型验证平台的原理,着重分析采用AHB-lite片上总线结构能够极大地减小CPU卡设计的复杂度。运用搭建的CPU卡虚拟原型验证平台,对CPU卡的架构和自主设计的IP模块进行测试,并在实际的物理原型验证平台上对整个架构进行测试。测试结果表明设计的虚拟原型验证平台可以切实地减少设计的时间和成本。 展开更多

关键词 片上总线 CPU卡 虚拟原型平台 系统架构 功能验证

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一种低硬件开销的高级加密标准设计

9

作者 陈海进 景为平 《计算机工程》 EI CAS CSCD 北大核心 2005年第20期165-167,共3页

在智能卡、PDA等便携式设备中,希望使用面积小的密码芯片。通过对AES算法进行结构优化,有效地减小了硬件实现时的开销。使用Verilog HDL语言设计并在Altera APEX20K器件中验证通过,设计集成了加密/解密模式及所有3种密钥长度,为进一步的... 在智能卡、PDA等便携式设备中,希望使用面积小的密码芯片。通过对AES算法进行结构优化,有效地减小了硬件实现时的开销。使用Verilog HDL语言设计并在Altera APEX20K器件中验证通过,设计集成了加密/解密模式及所有3种密钥长度,为进一步的VLSI实现提供了FPGA原形验证。 展开更多

关键词 高级加密标准 CMOS 逻辑综合 FPGA

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基于ISO15693协议的RFID智能货架管理系统设计 被引量：16

10

作者 张成吉 景为平 《仪表技术与传感器》 CSCD 北大核心 2019年第1期50-54,共5页

针对制造业中待加工物品管理效率低下的问题,设计了一套基于射频识别(RFID)的智能货架管理系统。通过RFID阅读器和手持式智能终端实时进行数据采集,采用复杂事件处理(CEP)进行数据清洗、过滤并传入制造企业生产过程执行系统(MES)。基于I... 针对制造业中待加工物品管理效率低下的问题,设计了一套基于射频识别(RFID)的智能货架管理系统。通过RFID阅读器和手持式智能终端实时进行数据采集,采用复杂事件处理(CEP)进行数据清洗、过滤并传入制造企业生产过程执行系统(MES)。基于ISO15693协议对RFID阅读器实现发送功率可调、网口通信功能设计,借助. NET平台开发RFID中间件程序及网络应用程序,方便用户实时查询物品信息。系统已在制造企业中应用,效果卓著,性能良好。经实际测试,系统能够快速、稳定、高效地工作,实现了对待加工物品的实时监测和生产计划的高效执行。 展开更多

关键词 射频识别(RFID) ISO15693 复杂事件处理(CEP) .NET

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基于FPGA的RFID晶圆并行测试系统设计 被引量：5

11

作者 张慧雷 景为平 《半导体技术》 CAS CSCD 北大核心 2015年第11期866-871,共6页

针对高频射频识别(RFID)晶圆在中测(CP)阶段单通道串行测试效率低下的问题,设计了一种基于现场可编程门阵列(FPGA)的多通道并行测试系统以提高测试效率。鉴于RFID晶圆上没有集成天线,提出了一种新的基于探针技术的射频耦合式的晶圆检测... 针对高频射频识别(RFID)晶圆在中测(CP)阶段单通道串行测试效率低下的问题,设计了一种基于现场可编程门阵列(FPGA)的多通道并行测试系统以提高测试效率。鉴于RFID晶圆上没有集成天线,提出了一种新的基于探针技术的射频耦合式的晶圆检测方法,模拟芯片实际工作。系统选用FPGA为微控制器,配以多路射频耦合通信电路,实现测试向量生成及快速信号处理。再结合上位机与探针台高速并行的通用接口总线(GPIB)通信接口,以实现晶圆级RFID芯片测试。经实际测试,该系统能够实现16通道并行测试,与单通道串行测试系统相比,效率提升了97%,可靠性好,稳定性高,可应用高密度RFID晶圆的中测。 展开更多

关键词 并行测试 高频射频识别(RFID) 晶圆测试(CP) 射频耦合 现场可编程门阵列(FPGA)

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2.45GHz射频识别系统设计 被引量：5

12

作者 丁晗 景为平 《计算机工程与设计》 北大核心 2019年第7期1852-1858,共7页

提出一种基于国标空中接口协议GB/T28925的2.45 GHz射频识别(RFID)读写系统设计,介绍阅读器和有源标签的硬件和软件系统设计。阅读器是基于ARM Cortex-M3内核处理器设计的远距离阅读器,阅读器通过串口或以太网与上位机通信,标签采用超... 提出一种基于国标空中接口协议GB/T28925的2.45 GHz射频识别(RFID)读写系统设计,介绍阅读器和有源标签的硬件和软件系统设计。阅读器是基于ARM Cortex-M3内核处理器设计的远距离阅读器,阅读器通过串口或以太网与上位机通信,标签采用超低功耗芯片实现,解决标签耗电大的问题,借助C#完成控制终端的开发平台设计。采用成帧二进制树算法提高标签防碰撞性能,提高系统对标签的识别率,测试结果表明,阅读器能够快速、稳定、高效地识别标签。 展开更多

关键词 射频识别 2.45G阅读器 有源标签 防碰撞 国标空中接口协议GB/T28925

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基于ISO 15693射频标签的RFID手术器械管理系统设计 被引量：5

13

作者 陆志峰 景为平 《实验室研究与探索》 CAS 北大核心 2017年第9期275-279,共5页

针对手术异物遗留(RSIS)的难题,提出了基于ISO15693射频标签的射频识别(RFID)手术器械管理系统。将ISO15693射频标签内置在手术器械中,采用三通道天线协调工作的RFID阅读器完成对手术器械的登记录入、回收统计和寻找扫描。借助Qt图形界... 针对手术异物遗留(RSIS)的难题,提出了基于ISO15693射频标签的射频识别(RFID)手术器械管理系统。将ISO15693射频标签内置在手术器械中,采用三通道天线协调工作的RFID阅读器完成对手术器械的登记录入、回收统计和寻找扫描。借助Qt图形界面应用程序开发框架,实现对手术器械管理系统的上位机操作界面的设计。实验表明系统能够稳定、快速、准确地实现对手术器械使用和回收的智能化管理,有效地防止了手术器械遗留问题的发生,给手术安全提供了更加高效可靠的保障。系统现已具备实际应用能力,正在进行面向医疗实用的推广。 展开更多

关键词 手术异物遗留 15693国际标准 射频识别 手术器械

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符合ISO/IEC 15693协议的专用RFID并行晶圆测试系统设计 被引量：2

14

作者 范巍 景为平 《实验室研究与探索》 CAS 北大核心 2017年第11期130-134,154,共6页

针对遵循ISO/IEC 15693协议的RFID(radio frequency identification)晶圆测试效率低下的问题,提出了一种16通道并行测试系统的方法,选用FPGA(field programmable gate array)作为逻辑处理器,使用并行处理的方法高效地实现逻辑功能;设计... 针对遵循ISO/IEC 15693协议的RFID(radio frequency identification)晶圆测试效率低下的问题,提出了一种16通道并行测试系统的方法,选用FPGA(field programmable gate array)作为逻辑处理器,使用并行处理的方法高效地实现逻辑功能;设计专用硬件测试电路,成本低、针对性强;采用16通道并行测试方法,大幅度提高测试效率;采用射频耦合式测试方法,完全模拟芯片的实际工作状态,保证测试结果与实际应用结果一致。实际测试中,测试晶圆为8 in(203 mm)。如果采用单通道串行测试系统,整片测试时间为36 h;采用16通道并行测试系统,测试时间为2.26 h。结果表明采用16通道并行测试的方法可以节约93.8%的时间,大大提高了测试效率,缩短了测试时间。 展开更多

关键词 射频识别 现场可编程序门阵列 测试效率 晶圆

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一种低频RFID晶圆并行测试系统设计

15

作者 都平 景为平 《半导体技术》 CAS CSCD 北大核心 2016年第11期864-868,共5页

针对低频射频识别(RFID)晶圆测试中耗时久、效率低的问题,设计了一种32通道并行测试系统。系统基于32通道垂直探针卡,采用直接耦合方式,达到芯片实际工作条件。利用现场可编程门阵列(FPGA),实现测试向量的快速生成和信号解码的高速处理... 针对低频射频识别(RFID)晶圆测试中耗时久、效率低的问题,设计了一种32通道并行测试系统。系统基于32通道垂直探针卡,采用直接耦合方式,达到芯片实际工作条件。利用现场可编程门阵列(FPGA),实现测试向量的快速生成和信号解码的高速处理。通过专用硬件测试电路,对已调信号进行包络检波、滤波放大、电平判决,解调出被测芯片(DUT)编码信息。凭借通用接口总线(GPIB)完成探针台与上位机的数据交换,获得晶圆图。经测试,系统能够稳定、快速实现对低频RFID晶圆进行32通道并行测试,与传统单通道串行测试相比,测试时间至少优化了95.4%。测试结果表明系统缩短了测试时间、提高了测试效率,可适用于批量测试应用。 展开更多

关键词 晶圆测试 射频识别(RFID) 现场可编程门阵列(FPGA) 通用接口总线(GPIB) 并行测试

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动态环境下自主机器人的双机制切向避障 被引量：3

16

作者 章一鸣 姚文广 陈海进 《浙江大学学报（工学版）》 EI CAS CSCD 北大核心 2024年第4期779-789,846,共12页

针对机器人工作环境的动态随机性,提出面向双机制切向避障的改进人工势场法.针对传统人工势场法的局部极小值陷阱问题,提出静态避障机制,在规划开始前对地图进行预处理,预测局部极小值点并将障碍物分成连通与非连通障碍物,结合切向避障... 针对机器人工作环境的动态随机性,提出面向双机制切向避障的改进人工势场法.针对传统人工势场法的局部极小值陷阱问题,提出静态避障机制,在规划开始前对地图进行预处理,预测局部极小值点并将障碍物分成连通与非连通障碍物,结合切向避障实现静态切向避障.以静态避障机制为基础,针对动态障碍物,提出动态避障机制,通过实时调整碰撞风险系数并选择系数最大的障碍物进行避障角补偿,实现动态切向避障.通过状态决策统筹静态、动态切向避障机制与全局路径规划,实现混合规划与设计.设计仿真和全向移动平台,对所提方法进行验证测试.结果表明,所提方法在不同环境复杂下均有效解决了传统人工势场法的局部极小值陷阱问题,实现了动态环境下快速自主避障.对比3种方法避开不同类型障碍物的平均耗时,所提方法比动态窗口法(DWA)提升55%,比时间弹性带法(TEB)提升40%;对比3种方法导航不同复杂度地图的平均耗时,所提方法比DWA提升39%,比TEB提升22%. 展开更多

关键词 动态环境 人工势场法 局部极小值陷阱 双机制切向避障 状态决策 混合规划

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基于遗传蚁群算法的片上网络映射研究 被引量：8

17

作者 刘炎华 刘静 +1 位作者 赖宗声 景为平 《计算机工程》 CAS CSCD 北大核心 2010年第22期262-264,共3页

基于2DMesh结构的片上网络在设计之初就要考虑模块映射问题,以满足通信功耗的约束。提出一种基于遗传蚁群映射算法的方法解决片上网络设计中通信功耗最小化问题。该算法针对标准蚁群算法易于出现早熟停滞等缺陷,引入轮盘赌选择机制及染... 基于2DMesh结构的片上网络在设计之初就要考虑模块映射问题,以满足通信功耗的约束。提出一种基于遗传蚁群映射算法的方法解决片上网络设计中通信功耗最小化问题。该算法针对标准蚁群算法易于出现早熟停滞等缺陷,引入轮盘赌选择机制及染色体杂交等手段,使映射功耗函数快速收敛,达到良好的全局寻优效果。 展开更多

关键词 片上网络 遗传蚁群映射算法 轮盘赌选择 染色体杂交

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可逆逻辑门网络的表示与级联 被引量：10

18

作者 管致锦 秦小麟 +1 位作者 陶涛 施 《电子学报》 EI CAS CSCD 北大核心 2010年第10期2370-2376,共7页

可逆计算是一个新兴的研究领域,可逆逻辑门网络的级联是可逆计算的重要内容.本文提出了一种可逆逻辑网络表示方法,给出了相应的可逆网络模型.为了构造可逆逻辑网络,给出了一种可逆逻辑门单元库的构造方法.证明了同一垂直线上两个不相交... 可逆计算是一个新兴的研究领域,可逆逻辑门网络的级联是可逆计算的重要内容.本文提出了一种可逆逻辑网络表示方法,给出了相应的可逆网络模型.为了构造可逆逻辑网络,给出了一种可逆逻辑门单元库的构造方法.证明了同一垂直线上两个不相交可逆逻辑门单元的输出值与此二逻辑门单元分布到相同平行线的两条相邻垂直线上的输出值之间的关系;给出了分布在相同平行线上奇数和偶数个相邻的相同可逆逻辑门单元输出结果的性质.提出了一种可逆网络输出向量的表示方法和基于可逆门编码的可逆网络级联方法,以此生成给定范围内的可逆网络.通过变进制数的方法快速找到可逆网络输出向量所对应的序号,降低了搜索次数,减小了搜索空间,为进一步综合大规模可逆网络,提高可逆网络级联效率提供了支持.Benchmark例题验证表明,该方法构造的可逆网络控制门数更少,代价更小. 展开更多

关键词 可逆计算 可逆逻辑综合 可逆逻辑门 可逆网络 可逆门级联

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新型热释电材料及其在红外探测器中的应用 被引量：6

19

作者 刘林华 罗豪甦 +5 位作者 吴啸 赵祥永 方家熊 李言瑾 邵秀梅 景为平 《红外与激光工程》 EI CSCD 北大核心 2011年第5期777-785,共9页

以(1-x)Pb(Mg1/3Nb2/3)O3-xPbTiO3{PMNT[(1-x)/x]}为代表的大尺寸、高质量弛豫铁电单晶具有非常高的热释电系数、探测优值和较低的热扩散系数,其综合热释电性能远优于传统的热释电材料。概述了PMNT[(1-x)/x]单晶、掺锰PMNT(74/26)单晶和... 以(1-x)Pb(Mg1/3Nb2/3)O3-xPbTiO3{PMNT[(1-x)/x]}为代表的大尺寸、高质量弛豫铁电单晶具有非常高的热释电系数、探测优值和较低的热扩散系数,其综合热释电性能远优于传统的热释电材料。概述了PMNT[(1-x)/x]单晶、掺锰PMNT(74/26)单晶和0.42Pb(In1/2Nb1/2)O3-0.3Pb(Mg1/3Nb2/3)O3-0.28PbTiO3[PIMNT(42/30/28)]单晶的介电性能、铁电性能和热释电性能。掺杂后PMNT(74/26)单晶的介电损耗降低到0.000 5,探测优值提高到40.2×10-5 Pa-1/2,是目前所有三方四方相变温度(TRT)高于90°C的本征热释电材料中最高的。高居里温度PIMNT(42/30/28)单晶的TRT达到152°C,且具有较高的探测优值(10.2×10-5 Pa-1/2),将在更宽温度范围内得到广泛的应用。制作了基于掺锰PMNT(74/26)单晶的单元探头,其比探测率D*达到1.07×109 cmHz1/2W-1,是目前商用LiTaO3探测器的两倍,器件性能满足实用要求。 展开更多

关键词 弛豫铁电单晶 热释电 红外探测器 Pb(Mg1/3Nb2/3)O3-PbTiO3

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电子收费系统车载单元LLC子层研究 被引量：3

20

作者 张威 李跃辉 景为平 《计算机工程》 CAS CSCD 北大核心 2011年第8期246-248,共3页

采用通用微控制器实现电子收费(ETC)专用短程通信的逻辑链路控制(LLC)子层时存在功耗大、速度慢等缺点。针对该问题,通过研究ETC系统中车载单元LLC子层协议的工作原理,提出以专用逻辑电路实现LLC子层的功能,给出2种类型服务在该层的状... 采用通用微控制器实现电子收费(ETC)专用短程通信的逻辑链路控制(LLC)子层时存在功耗大、速度慢等缺点。针对该问题,通过研究ETC系统中车载单元LLC子层协议的工作原理,提出以专用逻辑电路实现LLC子层的功能,给出2种类型服务在该层的状态转换方式。利用Verilog HDL在FPGA上实现该层的功能,结果证明了该方法的有效性。 展开更多

关键词 电子收费 专用短程通信 逻辑链路控制 状态分析 FPGA实现 VERILOG HDL语言

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