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基于适应度评价扩展自适应遗传算法的门级电路进化设计
被引量：
6
1
作者
柏磊
顾陈
+1 位作者
严璐
朱晓华
《南京理工大学学报》
EI
CAS
CSCD
北大核心
2011年第2期240-244,共5页
针对遗传算法适应度评价阶段指定输出单元容易丢失潜在解的问题,该文提出了一种基于适应度评价扩展的电路进化设计方法。该方法将每个逻辑单元的输出都视为一个潜在的解处理,得到一个最优适应度评价值,避免了潜在解的丢失,有效地提高了...
针对遗传算法适应度评价阶段指定输出单元容易丢失潜在解的问题,该文提出了一种基于适应度评价扩展的电路进化设计方法。该方法将每个逻辑单元的输出都视为一个潜在的解处理,得到一个最优适应度评价值,避免了潜在解的丢失,有效地提高了自适应遗传算法的性能。通过多种电路的进化设计实验比较了该文方法与传统自适应遗传算法设计的性能,结果表明,该文方法具有收敛速度快、迭代次数少、获得最优解成功概率高的优点。
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关键词
电路进化设计
适应度评价扩展
门级电路
自适应遗传算法
可进化硬件
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职称材料
题名
基于适应度评价扩展自适应遗传算法的门级电路进化设计
被引量：
6
1
作者
柏磊
顾陈
严璐
朱晓华
机构
南京
理工大学电子工程与光电
技术
学院
南京莱斯信息技术股份有限公司智能交通事业部
出处
《南京理工大学学报》
EI
CAS
CSCD
北大核心
2011年第2期240-244,共5页
文摘
针对遗传算法适应度评价阶段指定输出单元容易丢失潜在解的问题,该文提出了一种基于适应度评价扩展的电路进化设计方法。该方法将每个逻辑单元的输出都视为一个潜在的解处理,得到一个最优适应度评价值,避免了潜在解的丢失,有效地提高了自适应遗传算法的性能。通过多种电路的进化设计实验比较了该文方法与传统自适应遗传算法设计的性能,结果表明,该文方法具有收敛速度快、迭代次数少、获得最优解成功概率高的优点。
关键词
电路进化设计
适应度评价扩展
门级电路
自适应遗传算法
可进化硬件
Keywords
evolutionary design of circuits
fitness evaluation expansion
gate-level circuits
adaptive genetic algorithm
evolvable hardware
分类号
TP18 [自动化与计算机技术—控制理论与控制工程]
TN702 [电子电信—电路与系统]
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题名
作者
出处
发文年
被引量
操作
1
基于适应度评价扩展自适应遗传算法的门级电路进化设计
柏磊
顾陈
严璐
朱晓华
《南京理工大学学报》
EI
CAS
CSCD
北大核心
2011
6
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