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时钟及面积优化的可配置片上网络路由器
被引量：
2
1
作者
胡东伟
尚德龙
+1 位作者
张勇
王力男
《西安电子科技大学学报》
EI
CAS
CSCD
北大核心
2022年第2期125-134,共10页
片上网络路由器是实现多核/众核互连的核心电路部件。在介绍同步先进先出缓存器和异步先进先出缓存器的实现电路架构和延迟特点以及片上网络及其路由器架构的基础上,提出了片上网络的时钟优化方案,给出了优化时钟方案下的路由器电路结构...
片上网络路由器是实现多核/众核互连的核心电路部件。在介绍同步先进先出缓存器和异步先进先出缓存器的实现电路架构和延迟特点以及片上网络及其路由器架构的基础上,提出了片上网络的时钟优化方案,给出了优化时钟方案下的路由器电路结构,并进行了实现。采用该时钟方案,片上网络路由器间的延迟得以减小。为降低先进先出缓存器的面积开销,进一步提出采用锁存器来实现同步或异步先进先出缓存器,解决了单时钟下的锁存器写问题。更进一步,给出了多个先进先出缓存器的共享实现方案。文章中的方案对开发低功耗嵌入式众核处理器具有直接指导意义。
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关键词
先进先出缓存器
片上网络
路由器
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职称材料
题名
时钟及面积优化的可配置片上网络路由器
被引量：
2
1
作者
胡东伟
尚德龙
张勇
王力男
机构
中国电子科技集团公司第五十四
研究
所
南京智能技术研究院
出处
《西安电子科技大学学报》
EI
CAS
CSCD
北大核心
2022年第2期125-134,共10页
基金
国防基础研究计划(HHX20641,HHX21641)。
文摘
片上网络路由器是实现多核/众核互连的核心电路部件。在介绍同步先进先出缓存器和异步先进先出缓存器的实现电路架构和延迟特点以及片上网络及其路由器架构的基础上,提出了片上网络的时钟优化方案,给出了优化时钟方案下的路由器电路结构,并进行了实现。采用该时钟方案,片上网络路由器间的延迟得以减小。为降低先进先出缓存器的面积开销,进一步提出采用锁存器来实现同步或异步先进先出缓存器,解决了单时钟下的锁存器写问题。更进一步,给出了多个先进先出缓存器的共享实现方案。文章中的方案对开发低功耗嵌入式众核处理器具有直接指导意义。
关键词
先进先出缓存器
片上网络
路由器
Keywords
first-input-first-output
network-on-chip
router
分类号
TN4 [电子电信—微电子学与固体电子学]
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题名
作者
出处
发文年
被引量
操作
1
时钟及面积优化的可配置片上网络路由器
胡东伟
尚德龙
张勇
王力男
《西安电子科技大学学报》
EI
CAS
CSCD
北大核心
2022
2
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