基于RC触发NMOS器件的ESD电路设计 被引量：4

1

作者 李志国 余天宇 +2 位作者 张颖 孙磊 潘亮 《半导体技术》 CAS CSCD 北大核心 2014年第8期579-583,共5页

研究了基于电阻(R)电容(C)触发n型金属氧化物半导体(NMOS)器件的静电放电(ESD)电路参数与结构的设计,讨论了电阻电容触发结构对ESD性能的提升作用,研究了不同RC值对ESD性能的影响以及反相器结构带来的ESD性能差异,并讨论了在特定应用中... 研究了基于电阻(R)电容(C)触发n型金属氧化物半导体(NMOS)器件的静电放电(ESD)电路参数与结构的设计,讨论了电阻电容触发结构对ESD性能的提升作用,研究了不同RC值对ESD性能的影响以及反相器结构带来的ESD性能差异,并讨论了在特定应用中沟道放电器件的优势。通过一系列ESD测试电路的测试和分析,发现电阻电容触发结构可以明显提高ESD电路的保护能力,其中RC值10 ns设计的栅耦合NMOS(GCNMOS)电路具有最高的单位面积ESD保护能力,达到0.62 mA/μm2。另外对于要求触发电压特别低的应用场合,RC值1μs设计的GCNMOS电路将是最好的选择,ESD能力可以达到0.47 mA/μm2,而触发电压只有3 V。 展开更多

关键词 互补型金属氧化物半导体(CMOS)工艺 电阻电容触发NMOS 静电放电(ESD)电路 传输线脉冲(TLP)测试 热效应

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USB1．1控制器的设计与实现 被引量：6

2

作者 谷荧柯 王征 +1 位作者 白国强 陈弘毅 《计算机工程》 CAS CSCD 北大核心 2009年第2期236-238,共3页

设计并实现一种USB1.1控制器,能在全速模式下支持控制、中断、批量3种传输方式,端点数可配置。将其作为IP核应用于一款安全芯片中,能解决芯片的部分I/O通信瓶颈问题。该USB1.1控制器配合MCU8051在FPGA验证平台上实现,可与PC机通信,并在... 设计并实现一种USB1.1控制器,能在全速模式下支持控制、中断、批量3种传输方式,端点数可配置。将其作为IP核应用于一款安全芯片中,能解决芯片的部分I/O通信瓶颈问题。该USB1.1控制器配合MCU8051在FPGA验证平台上实现,可与PC机通信,并在此基础上完成对安全芯片其他功能模块的FPGA验证。 展开更多

关键词 通用串行总线 FPGA验证 SFR总线

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智能卡芯片中TDES密码电路的差分功耗攻击 被引量：2

3

作者 欧海文 李起瑞 +1 位作者 胡晓波 赵静 《计算机应用研究》 CSCD 北大核心 2012年第3期927-929,共3页

使用相关性分析方法进行差分功耗攻击(DPA)实验,成功攻击了TDES密码算法。结果表明,相关性分析方法对简单的功耗模型具有很好的攻击效果且实施简单,对于HD功耗模型,获得TDES每一轮的圈密钥所需最少曲线条数仅为3 500条;同时,由于TDES和... 使用相关性分析方法进行差分功耗攻击(DPA)实验,成功攻击了TDES密码算法。结果表明,相关性分析方法对简单的功耗模型具有很好的攻击效果且实施简单,对于HD功耗模型,获得TDES每一轮的圈密钥所需最少曲线条数仅为3 500条;同时,由于TDES和DES电路的实现结构相同,对两者进行DPA攻击的方法相同。 展开更多

关键词 智能卡芯片 相关性分析 功耗模型 三重加密标准 差分功耗攻击

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一种UART&SPI接口验证工具的设计与实现 被引量：1

4

作者 李欣伟 《现代电子技术》 2013年第24期94-98,共5页

随着WLAN(无线局域网)的普及,各种接口的WLAN网卡层出不穷,像UART,SPI,USB等。为了验证接口的功能、性能和兼容性是否符合需求,在此提出了一种支持UART&SPI接口的验证工具。传统的接口验证采用手动验证的方法,即手动修改UART接口的... 随着WLAN(无线局域网)的普及,各种接口的WLAN网卡层出不穷,像UART,SPI,USB等。为了验证接口的功能、性能和兼容性是否符合需求,在此提出了一种支持UART&SPI接口的验证工具。传统的接口验证采用手动验证的方法,即手动修改UART接口的波特率或SPI接口的大小端等来达到遍历所有用例的目的,传统方法存在效率低,容易漏测测试用例等缺陷。而该工具通过命令通道完成上位机和下位机的协商,保持接口参数同步;数据通道验证在该接口参数下的功能和性能,实现了接口的功能和性能验证的自动化,大大提高了测试效率,保证测试用例的覆盖率。该工具适用于多种平台下的UART和SPI接口验证。 展开更多

关键词 UART SPI 接口验证 自动化

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一种WLAN自动化测试平台的设计及实现 被引量：1

5

作者 李欣伟 王玲玲 《现代电子技术》 2012年第1期150-152,156,共4页

随着WLAN(无线局域网)业务的日益普及,WLAN测试显得尤为重要。而传统的WLAN测试方法以人工测试为主。人工测试存在效率低、测试覆盖率得不到保障等缺点。介绍了一种WLAN自动化测试平台的设计与实现。采用Linux作为控制端,远程Telnet AP(... 随着WLAN(无线局域网)业务的日益普及,WLAN测试显得尤为重要。而传统的WLAN测试方法以人工测试为主。人工测试存在效率低、测试覆盖率得不到保障等缺点。介绍了一种WLAN自动化测试平台的设计与实现。采用Linux作为控制端,远程Telnet AP(Access Point)端和STA(station)端,分别通过脚本配置AP端和STA端,并控制他们之间的交互。该平台可实现跨平台、自动配置AP和STA、自动搜集日志、自动生成测试报告,从而大大节约了人力成本,提高了工作效率。 展开更多

关键词 WLAN 自动化测试 TELNET GTK

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双界面智能卡芯片模拟前端ESD设计

6

作者 李志国 孙磊 潘亮 《半导体技术》 CAS CSCD 北大核心 2017年第4期269-274,共6页

双界面智能卡芯片静电放电(ESD)可靠性的关键是模拟前端(AFE)模块的ESD可靠性设计,如果按照代工厂发布的ESD设计规则设计,AFE模块的版图面积将非常大。针对双界面智能卡芯片AFE电路结构特点和失效机理,设计了一系列ESD测试结构。通过对... 双界面智能卡芯片静电放电(ESD)可靠性的关键是模拟前端(AFE)模块的ESD可靠性设计,如果按照代工厂发布的ESD设计规则设计,AFE模块的版图面积将非常大。针对双界面智能卡芯片AFE电路结构特点和失效机理,设计了一系列ESD测试结构。通过对这些结构的流片和测试分析,研究了器件设计参数和电路设计结构对双界面智能卡芯片ESD性能的影响。定制了适用于双界面智能卡芯片AFE模块设计的ESD设计规则,实现对ESD器件和AFE内核电路敏感结构的面积优化,最终成功缩小了AFE版图面积,降低了芯片加工成本,并且芯片通过了8 000 V人体模型(HBM)ESD测试。 展开更多

关键词 双界面智能卡 模拟前端(AFE) 静电放电(ESD) 人体模型(HBM) 设计规则 芯片成本

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基于反码抗DPA、DFA的DES设计方法

7

作者 冀利刚 《计算机应用》 CSCD 北大核心 2013年第A02期147-149,共3页

当前以差分功耗攻击、差分错误攻击为代表的攻击,对芯片实现的数据加密标准(DES)造成了严重威胁。提出一种有效降低密码设备运行中泄露的功耗信息的方案。该方案通过算法变换,找到了一种与原始DES的中间数据互为补码的实现流程,减小了... 当前以差分功耗攻击、差分错误攻击为代表的攻击,对芯片实现的数据加密标准(DES)造成了严重威胁。提出一种有效降低密码设备运行中泄露的功耗信息的方案。该方案通过算法变换,找到了一种与原始DES的中间数据互为补码的实现流程,减小了不同数据在密码设备运行中的功耗差异,具有抗差分功耗分析(DPA)攻击的能力。由于中间值互为补码,增加校验还可抵抗差分故障分析攻击(DFA)。该方案具有实现简单、开销小的特点,可直接应用于电路设计。 展开更多

关键词 数据加密标准算法 差分功耗攻击 抗差分功耗分析攻击 抗差分故障分析攻击

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TYPE B芯片射频接口电路技术研究

8

作者 刘晓艳 张建平 +1 位作者 马纪丰 王小宁 《科学技术与工程》 2009年第6期1532-1536,1545,共6页

整流器、时钟提取电路、调制电路和解调器等主要模块,符合ISO/IEC14443TypeB协议的非接触IC卡射频接口电路的基本构成,列举并分析了具体的电路实现形式。对于TypeB射频接口电路的设计具有参考和指导意义。

关键词 TypeB射频接口电路 整流 时钟提取 调制 解调

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基于DFT滤波器组的低时延FPGA语音处理实现研究 被引量：5

9

作者 薛一鸣 陈鹞 +2 位作者 何宁宁 胡彩娥 王建平 《电子学报》 EI CAS CSCD 北大核心 2018年第3期695-701,共7页

提出了WOLA(Weighted Overlap-Add)并行结构的低时延DFT滤波器组的设计和FPGA实现方法.为降低系统总体时延,在综合考虑传递失真、混迭失真的基础上,将群时延引入系统目标函数,并采用非对称综合原型滤波器设计方法,提出迭代算法,实现了DF... 提出了WOLA(Weighted Overlap-Add)并行结构的低时延DFT滤波器组的设计和FPGA实现方法.为降低系统总体时延,在综合考虑传递失真、混迭失真的基础上,将群时延引入系统目标函数,并采用非对称综合原型滤波器设计方法,提出迭代算法,实现了DFT滤波器组低时延优化设计.通过对DFT滤波器组中分析和综合功能的关键模块采用多路并行乘法、多级流水加法链设计,实现了并行的WOLA结构DFT滤波器组,降低FPGA实现的计算时延.整个设计在Xilinx公司的Zynq7020型号FPGA芯片上进行实现.PESQ测试表明,设计的DFT滤波器组能取得较好的语音质量.与串行WOLA结构的实现对比表明,在16k Hz语音采样率下,并行的WOLA结构FPGA实现的总时延能降低1.192ms,其中群时延降低12%,计算时延降低29.2%. 展开更多

关键词 语音处理 DFT滤波器组 低时延 FPGA 并行设计

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光纤陀螺组件快速高精度标定方法 被引量：1

10

作者 李松 高星伟 +1 位作者 孙伟 赵桂玲 《辽宁工程技术大学学报（自然科学版）》 CAS 北大核心 2018年第1期169-173,共5页

针对光纤陀螺组件标定周期长、程序复杂、参数重复性不好等问题,提出一种基于姿态误差的光纤陀螺组件快速、高精度标定方法.以最近一次的光纤陀螺标定参数作为初始值,在初始对准中估计陀螺漂移并对陀螺输出脉冲进行修正,推导标度因数误... 针对光纤陀螺组件标定周期长、程序复杂、参数重复性不好等问题,提出一种基于姿态误差的光纤陀螺组件快速、高精度标定方法.以最近一次的光纤陀螺标定参数作为初始值,在初始对准中估计陀螺漂移并对陀螺输出脉冲进行修正,推导标度因数误差和安装误差的标定误差与系统姿态误差之间的关系,以导航解算的姿态与转台提供的姿态之差作为观测量,设计光纤陀螺闭环标定路径,不断对标度因数和安装误差进行修正,并根据光纤陀螺器件精度和标定参数分辨率设计快速标定结束临界值ε.标定及导航实验结果表明:光纤陀螺组件快速、高精度标定方法可以完成3个标度因数和6个安装误差的计算,并大幅度提高系统定位精度. 展开更多

关键词 光纤陀螺 标定 标度因数 安装误差 闭环标定

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串扰延迟变化曲线的分析计算 被引量：1

11

作者 孙加兴 郑赟 +1 位作者 叶青 叶甜春 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2005年第10期2232-2238,共7页

在串扰噪声及互连线延迟研究的基础上,分析了串扰延迟的本质以及串扰延迟变化曲线的计算问题;深入探讨了串扰延迟变化曲线和串扰噪声的关系,指出两者并不存在镜像关系,最大串扰延迟变化并不一定对应于串扰噪声尖峰值;研究了几个重要参... 在串扰噪声及互连线延迟研究的基础上,分析了串扰延迟的本质以及串扰延迟变化曲线的计算问题;深入探讨了串扰延迟变化曲线和串扰噪声的关系,指出两者并不存在镜像关系,最大串扰延迟变化并不一定对应于串扰噪声尖峰值;研究了几个重要参数对串扰延迟变化曲线影响的灵敏度.全SPICE模拟结果说明了文中分析的正确性和准确性. 展开更多

关键词 串扰延迟 输入偏移 串扰延迟变化曲线

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基于参数寻优的立体声鲁棒水印算法 被引量：1

12

作者 薛一鸣 张金雨 +1 位作者 陈波涛 杨正洪 《通信学报》 EI CSCD 北大核心 2023年第7期149-158,共10页

针对网络音频数据非法传播、隐私泄露等问题,提出了一种基于参数寻优的立体声鲁棒水印算法。首先利用立体声2个声道之间的相对关系对攻击的不敏感性,以2个声道的相对失真最小为目标,优化嵌入过程,修改奇数段的奇异值比值以嵌入水印,提... 针对网络音频数据非法传播、隐私泄露等问题,提出了一种基于参数寻优的立体声鲁棒水印算法。首先利用立体声2个声道之间的相对关系对攻击的不敏感性,以2个声道的相对失真最小为目标,优化嵌入过程,修改奇数段的奇异值比值以嵌入水印,提高音频文件的感知质量。其次,针对不同音频文件,提出一种参数寻优算法用于寻找对每个音频文件最优的参数,更好地平衡了算法的不可感知性和鲁棒性。仿真实验结果证明,所提算法具有较好的不可感知性,并且对常规信号处理均具有较好的鲁棒性。 展开更多

关键词 立体声音频 音频水印 参数寻优

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互连线延迟的瑞利度量 被引量：3

13

作者 刘昆 郑文赟 +1 位作者 黄道君 侯劲松 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2005年第1期119-121,共3页

从统计概率的角度出发 ,提出一种采用瑞利分布的延迟度量———互连线延迟的瑞利度量 (RLD) 该算法仅需要采用前两个瞬态 ,计算简单 ,而且准确性较好 。

关键词 概率密度函数 统计密度函数 瞬态 瑞利分布

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基于线性判别分析的模幂掩码模板攻击方法 被引量：2

14

作者 韩绪仓 陈波涛 +2 位作者 曹伟琼 陈华 李昊远 《电子学报》 EI CAS CSCD 北大核心 2023年第11期3024-3032,共9页

掩码在模幂安全实现中被广泛采用,其抵抗侧信道分析的能力已被充分证明.本文发现模乘运算中读操作数的功耗将泄露操作数的地址,进而提出了一种基于线性判别分析的模板攻击方法,可对模幂掩码实现进行攻击.相比以往基于操作数的泄露,读操... 掩码在模幂安全实现中被广泛采用,其抵抗侧信道分析的能力已被充分证明.本文发现模乘运算中读操作数的功耗将泄露操作数的地址,进而提出了一种基于线性判别分析的模板攻击方法,可对模幂掩码实现进行攻击.相比以往基于操作数的泄露,读操作数的功耗泄露将不受掩码的影响,对常见的带掩码防护的模幂实现仍有效.本文提出的方法首先将测试向量泄露检测技术应用于泄露特征提取,降低了无关点对攻击的影响;然后将线性判别分析扩展用于对曲线的分类和降维,提升了曲线的类可分离性.最后,本文以硬件模幂掩码实现为实验对象,通过实验验证了基于读取操作数的泄露分布在整个模乘运算中,且对不同类型模乘分类的准确率可达到99.98%. 展开更多

关键词 指数掩码 模幂掩码 模板攻击 线性判别分析 泄露检测 操作数读取

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针对掩码AES的选择明文和二阶DPA组合攻击 被引量：2

15

作者 王飞宇 陈波涛 +2 位作者 刘剑峰 苑志刚 郑晓光 《密码学报》 2014年第6期525-536,共12页

AES算法已经被广泛的应用于商业密码领域,未加防护的AES算法可被DPA攻击.掩码是一种有效的抗DPA攻击防护措施,尤其是采用全掩码技术后,常规DPA无法对其成功实施攻击.本文提出了一种选择明文和二阶DPA的组合攻击方法(CSDCA),可成功实施... AES算法已经被广泛的应用于商业密码领域,未加防护的AES算法可被DPA攻击.掩码是一种有效的抗DPA攻击防护措施,尤其是采用全掩码技术后,常规DPA无法对其成功实施攻击.本文提出了一种选择明文和二阶DPA的组合攻击方法(CSDCA),可成功实施对全掩码AES电路的侧信道攻击.首先利用选择明文的方式降低密钥遍历的空间,由128比特降至每8比特分组进行攻击;同时,选择初始轮的轮输出和第一轮的轮输出作为中间值,采用二阶DPA技术,去除掩码防护,从而成功攻击掩码防护.实验结果表明:对于采用SASEBO板仿真实现的全掩码AES算法,应用CSDCA方法后,采集6万条曲线一小时即可获得密钥.相比于传统的二阶DPA攻击,本方法攻击成功所需的曲线条数(攻击所需时间)可降低94%(由100万条降低至6万条);该方法与业界常用方法(毛刺DPA攻击)相比,曲线条数(攻击时间)可降低79%(由28万条降低至6万条). 展开更多

关键词 选择明文攻击 二阶DPA AES 掩码 组合攻击

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基于重采样的差分频域分析方法 被引量：3

16

作者 王喆 刘戬 +1 位作者 王飞宇 刘剑峰 《计算机学报》 EI CSCD 北大核心 2015年第4期783-792,共10页

差分频域分析方法是常用的攻击方法之一,当设计中使用随机延时运行等其他防护措施时,现有的差分功耗分析方法已经不能开展攻击,而差分频域分析方法可以对这类防护措施实施攻击.但该攻击方法会带入更多噪声,降低攻击效率.针对以上问题,... 差分频域分析方法是常用的攻击方法之一,当设计中使用随机延时运行等其他防护措施时,现有的差分功耗分析方法已经不能开展攻击,而差分频域分析方法可以对这类防护措施实施攻击.但该攻击方法会带入更多噪声,降低攻击效率.针对以上问题,文中提出了一种基于重采样的差分频域分析方法,该方法可有效地提升攻击效率.文中首先介绍了基于重采样的差分频域分析方法的基本原理,然后搭建实验,在SASEBO GII仿真板上实现一个防护措施为随机延时运行和功耗隐藏的DES算法实施攻击.实验结果表明,针对DES随机延时运行和功耗隐藏防护措施,文中提出的重采样频域攻击方法较之DPA方法可攻击成功,是多种防护措施攻击成功的实例.同时,采用重采样处理的差分频域分析方法可以有效提高信号的信噪比,将攻击效率提升一倍. 展开更多

关键词 差分频域分析 重采样 DES 防护措施 密码学

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物联网感知层信息安全分析与建议 被引量：9

17

作者 马纪丰 梁浩 《现代电子技术》 2012年第19期76-78,88,共4页

物联网是以感知为目的,实现人与人、人与物、物与人全面互联的网络。其概念一经提出,得到了各国政府、科研机构以及各类企业的大力推广和积极发展。感知层作为物联网信息获取的主要来源,其信息安全问题是物联网发展所面临的首要问题。... 物联网是以感知为目的,实现人与人、人与物、物与人全面互联的网络。其概念一经提出,得到了各国政府、科研机构以及各类企业的大力推广和积极发展。感知层作为物联网信息获取的主要来源,其信息安全问题是物联网发展所面临的首要问题。对物联网感知层的信息获取方式以及存在的安全威胁进行了研究,并对现有的安全防护机制进行了分析和总结。最后,针对感知层目前存在的信息安全问题及其技术的发展趋势,提出了相应的应对建议措施。 展开更多

关键词 物联网 感知层 信息安全 建议

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基于高速JTAG的嵌入式CPU的调试技术 被引量：2

18

作者 李艳华 李丹 唐晓柯 《电子测量技术》 2008年第5期80-83,共4页

JTAG调试技术是CPU的调试手段之一。针对传统调试技术的效率低,本文介绍一种新的高效的JTAG调试技术,采用中断的方式,通过中断服务程序配合和直接对存储器的读写控制的方法实现调试。本文详细介绍了基于高速JTAG调试技术的单步、断点、... JTAG调试技术是CPU的调试手段之一。针对传统调试技术的效率低,本文介绍一种新的高效的JTAG调试技术,采用中断的方式,通过中断服务程序配合和直接对存储器的读写控制的方法实现调试。本文详细介绍了基于高速JTAG调试技术的单步、断点、读写存储器、特殊功能寄存器的实现原理,并给出了逻辑实现框图和实验结果。实验结果表明,采用本文介绍的调试技术相比传统的插入指令的调试技术在大批量数据传输上速度提高约80倍,是一种非常简洁实用的调试技术。 展开更多

关键词 JTAG 嵌入式CPU 调试方法 断点屏驱动 QT/E 人机交互

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改进的PACT算法在RC网络约简中的应用

19

作者 李宁 侯劲松 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2004年第4期407-413,共7页

超大规模集成电路设计进入深亚微米阶段 ,衬底和互连线的寄生RC参数成为影响电路速度和信号完整性分析的关键因素 由于互连提取的RC规模十分庞大 ,对其进行时序分析十分困难 ,因此需要对提取的RC网络进行约简 在经典的RC网络约简算法PAC... 超大规模集成电路设计进入深亚微米阶段 ,衬底和互连线的寄生RC参数成为影响电路速度和信号完整性分析的关键因素 由于互连提取的RC规模十分庞大 ,对其进行时序分析十分困难 ,因此需要对提取的RC网络进行约简 在经典的RC网络约简算法PACT的基础上提出几点重要改进 ,明显地提高了网络约简的速度 ,改进后的算法克服了经典PACT算法的局限性 ,使之可以适用于含有到端口无直流通路的内点的电路 ,从而提高了该算法的适用性 计算结果表明 ,在精度保持不变的条件下 。 展开更多

关键词 RC网络约简 共轭变换极点分析 RCM PACT算法 速度 超大规模集成电路 设计

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浅谈绩效管理在企业导入时遇到的问题 被引量：1

20

作者 吕霖 《人口与经济》 CSSCI 北大核心 2004年第S1期178-180,共3页

关键词 绩效管理 职位 工作岗位 人力资源工作者 企业 企业管理

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