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一种基于相位插值器的低抖动串行链路接收器
被引量：
1
1
作者
吕俊盛
邵刚
田泽
《半导体技术》
CAS
CSCD
北大核心
2016年第6期429-434,共6页
为了提高接收器在多通道和多协议应用中的性能,提出了一种基于高线性度相位插值器的低抖动串行链路接收器。采用环形压控振荡器锁相环提供参考时钟,通过数字滤波器控制相位插值器调整采样时钟相位从而完成低抖动的数据恢复。整个接收器...
为了提高接收器在多通道和多协议应用中的性能,提出了一种基于高线性度相位插值器的低抖动串行链路接收器。采用环形压控振荡器锁相环提供参考时钟,通过数字滤波器控制相位插值器调整采样时钟相位从而完成低抖动的数据恢复。整个接收器在65 nm CMOS工艺平台实现流片验证,单通道接收器的面积为320μm×685μm。测试结果表明,接收器工作在3.125 Gbit/s时,引入的总抖动仅为11.3 ps;电路采用1.2 V供电,功耗仅为21 m W;在PCIE,FC和SRIO三种协议规定的1.062 5-3.125 Gbit/s数据率下,收发器的误码率均小于10-12。
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关键词
多通道
多协议
低抖动
相位插值器
接收器
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题名
一种基于相位插值器的低抖动串行链路接收器
被引量：
1
1
作者
吕俊盛
邵刚
田泽
机构
中国航空工业集团公司西安航空计算技术研究所集成电路与微系统设计航空科技重点实验室
出处
《半导体技术》
CAS
CSCD
北大核心
2016年第6期429-434,共6页
文摘
为了提高接收器在多通道和多协议应用中的性能,提出了一种基于高线性度相位插值器的低抖动串行链路接收器。采用环形压控振荡器锁相环提供参考时钟,通过数字滤波器控制相位插值器调整采样时钟相位从而完成低抖动的数据恢复。整个接收器在65 nm CMOS工艺平台实现流片验证,单通道接收器的面积为320μm×685μm。测试结果表明,接收器工作在3.125 Gbit/s时,引入的总抖动仅为11.3 ps;电路采用1.2 V供电,功耗仅为21 m W;在PCIE,FC和SRIO三种协议规定的1.062 5-3.125 Gbit/s数据率下,收发器的误码率均小于10-12。
关键词
多通道
多协议
低抖动
相位插值器
接收器
Keywords
multi-lane
multi-standard
low jitter
phase interpolator
receiver
分类号
TN492 [电子电信—微电子学与固体电子学]
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题名
作者
出处
发文年
被引量
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1
一种基于相位插值器的低抖动串行链路接收器
吕俊盛
邵刚
田泽
《半导体技术》
CAS
CSCD
北大核心
2016
1
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