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高可靠信息系统非相似冗余架构中的执行体同步技术
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作者 于洪 刘勤让 +1 位作者 魏帅 兰巨龙 《电子与信息学报》 EI CAS CSCD 北大核心 2024年第5期2122-2136,共15页
非相似冗余架构被广泛使用到信息系统中,提高系统的安全性和可靠性。非相似冗余架构中的执行体之间存在差异,当系统正常工作时,执行体表现一致,但在面对恶意攻击行为时,执行体会表现出不一致。架构通过比较执行体的表现监控系统、感知威... 非相似冗余架构被广泛使用到信息系统中,提高系统的安全性和可靠性。非相似冗余架构中的执行体之间存在差异,当系统正常工作时,执行体表现一致,但在面对恶意攻击行为时,执行体会表现出不一致。架构通过比较执行体的表现监控系统、感知威胁,从而提升系统安全可靠性。执行体的同步监控,是所有非相似冗余架构都需要解决的难题。目前没有针对同步技术比较系统性的描述和总结。该文首先对执行体同步问题进行了抽象建模,然后提出基于同步点的同步技术分类方法,并分别对每种技术的基本方式、流行度、优缺点进行了总结。该文还提出了影响同步效果的3个重要指标:同步点、误报率和性能,同时给出了同步技术的数学模型,可用于同步技术的设计评估。最后,结合网络弹性工程领域和软件定义晶上系统领域的发展,指出了同步技术未来的发展潜力和可能的发展方向。 展开更多
关键词 非相似冗余 多变体 异构冗余 执行体同步
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基于国产FPGA的高速SS7信令研究与实现 被引量:1
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作者 李静岩 何赞园 王领伟 《现代电子技术》 北大核心 2024年第15期1-7,共7页
高速SS7信令是一种在数字通信网中使用的公共信道信令技术,适用于无线和有线的公共交换电话网。现有高速信令解析方案可拓展性相对不足,在实际应用场景中扩展成本巨大,并且大都采用外国平台实现。随着国家信息系统软硬件平台对自主可控... 高速SS7信令是一种在数字通信网中使用的公共信道信令技术,适用于无线和有线的公共交换电话网。现有高速信令解析方案可拓展性相对不足,在实际应用场景中扩展成本巨大,并且大都采用外国平台实现。随着国家信息系统软硬件平台对自主可控要求越来越高,文中提出一种基于国产高云FPGA的高速SS7信令解析方案。信令解析过程包括信令采集模块和信令过滤模块,分别对其进行了详细的介绍,并且解析信令的同时统计系统运行信息。相比现有方案,文中方案采用国产平台实现,满足自主可控要求,并对方案进行了模块化参数化设计,可以很容易地实现不同应用场景的扩展。最终设计实现了8路高速SS7信令的并发处理,经过实网测试验证,达到了预期的目的,并成功投入商用。 展开更多
关键词 高速SS7信令 可拓展性 自主可控要求 高云FPGA 模块化参数化 并发处理
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NB-IoT技术在ATCA监测系统中的应用 被引量:1
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作者 邢留洋 何赞园 +1 位作者 汤红波 高远 《电讯技术》 北大核心 2022年第2期218-224,共7页
为解决先进计算电信架构(Advanced Telecom Computing Architecture,ATCA)设备监测系统中存在的控制板卡自主可控度低、监测范围有限、部署实施难度大、运维成本高等问题,在实现智能平台管理控制器(Intelligent Platform Management Con... 为解决先进计算电信架构(Advanced Telecom Computing Architecture,ATCA)设备监测系统中存在的控制板卡自主可控度低、监测范围有限、部署实施难度大、运维成本高等问题,在实现智能平台管理控制器(Intelligent Platform Management Controller,IPMC)自主可控及监测界面设计的基础上,提出将现网中ATCA监测系统结构与近年备受关注的低功耗广域网(Low Power Wide Area Network,LPWAN)中的窄带物联网(Narrow Band Internet of Things,NB-IoT)技术相结合。通过对3种NB-IoT应用方案进行对比分析,结合目前现实情况,提出一种快速无线组网的可行方案,并基于此方案设计出一种能够进行数据处理及转发的传输节点,实现了智能平台管理接口(Intelligent Platform Management Interface,IPMI)消息在机箱管理控制器(Shelf Management Controller,ShMC)节点与NB-IoT模组之间的高效数据传输。 展开更多
关键词 ATCA监测系统 智能平台管理控制器(IPMC) 窄带物联网(NB-IoT) 机箱管理控制器
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基于国产FPGA的移动通信网信令设计与实现 被引量:1
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作者 李静岩 何赞园 +2 位作者 陈鸿昶 巩小锐 陈云杰 《电讯技术》 北大核心 2024年第8期1298-1306,共9页
为提高电信网设备应对异常信令访问的检测能力,需对64K信令进行分析并处理。为了提高解析效率并满足近年来相关产品对自主可控越来越高的要求,设计了一种基于国产现场可编程门阵列(Field Programmable Gate Array, FPGA)的信令解析方案... 为提高电信网设备应对异常信令访问的检测能力,需对64K信令进行分析并处理。为了提高解析效率并满足近年来相关产品对自主可控越来越高的要求,设计了一种基于国产现场可编程门阵列(Field Programmable Gate Array, FPGA)的信令解析方案,给出了方案的总体设计思路,并对FPGA实现的功能模块进行详细说明。对系统进行设计时,采用模块化参数化方法以及在关键环节添加状态参数,提高了可扩展性并可以对模块内部运行状态进行监控,最终实现了对信令高效且灵活的解析,主要器件等均为国产。经过测试,可以实现STM-1(STM-Synchronous Transfer Module-1)数据的接入、串并转换、HDLC(High-level Data Link Control)解帧等功能,完成32路64K信令的并发处理,模块运行状态可查可看,达到了预期的效果。以STM-1为例,基于现有功能的模块化设计,可以平滑地扩展到STM-4、STM-16的应用。 展开更多
关键词 移动通信网 电路交换 64K信令 国产FPGA 模块化参数化设计
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支持增量式编程的多模态网络环境
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作者 崔子熙 田乐 +3 位作者 崔鹏帅 胡宇翔 伊鹏 邬江兴 《电子学报》 EI CAS CSCD 北大核心 2024年第4期1230-1238,共9页
当前,多模态网络编程模型与底层硬件紧耦合、强相关,导致网络程序呈现扁平化和单片化特征.因此,持续开发模态程序效率低下且极易出错,制约了网元设备的可用性和可靠性.为此,本文提出面向多模态网络的编程环境(PINet’s Programming Envi... 当前,多模态网络编程模型与底层硬件紧耦合、强相关,导致网络程序呈现扁平化和单片化特征.因此,持续开发模态程序效率低下且极易出错,制约了网元设备的可用性和可靠性.为此,本文提出面向多模态网络的编程环境(PINet’s Programming Environment,PPE),支持增量式开发网络协议与功能.基于“巨型交换机”思想,PPE提出了一种平台无关的编程模型及语言,支持模块化编程和跨平台移植,通过模块单元的灵活组合提高网络程序的开发效率.同时,针对上述模型设计了前后端分离的编译系统框架.该系统自动化解析并组合分布式的模态程序,通过优化报文处理逻辑自动适配硬件资源约束.实验结果表明,在不影响硬件性能的基础上,PPE能够降低20%的程序开发量,同时引入编译时延和资源开销在合理范围内. 展开更多
关键词 编程模型 多模态网络 可编程数据平面 模块化 增量式编程 网络模态
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5G网络下资源感知的服务功能链协同构建和映射算法 被引量:18
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作者 孙士清 彭建华 +1 位作者 游伟 李英乐 《西安交通大学学报》 EI CAS CSCD 北大核心 2020年第8期140-148,共9页
为了充分发挥网络功能虚拟化带来的灵活性优势,实现5G场景下定制化服务的高效部署,提出了一种资源感知的服务功能链协同构建和映射算法。该算法首先根据服务请求构建出服务功能链集合,然后对集合中的服务链进行映射,最终求解出资源优化... 为了充分发挥网络功能虚拟化带来的灵活性优势,实现5G场景下定制化服务的高效部署,提出了一种资源感知的服务功能链协同构建和映射算法。该算法首先根据服务请求构建出服务功能链集合,然后对集合中的服务链进行映射,最终求解出资源优化的服务链部署方案。在服务功能链构建阶段,采用基于广度优先搜索的服务功能链构建算法,得到服务功能链所有的构建方案;在服务链映射阶段,采用双层编码方法,将服务功能链构建方案和映射方案进行混合编码,然后利用改进的遗传粒子群算法对问题进行求解,计算出符合当前底层网络状态的服务功能链构建方案和映射方案。仿真结果表明,与TASAR算法相比,所提出的协同构建和映射算法服务请求接受率提高了9%,带宽资源开销降低了13%,节点资源开销提高了9%。 展开更多
关键词 5G网络 服务功能链 网络功能虚拟化 虚拟网络功能 粒子群算法
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SDN中基于全局拓扑感知的自适应流量均衡算法 被引量:4
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作者 王莅晟 伊鹏 +3 位作者 胡涛 江逸茗 胡静萍 胡宗魁 《电子学报》 EI CAS CSCD 北大核心 2021年第5期964-974,共11页
针对软件定义网络(Software-Defined Networking,SDN)中控制平面和数据平面之间的控制链路性能受限导致的Packet_In传输瓶颈问题,提出了一种自适应的流量均衡算法,利用SDN网络控制平面拥有全局拓扑和交换机实时状态的特点,运用阈值对流... 针对软件定义网络(Software-Defined Networking,SDN)中控制平面和数据平面之间的控制链路性能受限导致的Packet_In传输瓶颈问题,提出了一种自适应的流量均衡算法,利用SDN网络控制平面拥有全局拓扑和交换机实时状态的特点,运用阈值对流量均衡起止条件进行控制,通过将超载交换机中流量重定向到邻居交换机的一跳转发的自适应方法,解决上行控制链路瓶颈问题.与现有方法相比,减小了33%的上行控制链路负载与50%的Packet-In消息丢包率,且部署开销小. 展开更多
关键词 软件定义网络 控制链路 全局拓扑 流量优化 自适应
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异构计算并行编程模型综述 被引量:7
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作者 邬江兴 祁晓峰 高彦钊 《上海航天(中英文)》 CSCD 2021年第4期1-11,共11页
异构计算架构是目前高性能计算研究的重要领域。在异构计算架构中,不同种类的计算器件协同工作需要解决如任务调度、数据通信、存储、同步优化等问题。这些问题会对异构计算架构系统的运行性能、功耗、可靠性等指标产生重要影响。为解... 异构计算架构是目前高性能计算研究的重要领域。在异构计算架构中,不同种类的计算器件协同工作需要解决如任务调度、数据通信、存储、同步优化等问题。这些问题会对异构计算架构系统的运行性能、功耗、可靠性等指标产生重要影响。为解决异构系统的应用开发与系统优化问题,近年出现许多面向异构计算架构的并行编程模型。本文介绍异构并行编程模型的研究进展,针对异构并行计算需要解决的关键问题进行讨论,最后对异构体系架构的发展方向做出总结。 展开更多
关键词 异构计算 并行编程 编程模型 中间表示 任务调度 负载均衡
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一种融合局部拓扑影响力的时序链路预测算法 被引量:2
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作者 朱宇航 刘树新 +2 位作者 吉立新 何赞园 李英乐 《电子与信息学报》 EI CSCD 北大核心 2022年第4期1440-1452,共13页
链路预测旨在发现复杂网络中的未知连接和未来可能的连接,在推荐系统等实际应用中具有重要作用。考虑到许多真实网络的时序特性,时序链路预测逐渐成为研究热点。当前,基于时间序列分析的方法往往忽略了网络演化过程对网络本身的影响,而... 链路预测旨在发现复杂网络中的未知连接和未来可能的连接,在推荐系统等实际应用中具有重要作用。考虑到许多真实网络的时序特性,时序链路预测逐渐成为研究热点。当前,基于时间序列分析的方法往往忽略了网络演化过程对网络本身的影响,而基于静态网络演化的方法大多仅考虑了局部连边的演化影响,对网络拓扑结构的演化特性挖掘有限。针对上述问题,该文提出一种融合局部拓扑影响力的时序链路预测算法(TLP-FLSI)。首先,基于网络拓扑结构影响力作用,提出时序链路预测的通用模型(CTLPM);其次,研究拓扑实体间相互作用在动态网络上的演化规律,分别定义了节点和连边的演化因子,以及时间序列衰减的演化因子,综合利用多个维度的特征信息,给出了融合局部节点和连边特征影响力的时序链路预测算法;最后,在7个真实数据集上分别进行实验,对比传统基于移动平均方法、误差修正、邻居扩展加权和图注意力网络等时序链路预测方法,实验结果证明该算法具有较好的准确率和排序性能。 展开更多
关键词 时序动态网络 链路预测 融合特征 相似性指标 影响力衰减
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RapidIO交换芯片的静态时序约束设计 被引量:1
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作者 张丽 沈剑良 李沛杰 《现代电子技术》 2023年第4期1-6,共6页
静态时序分析是目前通用的芯片时序验证的重要方法,其依赖于时序模型和时序约束。时序约束是检验设计电路时序的准则,好的时序约束可以正确地体现芯片的设计需求。针对RapidIO交换芯片中存在的多时钟域构成、高速通道的高速时钟频率要求... 静态时序分析是目前通用的芯片时序验证的重要方法,其依赖于时序模型和时序约束。时序约束是检验设计电路时序的准则,好的时序约束可以正确地体现芯片的设计需求。针对RapidIO交换芯片中存在的多时钟域构成、高速通道的高速时钟频率要求,2x/4x绑定模式下多lane时钟同步等的特殊要求,以及较多的跨异步时钟处理存在的问题,文中提出一种多分组的全芯片时序约束,通过设置时钟定义、时钟组定义、端口延迟定义、时序例外和虚假路径等,以及修正和优化必要的setup time/hold time违例,解决RapidIO交换芯片静态时序分析中的时序违例等时序问题,实现时序收敛的目的。实验验证及流片测试结果表明,所有时序路径均满足时序要求,RapidIO芯片的时序约束设计正确、完备。 展开更多
关键词 静态时序分析 时序约束 RapidIO交换芯片 时序收敛 时钟同步 时钟约束
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一种面向超高速以太网的双模RS解码器设计
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作者 李继豪 沈剑良 陈艇 《现代电子技术》 2023年第4期35-40,共6页
100 GB以上超高速以太网采用FEC(Forward Error Correction)技术来降低误码率,提升传输可靠性。针对目前以太网中RS(528,514)码和RS(544,514)码两种编解码规范并存,导致的FEC解码器结构冗杂、资源耗费严重、面积占用大等问题,文中将多... 100 GB以上超高速以太网采用FEC(Forward Error Correction)技术来降低误码率,提升传输可靠性。针对目前以太网中RS(528,514)码和RS(544,514)码两种编解码规范并存,导致的FEC解码器结构冗杂、资源耗费严重、面积占用大等问题,文中将多模RS解码器的概念引入以太网FEC解码器设计,提出一种适用于100 GB及以上超高速以太网的双模RS解码器。通过对不同的编解码规范进行研究与分析,设计通用的SC、KES、CSEE模块并实现部分内存共享,采用并行设计与流水线处理来降低传输时延、提高吞吐量。在100 GB以太网中进行仿真实验,测试该双模解码器的功能完整性、资源开销以及功耗。结果表明,所设计的双模RS解码器能成功实现对两种FEC规范的解码,解码时延分别为93 ns,96 ns,相比于传统RS解码器,资源开销与功耗分别降低32.32%,17.34%。 展开更多
关键词 RS解码器 超高速以太网 双模解码器 内存共享 模块设计 仿真验证 性能分析
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全维可重构的多模态网络交换芯片架构设计
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作者 李彧 李召召 +1 位作者 吕平 刘勤让 《电信科学》 2023年第6期22-32,共11页
当前,IP网络结构僵化、可扩展性差、安全性差。为了解决这些问题,学者们提出了多模态网络的概念,并成为当前的研究热点。可编程网络交换芯片是多模态网络的实现基础。提出了一种全维可重构的多模态网络交换芯片架构,以嵌入式FPGA为基础... 当前,IP网络结构僵化、可扩展性差、安全性差。为了解决这些问题,学者们提出了多模态网络的概念,并成为当前的研究热点。可编程网络交换芯片是多模态网络的实现基础。提出了一种全维可重构的多模态网络交换芯片架构,以嵌入式FPGA为基础实现了多模态网络的端口级、比特级细粒度可重构,以自主设计的网络处理单元为基础实现了网络交换引擎的粗粒度可重构,使网络交换芯片具备了全维可重构的能力,为多模态网络的数据层提供了实现基础。还提出了一种改进的位矢量查找算法,能够以较小的资源占用实现较快的流表查找,提升网络交换性能,展现出较高的实用性。 展开更多
关键词 交换芯片 多模态网络 可重构计算
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