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一种含BCH编解码器的SLC/MLC NAND FLASH控制器的VLSI设计 被引量:11
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作者 李璐 周海燕 《现代电子技术》 2009年第7期167-170,共4页
为了满足存储器市场对低单比特成本和高存储密度的需求,在一款基于ARM926EJ的片上处理器芯片中,集成了一个可支持SLC/MLC NAND FLASH的控制器。为了纠正FLASH存储器芯片中的随机错误,采用了可纠4比特错误的BCH纠错码,该纠错码非常适应N... 为了满足存储器市场对低单比特成本和高存储密度的需求,在一款基于ARM926EJ的片上处理器芯片中,集成了一个可支持SLC/MLC NAND FLASH的控制器。为了纠正FLASH存储器芯片中的随机错误,采用了可纠4比特错误的BCH纠错码,该纠错码非常适应NAND类型存储器的随机错误特点。该控制器可支持多种类型的NAND FLASH。另外,对一种基于伯利坎普-梅西算法的高效BCH编解码器VLSI结构进行了研究,采用一种简化伯利坎普-梅西算法实现的低复杂度的关键方程解算机消除其速度瓶颈。芯片采用SMIC 0.13μm CMOS工艺。测试结果证明,设计电路完全符合系统规范,性能表现优良。 展开更多
关键词 MLC NAND FLASH控制器 BCH 编解码 伯利坎普-梅西算法 VLSI
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基于SystemC和Verilog软硬件协同验证 被引量:7
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作者 鲁芳 柏娜 《现代电子技术》 2008年第4期1-3,共3页
针对当前专用数字集成电路设计中的验证瓶颈,为了在更高的抽象级别对设计时象进行描述和验证,提出一种软硬件协同验证方法。该方法基于SystemC的交易级处理器内核模型和基于Verilog的内核之外的硬件模型。该方法被应用到东南大学研发的... 针对当前专用数字集成电路设计中的验证瓶颈,为了在更高的抽象级别对设计时象进行描述和验证,提出一种软硬件协同验证方法。该方法基于SystemC的交易级处理器内核模型和基于Verilog的内核之外的硬件模型。该方法被应用到东南大学研发的微处理器芯片GIV的具体验证中。实验数据表明,由于采用软硬件协同验证模型在芯片生产之前对系统功能、结构设计等进行验证,缩短了开发周期,降低了开发成本,提高了验证可靠性。 展开更多
关键词 软硬件协同验证 建模 交易级处理器 抽象级别
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