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一种回声消除和噪声抑制SoC芯片
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作者 叶波 李天望 罗敏 《电子学报》 EI CAS CSCD 北大核心 2009年第8期1789-1793,共5页
提出了一种回声消除和噪声抑制算法,采用改进的自适应步长非线性滤波技术,用单芯片对该算法进行了实现.用180nm 3.3V/1.8V 6层金属混合信号CMOS工艺流片,可达70dB的声学回声消除性能,噪音消除达20dB,侧音消除达30dB.该芯片包含1个16位DS... 提出了一种回声消除和噪声抑制算法,采用改进的自适应步长非线性滤波技术,用单芯片对该算法进行了实现.用180nm 3.3V/1.8V 6层金属混合信号CMOS工艺流片,可达70dB的声学回声消除性能,噪音消除达20dB,侧音消除达30dB.该芯片包含1个16位DSP、3个14位Σ-ΔADC、2个16位Σ-ΔDAC、以及内置ROM和RAM等,并集成有USB、UART、I^2C和PCM等接口.测试结果表明该芯片具有全双工和远距离免提的功能,支持双路麦克风输入,技术规范符合G.165国际标准.该芯片功耗低,外围电路简单,自适应能力强,可广泛应用于蓝牙车载免提通信、GPS和即时通讯等领域. 展开更多
关键词 回声消除 噪声抑制 免提通信 SOC芯片
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SDH/SONET支路时钟抖动衰减数字锁相环设计 被引量:1
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作者 叶波 罗敏 王紫石 《半导体技术》 CAS CSCD 北大核心 2009年第1期27-30,共4页
提出了一种新的光纤通信网络中SDH/SONET支路时钟抖动衰减设计方法。采用全数字锁相环技术和可编程的方法,根据不同类型的PDH信号,配置相应的增益和衰减因子,使得时钟的抖动衰减收敛速度可调节,能快速的达到国际电信联盟ITU-T标准规定... 提出了一种新的光纤通信网络中SDH/SONET支路时钟抖动衰减设计方法。采用全数字锁相环技术和可编程的方法,根据不同类型的PDH信号,配置相应的增益和衰减因子,使得时钟的抖动衰减收敛速度可调节,能快速的达到国际电信联盟ITU-T标准规定的抖动范围。对于E3信号,滤波组合为100 Hz^800 kHz时,最大峰峰抖动为0.05 UI,滤波组合为10~800 kHz时,最大峰峰抖动小于10-3UI。该方法电路实现结构简单,可广泛应用于光纤通信领域。 展开更多
关键词 数字抖动 衰减 数字锁相环
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