基于混沌系统的真随机数发生器芯片设计和实现 被引量：6

1

作者 张亮 戎蒙恬 +1 位作者 诸悦 吕永其 《上海交通大学学报》 EI CAS CSCD 北大核心 2006年第3期421-424,430,共5页

提出了一种真随机数发生器的硬件设计.结合时间离散混沌与振荡器采样,即由时间离散混沌系统作为高频振荡源,通过低速时钟采样产生随机数.理论研究和测试分析证明,该方案能生成分布均匀、彼此独立的随机信号.经制版流片后,芯片能在1 MHz... 提出了一种真随机数发生器的硬件设计.结合时间离散混沌与振荡器采样,即由时间离散混沌系统作为高频振荡源,通过低速时钟采样产生随机数.理论研究和测试分析证明,该方案能生成分布均匀、彼此独立的随机信号.经制版流片后,芯片能在1 MHz时钟下输出满足随机性测试的串行随机数,且抗干扰性较好. 展开更多

关键词 随机数发生器 时间离散混沌 振荡器 随机性测试

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千兆以太网1000BASE-T收发器物理编码子层系统及芯片设计 被引量：1

2

作者 夏琦 戎蒙恬 诸悦 《上海交通大学学报》 EI CAS CSCD 北大核心 2006年第3期528-531,共4页

提出了一种优化而可行的系统结构,并以硬件实现了千兆以太网物理编码子层.该系统主要电路模块包括:递归式系统卷积码和网格编码器,以达到约6 dB的编码增益;优化的逻辑电路,以实现符号映射,替代了约6 KB的ROM;并行搜索阵列电路,以实现物... 提出了一种优化而可行的系统结构,并以硬件实现了千兆以太网物理编码子层.该系统主要电路模块包括:递归式系统卷积码和网格编码器,以达到约6 dB的编码增益;优化的逻辑电路,以实现符号映射,替代了约6 KB的ROM;并行搜索阵列电路,以实现物理编码子层的训练.仿真及FPGA验证结果表明,该系统的关键路径时延小于7 ns,符合802.3标准. 展开更多

关键词 千兆以太网 物理编码子层 网格编码 并行搜索阵列

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Flash存储管理的研究与设计 被引量：7

3

作者 朱念好 周玉洁 《计算机工程与设计》 CSCD 北大核心 2010年第3期511-513,554,共4页

针对目前存储管理对大容量NAND Flash考虑的不足,在对大容量NAND Flash物理特性深入研究的基础上,实现了连续写与非连续写技术,提高了存储管理的效率。首先研究并实现了特有的状态信息描述方法,完全符合大容量MLC类型NAND Flash的物理特... 针对目前存储管理对大容量NAND Flash考虑的不足,在对大容量NAND Flash物理特性深入研究的基础上,实现了连续写与非连续写技术,提高了存储管理的效率。首先研究并实现了特有的状态信息描述方法,完全符合大容量MLC类型NAND Flash的物理特性,研究并实现了区域映射技术,适用于任何容量的闪存,并实现了连续写与非连续写技术,提高了写大文件的效率。实验结果表明,该方法在文件传输方面最大限度地挖掘了MLC类型NAND Flash的性能。 展开更多

关键词 闪存 存储管理 逻辑写 连续写 非连续写

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MP3解码程序在Openrisc开发系统上的实现

4

作者 王本峰 戎蒙恬 刘伟栋 《计算机工程》 EI CAS CSCD 北大核心 2005年第11期205-207,共3页

介绍了MP3解码器在Openrisc开发系统上实现的过程。Openrisc是源代码公开的32位RISC内核,使用之前经过了严格的仿真、测试。项目中,针对Openrisc系统环境对MP3的解码算法也作了很多优化,最终在下载有Openrisc内核的FPGA上得到验证,放出... 介绍了MP3解码器在Openrisc开发系统上实现的过程。Openrisc是源代码公开的32位RISC内核,使用之前经过了严格的仿真、测试。项目中,针对Openrisc系统环境对MP3的解码算法也作了很多优化,最终在下载有Openrisc内核的FPGA上得到验证,放出悦耳圆润的音乐。 展开更多

关键词 Openrisc MP3 FPGA 专用集成电路 综合子带滤波

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一种并行结构的H.264帧内预测器 被引量：9

5

作者 刘凌志 路奇 +1 位作者 戎蒙恬 郑世宝 《上海交通大学学报》 EI CAS CSCD 北大核心 2006年第1期54-58,共5页

提出了一种基于可重构设计的并行结构的H.264帧内预测器.在分析17种帧内预测值求解算法的基础上,利用其运算上的相似性,将所有运算单元集中到一个运算单元中.该运算单元可根据预测模式的不同对输入的数据安排相应的运算模块及数据通路,... 提出了一种基于可重构设计的并行结构的H.264帧内预测器.在分析17种帧内预测值求解算法的基础上,利用其运算上的相似性,将所有运算单元集中到一个运算单元中.该运算单元可根据预测模式的不同对输入的数据安排相应的运算模块及数据通路,从而达到资源的最优化利用.在实际应用中,为了达到适时解码,系统同时安排4个并行运算单元以提高处理能力.实验表明,在50.5 MHz时钟时,本结构可以适时处理720×480,30帧/s的图像. 展开更多

关键词 帧内预测器 H.264 可重构 并行结构

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基于FPGA的4096点基-4FFT模块的实现 被引量：6

6

作者 鲁欣 陈进 付宇卓 《系统工程与电子技术》 EI CSCD 北大核心 2004年第3期404-408,共5页

现场可编程门阵列(fieldprogrammablegatearray,FPGA)技术,具有集成高度、逻辑实现能力强等特点,已经成为数字系统设计的重要技术之一。数字脉冲压缩技术可靠性高,灵活性好,可编程,在现代雷达中广泛应用。快速傅里叶变换(fastFouriertra... 现场可编程门阵列(fieldprogrammablegatearray,FPGA)技术,具有集成高度、逻辑实现能力强等特点,已经成为数字系统设计的重要技术之一。数字脉冲压缩技术可靠性高,灵活性好,可编程,在现代雷达中广泛应用。快速傅里叶变换(fastFouriertransform,FFT)是一种实现数字脉冲压缩的高效、灵活的方法,也是实现雷达数字信号中重要技术。首先说明了基4FFT的基本知识,然后介绍了如何使用Xilinx的FPGA的来实现雷达信号处理机的数字脉压的核心———4096点FFT模块。 展开更多

关键词 现场可编程门阵列 数字脉冲压缩 快速傅里叶变换

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MPEG-4中基于内容的算术编码器的改进及优化 被引量：1

7

作者 丁涛 戎蒙恬 刘文江 《计算机工程》 EI CAS CSCD 北大核心 2006年第8期229-231,共3页

针对MPEG-4实现中算术编码器的计算瓶颈,在算法上对原始Q-coder编码的进位翻转问题和移位加方法进行改进,大大提高了编码效率。针对二值形状视频对象编码消耗大量资源的特点,提出一种高效的实现CAE的VLSI结构。在内部采用了一种延迟缓... 针对MPEG-4实现中算术编码器的计算瓶颈,在算法上对原始Q-coder编码的进位翻转问题和移位加方法进行改进,大大提高了编码效率。针对二值形状视频对象编码消耗大量资源的特点,提出一种高效的实现CAE的VLSI结构。在内部采用了一种延迟缓冲线机制保存输入的像素,每个时钟输出相应模板的内容,同时最大限度地安排要重复使用的像素。 展开更多

关键词 MPEG-4 形状编码 基于内容的算术编码 延迟缓冲线

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一种应用于DSP的快速位提取和插入实现方法

8

作者 王兵 徐如淏 付宇卓 《计算机工程》 CAS CSCD 北大核心 2004年第13期160-162,共3页

介绍了一种快速的位提取和插入实现方法。该方法通过使用快速的与或逻辑电路而不是较慢的多选1电路来减小时延;通过器件复用技术来减小面积。仿真和综合结果表明该方法大大优化了DSP的时延和面积,有助于提高DSP整体的运算速度和降低功耗。

关键词 时延 面积 移位 复用技术

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基于MIPS内核的HDTV-SoC平台总线接口模块

9

作者 周波 孙军 《计算机工程》 CAS CSCD 北大核心 2005年第17期43-45,共3页

介绍了使用MIPS32TM4KcTM处理器作为CPU内核的高清晰度电视(HDTV)SoC平台,着重提出了该平台上系统总线接口(HIF)模块的设计方案。并通过仿真和综合实验,验证了该模块能够达到系统总体设计的要求。

关键词 MIPS 系统级芯片 总线 FIFO 中断

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MIPS32指令集兼容的CPU模拟器设计 被引量：6

10

作者 薛勃 周玉洁 《计算机工程》 CAS CSCD 北大核心 2009年第1期263-265,共3页

描述一个与MIPS32指令集兼容的CPU模拟器设计方案,该方案用C语言描述处理器的硬件行为,模拟CPU指令的执行过程,实现MIPS32除浮点运算指令以外的所有指令,有大小可配的主存储器、指令和数据统一的二相关高速缓存Cache,内置类型可配的分... 描述一个与MIPS32指令集兼容的CPU模拟器设计方案,该方案用C语言描述处理器的硬件行为,模拟CPU指令的执行过程,实现MIPS32除浮点运算指令以外的所有指令,有大小可配的主存储器、指令和数据统一的二相关高速缓存Cache,内置类型可配的分支预测器和ELF文件解析器,并给出设计的应用实例。 展开更多

关键词 MIPS处理器 模拟器 高速缓存 分支预测

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高性能DSP中断处理技术 被引量：5

11

作者 许新任 陈进 《计算机工程》 CAS CSCD 北大核心 2004年第19期176-177,191,共3页

分析了DSP中断控制和中断服务机制,设计了4级中断优先级系统,提供了硬件、软件异常,硬件、软件中断,DMA中断,片上、片外中断等多种中断类型;提供电平、边沿触发的选择。实现了快速中断A、快速中断B和普通中断3种服务类型。整个中断系统... 分析了DSP中断控制和中断服务机制,设计了4级中断优先级系统,提供了硬件、软件异常,硬件、软件中断,DMA中断,片上、片外中断等多种中断类型;提供电平、边沿触发的选择。实现了快速中断A、快速中断B和普通中断3种服务类型。整个中断系统较好地满足了DSP用作数字信号处理时快速高效的特点。 展开更多

关键词 中断控制 中断请求 快速中断 中断延迟

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一种32位全定制高速乘法器设计 被引量：2

12

作者 王田 陈健 付宇卓 《小型微型计算机系统》 CSCD 北大核心 2005年第2期307-309,共3页

对乘法器的多种实现方式作了综合比较 ,分析并实现了一种 32位全定制高速乘法器 ,该乘法器与 Synopsys DesignWare相应的乘法器相比速度快 14 %左右 .最后对 ASIC设计者选择不同用途的乘法器提供了相应的准则 .

关键词 乘法器 全定制 BOOTH编码 WALLACE TREE

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基于FPGA的PCMCIA加密网卡 被引量：3

13

作者 钟雄光 戎蒙恬 陈赟 《计算机工程》 CAS CSCD 北大核心 2005年第13期179-180,共2页

介绍了采用Altera公司的FPGA芯片实现的基于PCMCIA接口的加密网卡。核心模块用VHDL描述,在QuartusII软件下进行综合和仿真,并在EP20K200EFPGA目标板上进行了成功的验证。这种在单片上实现PCMCIA接口控制和数据加密的高集成方案具有较好... 介绍了采用Altera公司的FPGA芯片实现的基于PCMCIA接口的加密网卡。核心模块用VHDL描述,在QuartusII软件下进行综合和仿真,并在EP20K200EFPGA目标板上进行了成功的验证。这种在单片上实现PCMCIA接口控制和数据加密的高集成方案具有较好的安全性。 展开更多

关键词 个人计算机存储卡国际协会 FPGA 加密网卡

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基于FPGA的AVS环路滤波器设计与实现 被引量：5

14

作者 黄中华 支琤 《计算机工程》 CAS CSCD 北大核心 2007年第6期222-224,共3页

根据AVS音视频编码标准中提出的环路滤波算法设计了一个高效的环路滤波器。通过适当地增加片上数据存储空间,使得整个环路滤波的过程占用的带宽资源最小。该滤波器经过仿真验证,对一个完整的4:2:0格式的宏块数据进行环路滤波仅需293个... 根据AVS音视频编码标准中提出的环路滤波算法设计了一个高效的环路滤波器。通过适当地增加片上数据存储空间,使得整个环路滤波的过程占用的带宽资源最小。该滤波器经过仿真验证,对一个完整的4:2:0格式的宏块数据进行环路滤波仅需293个时钟周期。可以被用于1920×1080高清图像的AVS解码芯片中。 展开更多

关键词 AVS 环路滤波 去块效应

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32位高性能DMA控制器的VLSI实现 被引量：2

15

作者 全正元 戎蒙恬 刘文江 《计算机工程》 CAS CSCD 北大核心 2007年第9期235-237,共3页

高性能的DMA控制器是诸如高端微处理器和媒体处理器等SoC片上通信架构的重要组成部分。该文提出了面向AMBA总线的高性能32位DMA控制器的VLSI实现,引入了双时钟域、同步复位门控时钟和握手信号路由阵列的设计。在SMIC0.18μm的工艺下,可... 高性能的DMA控制器是诸如高端微处理器和媒体处理器等SoC片上通信架构的重要组成部分。该文提出了面向AMBA总线的高性能32位DMA控制器的VLSI实现,引入了双时钟域、同步复位门控时钟和握手信号路由阵列的设计。在SMIC0.18μm的工艺下,可以达到180MHz的工作频率。应用于32位RISC处理器ALP3310中,与使用软件传输相比,AHB总线和APB总线的数据传输速度分别提高80.0%和26.7%。 展开更多

关键词 DMA控制器 AMBA总线 SOC

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千兆以太网CRC的算法与VLSI设计与实现 被引量：1

16

作者 高继业 戎蒙恬 邹定楷 《计算机工程》 EI CAS CSCD 北大核心 2005年第3期215-217,共3页

介绍了CRC的数学原理及具体在以太网中的算法与VLSI实现方式。以CRC-8为例,介绍了串行结构实现及并行输入的推导,并给出了Verilog HDL编程及相关技术。串行移位结构的数据吞吐量无法满足千兆以太网1Gbps的要求,设计了一种8bits的并行VLS... 介绍了CRC的数学原理及具体在以太网中的算法与VLSI实现方式。以CRC-8为例,介绍了串行结构实现及并行输入的推导,并给出了Verilog HDL编程及相关技术。串行移位结构的数据吞吐量无法满足千兆以太网1Gbps的要求,设计了一种8bits的并行VLSI结构,用0.25μm CMOS单元库综合后得出数据吞吐量达到2Gbps,完全满足要求。 展开更多

关键词 千兆以太网 CRC 并行 算法 数据吞吐量 VLSI设计 串行 VLSI结构 单元库 CMOS

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千兆位以太网物理编码子层编码算法与实现 被引量：1

17

作者 王佳梁 戎蒙恬 +1 位作者 诸悦 夏琦 《计算机工程》 EI CAS CSCD 北大核心 2005年第11期115-116,159,共3页

为满足千兆位以太网1000Base-T在5类线上传输1Gbps数据的要求,介绍了千兆以太网收发器物理编码子层的编码算法,并给出了ASIC实现方案。使用递归式系统卷积码和网格编码,可以达到约6dB的编码增益。用Verilog语言完成发送模块设计,仿真结... 为满足千兆位以太网1000Base-T在5类线上传输1Gbps数据的要求,介绍了千兆以太网收发器物理编码子层的编码算法,并给出了ASIC实现方案。使用递归式系统卷积码和网格编码,可以达到约6dB的编码增益。用Verilog语言完成发送模块设计,仿真结果表明该设计完全符合802.3ab协议规范,能够满足千兆位以太网的传输要求。 展开更多

关键词 千兆位以太网 物理编码子层 递归式系统卷积码 网格编码

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32位时延无关异步流水线乘法器设计 被引量：2

18

作者 钟雄光 戎蒙恬 《上海交通大学学报》 EI CAS CSCD 北大核心 2004年第11期1851-1853,1856,共4页

提出采用Heaviside函数建立可精确描述门限门行为的数学模型,该数学模型可描述门限门的置位、复位行为.针对异步单轨逻辑健壮性差的缺点,基于零协议逻辑(NullConventionLogic)设计了双轨逻辑的时延无关32位异步流水线乘法器.乘法器基于... 提出采用Heaviside函数建立可精确描述门限门行为的数学模型,该数学模型可描述门限门的置位、复位行为.针对异步单轨逻辑健壮性差的缺点,基于零协议逻辑(NullConventionLogic)设计了双轨逻辑的时延无关32位异步流水线乘法器.乘法器基于改进的Booth编码和Wallace树.该乘法器与采取同样结构的同步乘法器的仿真结果表明,前者的性能提高了近4倍. 展开更多

关键词 异步电路 零协议逻辑 流水线乘法器

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基于MOF编码的椭圆曲线点乘方案 被引量：1

19

作者 徐茜 陈诚 《计算机工程》 CAS CSCD 北大核心 2010年第13期143-145,共3页

分析传统椭圆曲线点乘算法的优劣,介绍标量动态编码方法——MOF编码,在此基础上提出并实现一种椭圆曲线点乘方案。对改进前后IP的面积和性能2个方面进行比较,结果表明,该方案在不影响ECC IP性能的前提下能有效节省其面积,适合在智能卡... 分析传统椭圆曲线点乘算法的优劣,介绍标量动态编码方法——MOF编码,在此基础上提出并实现一种椭圆曲线点乘方案。对改进前后IP的面积和性能2个方面进行比较,结果表明,该方案在不影响ECC IP性能的前提下能有效节省其面积,适合在智能卡等资源受限的移动设备中应用。 展开更多

关键词 椭圆曲线 MOF编码 点乘方案 智能卡

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AC'97音频控制器的多时钟域设计方法

20

作者 胡嘉圣 郭炜 罗伟毅 《计算机工程》 EI CAS CSCD 北大核心 2005年第3期60-63,共4页

根据同步装置基本概念和AC'97音频协议,着重强调从系统设计角度优化同步装置的方法和正确的电路综合方法,以此构成AC'97音频控制器的多时钟域设计方法。结果分析表明同步装置在略微增加电路面积的同时,有效降低了同步错误概率,... 根据同步装置基本概念和AC'97音频协议,着重强调从系统设计角度优化同步装置的方法和正确的电路综合方法,以此构成AC'97音频控制器的多时钟域设计方法。结果分析表明同步装置在略微增加电路面积的同时,有效降低了同步错误概率,提高了AC'97音频控制器的性能。 展开更多

关键词 AC’97 音频控制器 时钟 电路综合 协议 同步 设计方法 错误概率 系统设计 性能

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