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一种基于40nm CMOS工艺的电流舵DAC IP核设计 被引量:3
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作者 王东 陈岚 冯燕 《微电子学与计算机》 CSCD 北大核心 2017年第2期25-29,共5页
基于SMIC 40nm CMOS工艺,设计了一种10位100MS/s DAC IP核.该DAC IP核采用6+4分段式电流舵结构,1.1V/2.5V双电源供电,满量程输出电流为20mA.完成了DAC IP核电路和版图的原型设计,提取了物理模型与时序模型,组成基本的数据交付项.对该DAC... 基于SMIC 40nm CMOS工艺,设计了一种10位100MS/s DAC IP核.该DAC IP核采用6+4分段式电流舵结构,1.1V/2.5V双电源供电,满量程输出电流为20mA.完成了DAC IP核电路和版图的原型设计,提取了物理模型与时序模型,组成基本的数据交付项.对该DAC IP核进行了仿真分析,给出了流片后的测试结果. 展开更多
关键词 数模转换器 分段式电流舵 IP核
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军用IP核标准体系关键共性技术分析 被引量:2
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作者 王东 陈岚 冯燕 《电子技术应用》 北大核心 2016年第9期24-28,共5页
基于军用IP核标准体系现状,结合现有标准对于军用IP核的适用性,针对军事应用的需求和特点,研究分析了军用IP核的交付项要求、质量评测、测试方法学、可靠性试验和检验等关键共性技术,为制定和完善军用IP核标准体系提供参考建议和技术指导。
关键词 军用IP核 标准体系 共性技术
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一种低功耗时钟树的设计和优化方法 被引量:5
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作者 朱佳琪 陈岚 王海永 《微电子学与计算机》 2021年第10期85-90,共6页
本文研究纳米工艺下低功耗时钟树的设计和优化方法.以时钟信号的转换时间和负载电容作为实现时钟树低功耗的两个设计变量,基于时钟网络的寄生电阻-电容模型,分析出金属布线宽度减小、间距变大可以降低时钟树功耗,但是,该方法会对时钟树... 本文研究纳米工艺下低功耗时钟树的设计和优化方法.以时钟信号的转换时间和负载电容作为实现时钟树低功耗的两个设计变量,基于时钟网络的寄生电阻-电容模型,分析出金属布线宽度减小、间距变大可以降低时钟树功耗,但是,该方法会对时钟树的时序产生影响.于是,本文提出一种以低功耗和低时序违例为联合约束条件的时钟树设计和优化方法,并给出了低功耗时钟树综合设计流程.实验证明,与一般经验设计相比,本文提出的时钟树设计和优化方法在典型情况下可以降低时钟网络的动态功耗10.3%,总的时序违例降低7.07%. 展开更多
关键词 动态功耗 负载电容 转换时间 时钟布线 设计流程
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基于公式递推法的可变计算位宽的循环冗余校验设计与实现 被引量:8
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作者 陈容 陈岚 WAHLA Arfan Haider 《电子与信息学报》 EI CSCD 北大核心 2020年第5期1261-1267,共7页
循环冗余校验(CRC)与信道编码的级联使用,可以有效改善译码的收敛特性。在新一代无线通信系统,如5G中,码长和码率都具有多样性。为了提高编译码分段长度可变的级联系统的译码效率,该文提出一种可变计算位宽的CRC并行算法。该算法在现有... 循环冗余校验(CRC)与信道编码的级联使用,可以有效改善译码的收敛特性。在新一代无线通信系统,如5G中,码长和码率都具有多样性。为了提高编译码分段长度可变的级联系统的译码效率,该文提出一种可变计算位宽的CRC并行算法。该算法在现有固定位宽并行算法的基础上,合并公式递推法中反馈数据与输入数据的并行计算,实现了一种高并行度的CRC校验架构,并且支持可变位宽的CRC计算。与现有的并行算法相比,合并算法节省了电路资源的开销,在位宽固定时,资源节约效果明显,同时在反馈时延上也有将近50%的优化;在位宽可变时,电路资源的使用情况也有相应的优化。 展开更多
关键词 循环冗余校验 并行算法 公式递推法
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LOD效应和WPE效应在纳米工艺PDK中的应用
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作者 周欢欢 陈岚 +2 位作者 尹明会 王晨 张卫华 《微电子学与计算机》 北大核心 2019年第2期1-5,共5页
本文研究了自主开发的40nm工艺PDK中的LOD效应和WPE效应.LOD参数SA和WPE参数left影响CMOS器件特性,尤其饱和电流I_(dsat)和阈值电压VTH.随着SA减小,NMOS的I_(dsat)减小4.25%而VTH增大2.79%;PMOS的电参数与SA关系曲线与NMOS的一致,但比N... 本文研究了自主开发的40nm工艺PDK中的LOD效应和WPE效应.LOD参数SA和WPE参数left影响CMOS器件特性,尤其饱和电流I_(dsat)和阈值电压VTH.随着SA减小,NMOS的I_(dsat)减小4.25%而VTH增大2.79%;PMOS的电参数与SA关系曲线与NMOS的一致,但比NMOS趋势要强,I_(dsat)减小8.32%而VTH增大6.78%;并解释了LOD效应的物理机制.随着left的减小,NMOS的I_(dsat)减小9.03%而VTH增大12.5%;PMOS的电参数与left关系曲线比NMOS的要弱,I_(dsat)减小8.50%而VTH增大4.61%,并提出了WPE效应下器件电参数变化原因.在纳米工艺PDK中,LOD效应和WPE效应的准确应用可以更好地模拟器件性能并改善电路设计精度. 展开更多
关键词 PDK LOD WPE 纳米工艺
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基于离散几何法的多物理场耦合问题研究 被引量:3
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作者 高展 徐小宇 +2 位作者 闫帅 吕鹏飞 任卓翔 《电子设计工程》 2017年第1期166-170,共5页
Tonti图揭示并高度概括了多种物理场所共同具备的数学结构,为求解不同物理场提供相同的拓扑算子以构建刚度矩阵。离散几何法是基于离散空间中互为正交的原始和对偶网格,利用其几何尺度直接导出本构矩阵,从而快速建立代数方程的数值解法... Tonti图揭示并高度概括了多种物理场所共同具备的数学结构,为求解不同物理场提供相同的拓扑算子以构建刚度矩阵。离散几何法是基于离散空间中互为正交的原始和对偶网格,利用其几何尺度直接导出本构矩阵,从而快速建立代数方程的数值解法,它的形式结构直观简单,便于计算。本文根据Tonti图将离散几何法应用于三维集成电路中TSV阵列的电-热-力场的耦合问题,并将计算结果与基于有限元法的商业软件COMSOL对比。实验结果表明:在多物理耦合问题上,离散几何法精度可靠,从而有望应用推广至电子设计自动化工具之中。 展开更多
关键词 离散几何法 电-热-力耦合问题 多物理 Tonti图 电子设计自动化
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基于机器学习的版图热点检测并行算法 被引量:2
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作者 李仲 吴玉平 +1 位作者 陈岚 张学连 《微电子学与计算机》 北大核心 2019年第1期27-31,共5页
针对基于机器学习的版图热点训练过程中降维算法耗时长和大多数训练算法没有利用多核资源的问题,分别提出了基于MPI的PCA并行降维算法和基于OpenMP的AdaBoost并行训练算法.首先采用QR分解优化奇异值求解特征矩阵,再结合MPI实现PCA的并... 针对基于机器学习的版图热点训练过程中降维算法耗时长和大多数训练算法没有利用多核资源的问题,分别提出了基于MPI的PCA并行降维算法和基于OpenMP的AdaBoost并行训练算法.首先采用QR分解优化奇异值求解特征矩阵,再结合MPI实现PCA的并行降维计算,最后将降维后的数据利用多核CPU进行训练,达到减小训练时间的目的.实验结果表明,PCA并行降维算法加速比达4.7倍,AdaBoost并行训练算法加速比达4.9倍,验证了并行化的可行性. 展开更多
关键词 版图热点 PCA ADABOOST 并行计算
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基于LSTM的CPU资源使用情况预测算法的研究 被引量:5
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作者 樊文杰 陈岚 张贺 《电子设计工程》 2021年第8期23-28,共6页
主要研究使用机器学习算法长短期记忆网络(LSTM)实现对CPU资源使用情况的准确预测。LSTM模型能够通过非线性计算提取出CPU资源使用特征,这样可以处理CPU资源使用率不平稳带来的预测难题。同时,在传统LSTM模型上做了优化,在激活函数方面... 主要研究使用机器学习算法长短期记忆网络(LSTM)实现对CPU资源使用情况的准确预测。LSTM模型能够通过非线性计算提取出CPU资源使用特征,这样可以处理CPU资源使用率不平稳带来的预测难题。同时,在传统LSTM模型上做了优化,在激活函数方面,使用非饱和激活函数ReLU函数代替饱和激活函数Tanh函数,模型的收敛速度提高20%。实验结论表明,在CPU资源使用情况的预测上,使用ReLU激活函数的LSTM模型的预测准确率较高,平均相对误差比传统LSTM模型下降13.75%。 展开更多
关键词 LSTM CPU资源 激活函数 预测
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