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The Design of I/O Subsystem in Satellite Real-Time Microkernel Operating System 被引量:1
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作者 Liu Xiaodong & Li Lianzhi (Dept. of Computer Science & Engineering, Harbin Institute of Technology, 150001, P. R. China) Qian Chunlai(Beijiing Institute of Radio Measurement, 100854, P. R. China) 《Journal of Systems Engineering and Electronics》 SCIE EI CSCD 1998年第3期77-81,共5页
One of the most important features of modern minor satellites is to realize autonomous moving. The performance of the satellite autonomous computer operating system acting as the control center is utmost important. Th... One of the most important features of modern minor satellites is to realize autonomous moving. The performance of the satellite autonomous computer operating system acting as the control center is utmost important. The recent trend in operating system development is adopting microkernel architecture which holds such advantages as microminiaturization, modularity, portability and extendibility. The performance of I/O subsystem is currently receiving considerable research attention. Object-orientation offers an approach to application development in which software system can be constructed by composing and refining the pre-designed plug-compatible software components.It also starts with some basic notions fairly well accepted in computer science, namely encapsulation and reuse. In this paper, a new object-oriented real-time I/O subsystem model has been designed.In this model, the traditional I/O subsystem framework is discarded and a stream mechanism based on the object-oriented concept is introduced. In addition, the I/O requests are classified according to their time emergency to obtain real-time performance. So, this model meets such satelliteperformance requirements as reliability, flexibility, portability and real-time performance. 展开更多
关键词 Satellite operating system I/O subsystem OBJECT-ORIENTED real-time
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High performance reconfigurable hardware system for real-time image processing
2
作者 赵广州 张天序 +2 位作者 王岳环 曹治国 左峥嵘 《Journal of Systems Engineering and Electronics》 SCIE EI CSCD 2005年第3期502-509,共8页
A novel reconfigurable hardware system which uses both muhi-DSP and FPGA to attain high performance and real-time image processing are presented. The system structure and working principle of mainly processing multi-B... A novel reconfigurable hardware system which uses both muhi-DSP and FPGA to attain high performance and real-time image processing are presented. The system structure and working principle of mainly processing multi-BSP board, extended multi-DSP board are analysed. The outstanding advantage is that the communication among different board components of this system is supported by high speed link ports & serial ports for increasing the system performance and computational power. Then the implementation of embedded real-time operating systems (RTOS) by us is discussed in detail. In this system, we adopt two kinds of parallel structures controlled by RTOS for parallel processing of algorithms. The experimental results show that exploitive period of the system is short, and maintenance convenient. Thus it is suitable for real-time image processing and can get satisfactory effect of image recognition. 展开更多
关键词 MULTI-DSP fidd programmable gate arrays real-time image processing real time operating systems parallel structure.
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职业教育新基建“五金”:结构逻辑、运行机理与生成路径 被引量:3
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作者 谭多宁 李同同 邓荣 《成人教育》 北大核心 2025年第4期71-77,共7页
职业教育正在经历从“层次”走向“类型”的全面深化改革,加强职业教育新基建“五金”建设,全面提升职业教育新基建“五金”建设质量势在必行。从结构功能主义理论来看,职业教育新基建“五金”建设是一个整体系统,其系统推进需要建构产... 职业教育正在经历从“层次”走向“类型”的全面深化改革,加强职业教育新基建“五金”建设,全面提升职业教育新基建“五金”建设质量势在必行。从结构功能主义理论来看,职业教育新基建“五金”建设是一个整体系统,其系统推进需要建构产业升级与学生发展双向耦合的发展根坻、形塑新质生产力生成环境的高质量“品相”、建成以高效率为追寻的资源优化配置机制、塑造内部“制度—权力—技术”运行的实践模式。从运行机理来看,职业教育新基建“五金”在建设过程中表现出相互形塑的整体演进促“五金”整体适应、共同目标的现实导向促“五金”系统调适、竞合关系的交织应用促“五金”资源配置、要素结构的持续作用促“五金”运行流畅的内在逻辑。基于此,职业教育新基建“五金”的建设路径为形塑政府主导、学校主体、企业主动的主体关系,构建制度供给、资源支持、技术支撑的运行机制,形成整体形塑、重心调适、重点突破的组织策略,搭建系统规划、组织协同、要素优化的保障架构。 展开更多
关键词 职业教育新基建 五金 结构逻辑 运行机理 生成路径
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基于Zynq的卷积神经网络加速器设计
4
作者 孟凡开 张峰 +1 位作者 李淼 张多利 《合肥工业大学学报(自然科学版)》 北大核心 2025年第7期904-909,共6页
针对卷积神经网络(convolutional neural network,CNN)嵌入式部署资源开销大、运行速度慢等问题,文章提出一种以Tiny-YOLOv3作为算法模型的CNN硬件加速器。首先,基于Tiny-YOLOv3网络各层的特性和要求设计CNN加速器实现方案,将权重系数... 针对卷积神经网络(convolutional neural network,CNN)嵌入式部署资源开销大、运行速度慢等问题,文章提出一种以Tiny-YOLOv3作为算法模型的CNN硬件加速器。首先,基于Tiny-YOLOv3网络各层的特性和要求设计CNN加速器实现方案,将权重系数按位分割,面向单bit权重设计卷积加速器,通过逐位实施达到处理速度和识别率的高效平衡;然后,采用查表选择法实现卷积算子的乘加运算,设计一款6×3×16的三维加速器计算阵列,可单周期完成288个卷积窗口计算;最后,在Xilinx Zynq UltraScale+MPSoC系列芯片上对设计的CNN加速器进行性能测试。实验结果表明,该CNN加速器在200 MHz频率下具有518.4 GOPS的算力,比现有的解决方案性能提高了约63%。 展开更多
关键词 卷积神经网络(CNN) Tiny-YOLOv3网络模型 硬件加速 流水阵列 并行运算
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基于访存图案变形的CGRA存储划分优化
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作者 潘德财 牟迪 +1 位作者 尚家兴 刘大江 《计算机研究与发展》 北大核心 2025年第4期1003-1016,共14页
由于兼具高灵活性和高能效的特征,粗粒度可重构阵列(coarse-grained reconfigurable array,CGRA)是一种具有潜力的领域定制加速器架构.为了利用多bank存储器的访问并行性,通常会在CGRA中引入存储器划分.然而,在CGRA上进行存储划分工作... 由于兼具高灵活性和高能效的特征,粗粒度可重构阵列(coarse-grained reconfigurable array,CGRA)是一种具有潜力的领域定制加速器架构.为了利用多bank存储器的访问并行性,通常会在CGRA中引入存储器划分.然而,在CGRA上进行存储划分工作要么以昂贵的寻址开销为代价实现最佳分区解决方案,要么以更多的存储bank消耗为代价来减少面积和功耗开销.为此,提出了一种通过访存图案变形来实现面向CGRA的存储划分方法.通过对包含多维数组的应用进行存储划分和算子调度协同优化,形成了存储划分友好的访存图案,从而可以用全“1”超平面对其进行存储划分,进而优化了划分结果并减少了访存地址计算开销.基于全“1”超平面的划分策略,还提出了一种可精简地址生成单元的高能效CGRA架构.实验结果表明,与最先进的方法相比,该方法可以实现1.25倍的能效提升. 展开更多
关键词 粗粒度可重构阵列 存储划分 软硬件联合设计 算子调度 访存图案
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A satellite observation data considered train positioning optimization method with RTK
6
作者 YUCHI Zhen-xin LI Wei +3 位作者 GAO Shi-juan CHEN Chun-yang HUANG Su-su JIANG Ji-xiong 《Journal of Central South University》 2025年第4期1548-1568,共21页
In this paper,a novel train positioning method considering satellite raw observation data was proposed,which aims to promote train positioning performance from an innovative perspective of the train satellite-based po... In this paper,a novel train positioning method considering satellite raw observation data was proposed,which aims to promote train positioning performance from an innovative perspective of the train satellite-based positioning error sources.The method focused on overcoming the abnormal observations in satellite observation data caused by railway environment rather than the positioning results.Specifically,the relative positioning experimental platform was built and the zero-baseline method was firstly employed to evaluate the carrier phase data quality,and then,GNSS combined observation models were adopted to construct the detection values,which were applied to judge abnormal-data through the dual-frequency observations.Further,ambiguity fixing optimization was investigated based on observation data selection in partly-blocked environments.The results show that the proposed method can effectively detect and address abnormal observations and improve positioning stability.Cycle slips and gross errors can be detected and identified based on dual-frequency global navigation satellite system data.After adopting the data selection strategy,the ambiguity fixing percentage was improved by 29.2%,and the standard deviation in the East,North,and Up components was enhanced by 12.7%,7.4%,and 12.5%,respectively.The proposed method can provide references for train positioning performance optimization in railway environments from the perspective of positioning error sources. 展开更多
关键词 train operation control system train positioning satellite positioning abnormal-data detection real-time kinematic positioning
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制导控制系统半实物仿真总体方案设计及集成联试
7
作者 常晓飞 焦佳玥 +2 位作者 陈康 符文星 闫杰 《系统仿真学报》 CAS CSCD 北大核心 2024年第1期83-96,共14页
半实物仿真作为一个大型分布式仿真系统,其总体方案的设计优劣和集成联试的是否顺利,直接影响了系统性能指标的表现和建设目标的实现。归纳总结了总体方案设计的工作内容,分析了实时性、兼容性、扩展性和安全性的性能要求;给出了包括功... 半实物仿真作为一个大型分布式仿真系统,其总体方案的设计优劣和集成联试的是否顺利,直接影响了系统性能指标的表现和建设目标的实现。归纳总结了总体方案设计的工作内容,分析了实时性、兼容性、扩展性和安全性的性能要求;给出了包括功能层次、运行机制和结构组成在内的典型半实物仿真系统总体方案;概括了仿真系统的集成联试内容,总结了典型系统的集成联试步骤,给出了系统验收测试的内容和系统可信度评估方法。 展开更多
关键词 半实物仿真 总体方案 集成联试 运行机制
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多泵切换对数字液压传动风力机工作特性影响的分析
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作者 刘增光 张本国 +3 位作者 岳大灵 李林飞 苏利强 任禄 《液压与气动》 北大核心 2024年第2期85-92,共8页
多泵数字液压传动风力机可根据风速大小使相应排量液压泵参与工作,使液压风力机在整个工作风速范围内始终保持高效。但不同排量液压泵参与工作的切换会造成风力机液压传动系统流量发生突变并产生压力冲击,影响风力机工作特性和风轮对风... 多泵数字液压传动风力机可根据风速大小使相应排量液压泵参与工作,使液压风力机在整个工作风速范围内始终保持高效。但不同排量液压泵参与工作的切换会造成风力机液压传动系统流量发生突变并产生压力冲击,影响风力机工作特性和风轮对风能的吸收。在分析多泵数字液压传动风力机工作原理的基础上,对5 MW级多泵数字液压传动风力机的方案进行设计和AMESim仿真建模;进行恒定风速和变风速条件下液压泵工作切换的仿真研究,得到多泵切换时液压风力机的风能利用系数、液压系统流量、压力等工作特性的变化规律;搭建了5 kW风能能量多泵数字液压传递半实物仿真实验平台对仿真结果进行实验验证;研究结果为多泵数字液压传动风力机风能高效利用和稳定运行提供理论依据和技术参考。 展开更多
关键词 液压风力机 数字液压传动 多泵切换 半实物仿真 工作特性
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物理不可克隆函数-多位并行异或运算一体化设计技术 被引量:1
9
作者 李刚 周俊杰 +2 位作者 汪鹏君 张茂林 郭宇锋 《电子与信息学报》 EI CAS CSCD 北大核心 2024年第11期4101-4111,共11页
物理不可克隆函数(PUF)和异或(XOR)运算在信息安全领域均发挥着重要作用。为突破PUF与逻辑运算之间的功能壁垒,通过对PUF工作机理和差分串联电压开关逻辑(DCVSL)的研究,该文提出一种基于DCVSL异或门级联单元随机工艺偏差的PUF和多位并... 物理不可克隆函数(PUF)和异或(XOR)运算在信息安全领域均发挥着重要作用。为突破PUF与逻辑运算之间的功能壁垒,通过对PUF工作机理和差分串联电压开关逻辑(DCVSL)的研究,该文提出一种基于DCVSL异或门级联单元随机工艺偏差的PUF和多位并行异或运算电路一体化设计方案。通过在DCVSL异或门差分输出端增加预充电管并在对地端设置管控门,可实现PUF特征信息提取、异或/同或(XOR/XNOR)运算和功率控制3种工作模式自由切换。此外,针对PUF响应稳定性问题,提出极端工作点和黄金工作点共同参与标记的不稳定位混合筛选技术。基于TSMC 65 nm工艺,对输入位宽为10位的电路进行全定制版图设计,面积为38.76 μm^(2)。实验结果表明,PUF模式下,可产生1024位输出响应,混合筛选后可获得超过512位稳定的密钥,且具有良好的随机性和唯一性;运算模式下,可同时实现10位并行异或和同或运算,功耗和延时分别为2.67 μW和593.52 ps。功控模式下,待机功耗仅70.5 nW。所提方法为突破PUF“功能墙”提供了一种新的设计思路。 展开更多
关键词 物理不可克隆函数 逻辑运算 一体化设计 稳定性筛选 硬件安全
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风火打捆送出系统稳定特性研究和运行策略优化 被引量:2
10
作者 朱益华 李成翔 +3 位作者 罗超 曾冠铭 武明康 余佳微 《南方电网技术》 CSCD 北大核心 2024年第3期26-33,共8页
为解决粤西海上风电集群与火电打捆送出的同步稳定问题,首先研究了风火打捆送出系统的同步稳定特性和影响因素,然后提出了提高风火打捆送出系统风电渗透率和同步稳定特性好的风电机组优先发电的运行方式优化策略。最后构建了风电场集群... 为解决粤西海上风电集群与火电打捆送出的同步稳定问题,首先研究了风火打捆送出系统的同步稳定特性和影响因素,然后提出了提高风火打捆送出系统风电渗透率和同步稳定特性好的风电机组优先发电的运行方式优化策略。最后构建了风电场集群整体硬件在环接入的实时仿真系统进行验证,仿真结果表明所提出的同步稳定性提升策略可以提高风火打捆送出系统稳定极限,有力提升了风电并网消纳率和电网安全稳定水平。 展开更多
关键词 风火打捆 稳定极限 同步稳定 硬件在环 运行策略
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面向物联网领域的低成本ECC密码处理器设计 被引量:1
11
作者 马敬万 曲英杰 《现代电子技术》 北大核心 2024年第18期95-100,共6页
为了保障物联网设备的隐私和安全,同时更好地满足其资源受限的特性,采用椭圆曲线密码(ECC)算法方案,通过优化底层算法和电路结构,设计了基于加法器的低成本架构的点乘硬件电路。采用硬件复用技术来减少资源消耗,每个模运算电路只用一个... 为了保障物联网设备的隐私和安全,同时更好地满足其资源受限的特性,采用椭圆曲线密码(ECC)算法方案,通过优化底层算法和电路结构,设计了基于加法器的低成本架构的点乘硬件电路。采用硬件复用技术来减少资源消耗,每个模运算电路只用一个超前进位加法器;优化模运算算子调度,改进电路结构,点运算只使用两个模加减模块、一个模逆模块和一个模乘模块设计实现。在Xilinx公司XCZU3CG-SFVC784-1-E的FPGA平台上进行分析,该点乘电路共使用了8927个CLB LUTs,7789个CLB Registers,电路总功耗为0.371W,工作频率可达247.3 MHz,对比其他架构,处理器硬件资源节省了39.10%~72.44%。 展开更多
关键词 物联网 椭圆曲线密码 密码处理器 模运算 硬件复用 FPGA
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高能效低延迟的BNN硬件加速器设计
12
作者 周培培 杜高明 +1 位作者 李桢旻 王晓蕾 《合肥工业大学学报(自然科学版)》 CAS 北大核心 2024年第12期1655-1661,共7页
针对二值化神经网络(binary neural network,BNN)硬件设计过程中大量0值引发计算量增加以及BNN中同一权值数据与同一特征图数据多次重复运算导致计算周期和计算功耗增加的问题,文章分别提出全0值跳过方法和预计算结果缓存方法,有效减少... 针对二值化神经网络(binary neural network,BNN)硬件设计过程中大量0值引发计算量增加以及BNN中同一权值数据与同一特征图数据多次重复运算导致计算周期和计算功耗增加的问题,文章分别提出全0值跳过方法和预计算结果缓存方法,有效减少网络的计算量、计算周期和计算功耗;并基于现场可编程门阵列(field programmable gate array,FPGA)设计一款BNN硬件加速器,即手写数字识别系统。实验结果表明,使用所提出的全0值跳过方法和预计算结果缓存方法后,在100 MHz的频率下,设计的加速器平均能效可达1.81 TOPs/W,相较于其他BNN加速器,提升了1.27~4.34倍。 展开更多
关键词 二值化神经网络(BNN) 权值共享 重复运算 现场可编程门阵列(FPGA) 硬件加速器
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新型电能质量监测系统的设计 被引量:27
13
作者 欧阳森 宋政湘 +3 位作者 王建华 段成刚 王克星 陈德桂 《电工电能新技术》 CSCD 2003年第1期43-47,共5页
本文设计了一个用于低压配电系统的新型电能质量监测系统。该系统的设计包含现场设备、设备的操作系统以及数据发布系统三部分。基于双CPU设计的现场设备保证了系统的实时工作能力;采用嵌入式实时多任务操作系统作为现场设备的操作系统... 本文设计了一个用于低压配电系统的新型电能质量监测系统。该系统的设计包含现场设备、设备的操作系统以及数据发布系统三部分。基于双CPU设计的现场设备保证了系统的实时工作能力;采用嵌入式实时多任务操作系统作为现场设备的操作系统,不仅能提高其工作稳定性和功能扩展能力,还从根本上改变了以往硬件系统的软件设计过程。基于Web技术的数据发布系统提高了系统的数据处理和发布能力;由于该系统采用IEEE标准构建数据格式,其数据兼容性较好,而且扩展能力较强。 展开更多
关键词 电能质量监测系统 设计 实时操作系统 硬件设计 互联网 电力系统 低压配电系统 PC机
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软PLC运行系统的硬件结构设计与实现 被引量:17
14
作者 王新华 周峰 +1 位作者 李剑锋 肖峰 《北京工业大学学报》 EI CAS CSCD 北大核心 2006年第8期745-749,共5页
为了配合在PC机上运行的软PLC编辑开发系统,使PC机完成相应的控制功能,研究和设计了软PLC运行系统.论文简述了软PLC的体系结构及运行系统的功能,详细介绍了软PLC运行系统的硬件结构和开发过程,给出了硬件系统的PCB电路板图.在设计过... 为了配合在PC机上运行的软PLC编辑开发系统,使PC机完成相应的控制功能,研究和设计了软PLC运行系统.论文简述了软PLC的体系结构及运行系统的功能,详细介绍了软PLC运行系统的硬件结构和开发过程,给出了硬件系统的PCB电路板图.在设计过程中对整个电路采取了电磁兼容性处理,减小了信号间及外部干扰源的干扰.实验表明,设计的下位机能很好地实现通信与控制功能. 展开更多
关键词 PLC 运行系统 硬件 模块 设计
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嵌入式实时操作系统移植技术的研究与应用 被引量:14
15
作者 赵星星 罗克露 +2 位作者 张军 邓勇 保云 《计算机工程》 CAS CSCD 北大核心 2007年第17期90-92,95,共4页
随着嵌入式系统在各个领域的不断发展,嵌入式操作系统的系统软件移植技术的研究已成为嵌入式开发中的一个重要问题。该文研究了嵌入式操作系统在不同平台移植的理论与技术,提出一种用层次化和模块化方法对嵌入式操作系统进行移植的一般... 随着嵌入式系统在各个领域的不断发展,嵌入式操作系统的系统软件移植技术的研究已成为嵌入式开发中的一个重要问题。该文研究了嵌入式操作系统在不同平台移植的理论与技术,提出一种用层次化和模块化方法对嵌入式操作系统进行移植的一般方案。该方案成功运用于CRTOSII移植到集成S3C2410芯片主板的项目中,实践证明了移植方案的正确性和可行性。 展开更多
关键词 实时操作系统 CRTOS 硬件相关层 层次化 模块化
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MIGPU-9多核交互式图形处理器的设计 被引量:11
16
作者 邓军勇 李涛 +8 位作者 蒋林 韩俊刚 杜慧敏 沈绪榜 黄光新 常立博 山蕊 黄虎才 马栋 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2014年第9期1468-1478,共11页
鉴于图形处理器的应用日趋广泛,多核SoC的研究日益迫切,设计了一款多核交互式图形处理器MIGPU-9及其完整的软件系统.为了兼顾编程灵活性和计算高效性,设计了具有专用指令的前端处理器FEP、支持定点/浮点运算与函数求值器的顶点染色处理... 鉴于图形处理器的应用日趋广泛,多核SoC的研究日益迫切,设计了一款多核交互式图形处理器MIGPU-9及其完整的软件系统.为了兼顾编程灵活性和计算高效性,设计了具有专用指令的前端处理器FEP、支持定点/浮点运算与函数求值器的顶点染色处理器VSP、双模式的剪裁投影处理器PCPTC,以及数个像素染色处理器PSP等共计9个微处理器核;MIGPU-9将这9个具有不同功能和不同结构的微处理器核以及各种专用加速电路以双轨握手的流水线形式集成到一块XC6VLX550T FPGA上,实现了图形处理任务在不同处理器核及专用电路上的并行计算.测试结果表明,MIGPU-9支持OpenGL2.0和DirectDraw,像素填充率最高可达40 M/s,电路规模超过527万门. 展开更多
关键词 多核染色器 图形处理器 硬件流水线 操作并行
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面向应用型本科教育的FPGA课程教学探讨 被引量:9
17
作者 王鹏 陈新武 +2 位作者 陈咏恩 黄文霞 孙秋菊 《实验技术与管理》 CAS 北大核心 2016年第3期185-188,234,共5页
结合实际的工程和教学经验,对FPGA课程的教学改革进行了有益的探索,并对教学关键点进行了整理,重点介绍如何理解FPGA和HDL语言的硬件电路特质,以及阻塞和非阻塞赋值的本质区别。在FPGA课程教学中综合采用多种措施,并特别加强对学生代码... 结合实际的工程和教学经验,对FPGA课程的教学改革进行了有益的探索,并对教学关键点进行了整理,重点介绍如何理解FPGA和HDL语言的硬件电路特质,以及阻塞和非阻塞赋值的本质区别。在FPGA课程教学中综合采用多种措施,并特别加强对学生代码风格的训练,使学生在接触课程时产生浓厚兴趣,逐步建立硬件电路思维。 展开更多
关键词 FPGA课程 硬件描述语言 并发执行 代码规范
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基于RTX和MFC的后封装平台数据采集和控制系统 被引量:26
18
作者 吴勇 熊振华 丁汉 《系统工程与电子技术》 EI CSCD 北大核心 2004年第9期1257-1261,共5页
简要回顾了实时系统的现状,通过RTX(realtimeextension)系统介绍了实时操作系统(RTOS)的概念和特点。对Windows系统和实时操作系统在实时精度方面的性能作了比较。针对实际的高速、高精度芯片后封装平台的硬件体系结构,提出了基于微型... 简要回顾了实时系统的现状,通过RTX(realtimeextension)系统介绍了实时操作系统(RTOS)的概念和特点。对Windows系统和实时操作系统在实时精度方面的性能作了比较。针对实际的高速、高精度芯片后封装平台的硬件体系结构,提出了基于微型计算机的MFC(microsoftfoundationclasses)和RTX综合软件模型,从而简捷实现了面向高速封装平台的高性能软件控制系统。实验结果表明,该采集控制系统为进一步的高性能控制提供了良好的结构框架基础。 展开更多
关键词 实时操作系统 响应延迟 实时精度 硬件抽象层
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厦门柔性直流输电工程功率突变现象及优化策略 被引量:12
19
作者 常浩 陈东 +1 位作者 吴延坤 马玉龙 《高电压技术》 EI CAS CSCD 北大核心 2016年第10期3045-3050,共6页
为解决直流控制系统异步运行对柔性直流输工程功率输出带来的严重影响,以厦门±320 kV柔性直流输电科技示范工程控制保护系统联调试验为背景,针对试验过程中系统无功功率突变的现象进行研究。在国际上首次发现并证明了柔直控制系统... 为解决直流控制系统异步运行对柔性直流输工程功率输出带来的严重影响,以厦门±320 kV柔性直流输电科技示范工程控制保护系统联调试验为背景,针对试验过程中系统无功功率突变的现象进行研究。在国际上首次发现并证明了柔直控制系统异步运行将导致工程传输功率周期性突变的问题,提出了柔直异步控制系统同步化的策略,并在工程用的阀控制系统中进行了验证。结果显示,异步运行将使换流阀调制波相位发生周期性的阶跃,直接影响换流阀和交流系统的功率交换,且功率突变的数值和系统等值阻抗特性呈负相关关系。 展开更多
关键词 柔性直流输电 系统联调 异步运行 功率突变 厦门工程
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基于FPGA/Nios-Ⅱ的矩阵运算硬件加速器设计 被引量:32
20
作者 许芳 席毅 +1 位作者 陈虹 靳伟伟 《电子测量与仪器学报》 CSCD 2011年第4期377-383,共7页
针对复杂算法中矩阵运算量大,计算复杂,耗时多,制约算法在线计算性能的问题,从硬件实现角度,研究基于FPGA/Nios-Ⅱ的矩阵运算硬件加速器设计,实现矩阵并行计算。首先根据矩阵运算的算法分析,设计了矩阵并行计算的硬件实现结构,并在Model... 针对复杂算法中矩阵运算量大,计算复杂,耗时多,制约算法在线计算性能的问题,从硬件实现角度,研究基于FPGA/Nios-Ⅱ的矩阵运算硬件加速器设计,实现矩阵并行计算。首先根据矩阵运算的算法分析,设计了矩阵并行计算的硬件实现结构,并在Modelsim中进行功能模块的仿真,然后将功能模块集成一个自定制组件,并通过Avalon总线与NiosⅡ主处理器通信,作为硬件加速器。最后在FPGA芯片中构建SoPC系统,并在Altera DE3开发板中进行矩阵实时计算测试。测试结果验证了基于FPGA/Nios-Ⅱ矩阵运算硬件加速器的正确性、可行性以及较高的计算性能。 展开更多
关键词 FPGA/Nios-Ⅱ 矩阵运算 硬件加速器 并行计算 实时测试验
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