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基于AES通信的新能源汽车监控仿真系统设计
1
作者 邹丹 《通信电源技术》 2024年第21期37-39,共3页
为提升新能源汽车监控系统的安全性与实时性,设计并实现了一种基于高级加密标准(Advanced Encryption Standard,AES)通信的监控仿真系统。系统通过车载数据管理单元采集数据,并采用AES-256算法进行加密,保障数据传输安全性。实验结果表... 为提升新能源汽车监控系统的安全性与实时性,设计并实现了一种基于高级加密标准(Advanced Encryption Standard,AES)通信的监控仿真系统。系统通过车载数据管理单元采集数据,并采用AES-256算法进行加密,保障数据传输安全性。实验结果表明,该系统在多种驾驶工况下均表现出高效的数据压缩,具有高加解密速度和低延迟,显著提升了监控系统运行的安全性和实时性。 展开更多
关键词 高级加密标准(aes)通信 新能源汽车 监控仿真 数据安全
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基于AES技术的智能配电网实时监测系统设计
2
作者 董浩波 吕稼先 《通信电源技术》 2024年第22期13-15,共3页
智能配电网的实时监测在保障电力系统稳定性和安全性方面至关重要。设计一种基于高级加密标准(Advanced Encryption Standard,AES)技术的智能配电网实时监测系统,包括数据采集与预处理、数据传输与加密、数据分析与可视化3个模块,实现... 智能配电网的实时监测在保障电力系统稳定性和安全性方面至关重要。设计一种基于高级加密标准(Advanced Encryption Standard,AES)技术的智能配电网实时监测系统,包括数据采集与预处理、数据传输与加密、数据分析与可视化3个模块,实现配电网状态的高效监控。实验表明,文章系统能够显著提升数据传输的安全性和系统的实时响应能力。 展开更多
关键词 智能配电网 高级加密标准(aes)技术 实时监测
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基于AES的S盒图像置乱算法研究 被引量:3
3
作者 肖华勇 李建辉 边笛 《西北工业大学学报》 EI CAS CSCD 北大核心 2008年第1期74-78,共5页
提出了一种基于密码学最新加密算法AES中的S盒对图像进行置乱的技术。该技术包括灰度置乱、行列置乱、块置乱及3种置乱技术的综合运用。文中对置乱的效果提出了灰度直方图、平均差异度、置乱图与原图的相关系数评价方法,并采用该方法对... 提出了一种基于密码学最新加密算法AES中的S盒对图像进行置乱的技术。该技术包括灰度置乱、行列置乱、块置乱及3种置乱技术的综合运用。文中对置乱的效果提出了灰度直方图、平均差异度、置乱图与原图的相关系数评价方法,并采用该方法对各种置乱技术进行了实验分析。从实验结果来看,达到了很好的效果。文中还对该置乱算法复杂性、置乱的安全性、周期性等进行了分析。结果表明该技术对图像置乱简单高效,安全性高。 展开更多
关键词 aes(advanced encryption standard)的S盒 相关系数 图像置乱 周期性 安全性
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基于超混沌AES图像加密算法 被引量:19
4
作者 陈在平 蔡鹏飞 董恩增 《吉林大学学报(信息科学版)》 CAS 2013年第2期158-164,共7页
为提高图像加密算法的安全性能,提出了一种改进的AES(Advanced Encryption Standard)超混沌加密算法。该算法根据超混沌系统产生的混沌序列进行排列组成S盒,对明文图像做像素值替换;利用加入外部密钥的混沌序列分别对图像像素点进行行... 为提高图像加密算法的安全性能,提出了一种改进的AES(Advanced Encryption Standard)超混沌加密算法。该算法根据超混沌系统产生的混沌序列进行排列组成S盒,对明文图像做像素值替换;利用加入外部密钥的混沌序列分别对图像像素点进行行、列位置置乱,并对加密算法的安全性能进行了深入分析。仿真实验结果表明,该算法具有更高的系统安全性,不仅具有较大的密钥空间和较高的密钥敏感性,而且能有效抵抗统计攻击和差分攻击等。 展开更多
关键词 超混沌 高级加密标准 图像加密 差分攻击
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一种可重构体系结构用于高速实现DES、3DES和AES 被引量:19
5
作者 高娜娜 李占才 王沁 《电子学报》 EI CAS CSCD 北大核心 2006年第8期1386-1390,共5页
可重构密码芯片提高了密码芯片的安全性和灵活性,具有良好的应用前景.然而目前的可重构密码芯片吞吐率均大大低于专用芯片,因此,如何提高处理速度是可重构密码芯片设计的关键问题.本文分析了常用对称密码算法DES、3DES和AES的可重构性,... 可重构密码芯片提高了密码芯片的安全性和灵活性,具有良好的应用前景.然而目前的可重构密码芯片吞吐率均大大低于专用芯片,因此,如何提高处理速度是可重构密码芯片设计的关键问题.本文分析了常用对称密码算法DES、3DES和AES的可重构性,利用流水线、并行处理和可重构技术,提出了一种可重构体系结构.基于该体系结构实现的DES、3DES和AES吞吐率在110MHz工作频率下分别可达到7Gbps、2.3Gbps和1.4Gbps.与其他同类设计相比,本文设计在处理速度上有较大优势,可以很好地应用到可重构密码芯片设计中. 展开更多
关键词 可重构体系结构 DES算法 aes算法
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防御零值功耗攻击的AES SubByte模块设计及其VLSI实现 被引量:14
6
作者 汪鹏君 郝李鹏 张跃军 《电子学报》 EI CAS CSCD 北大核心 2012年第11期2183-2187,共5页
密码器件在执行高级加密标准(Advanced Encryption Standard,AES)时常以能量消耗方式泄漏密钥信息,为有效降低其与实际处理数据之间的相关性,该文提出一种具有防御零值功耗攻击性能的AES SubByte模块设计及其VLSI实现方案.首先,在分析GF... 密码器件在执行高级加密标准(Advanced Encryption Standard,AES)时常以能量消耗方式泄漏密钥信息,为有效降低其与实际处理数据之间的相关性,该文提出一种具有防御零值功耗攻击性能的AES SubByte模块设计及其VLSI实现方案.首先,在分析GF(256)域求逆算法的基础上,采用关键模块复用的方法,提出一种更为有效的加法性屏蔽求逆算法;然后依此进一步得到一种新型的SubByte模块结构,实现在不影响对所有中间数据进行加法性屏蔽编码的同时,减少电路的芯片开销、提高电路的工作速度.实验结果表明,所设计的电路具有正确的逻辑功能.与传统Sub-Byte模块比较,该设计的最高工作频率和面积都有较大的优化. 展开更多
关键词 SubByte模块 零值功耗攻击 差分功耗攻击 加法性屏蔽 高级加密标准
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基于汉明纠错编码的AES硬件容错设计与实现 被引量:7
7
作者 唐明 张国平 张焕国 《电子学报》 EI CAS CSCD 北大核心 2005年第11期2013-2016,共4页
提出一种AES硬件容错设计可避免攻击者利用在AES设计环节中插入故障位实现攻击.在原有AES硬件设计中加入汉明码纠错电路,能自动纠正同一字节内的所有单比特故障,硬件仿真实验证明,故障发现率接近100%.针对不同AES设计结构和测试点配置... 提出一种AES硬件容错设计可避免攻击者利用在AES设计环节中插入故障位实现攻击.在原有AES硬件设计中加入汉明码纠错电路,能自动纠正同一字节内的所有单比特故障,硬件仿真实验证明,故障发现率接近100%.针对不同AES设计结构和测试点配置对纠错电路的资源及速度进行了分析,实验结果表明我们提出的硬件容错设计有很强的可行性. 展开更多
关键词 高级加密标准 汉明码 容错 纠错码 故障发现
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利用多进制组合快速构造S盒的AES算法设计 被引量:3
8
作者 王海龙 孟繁军 +1 位作者 张跃军 张增平 《合肥工业大学学报(自然科学版)》 CAS CSCD 北大核心 2014年第4期431-434,502,共5页
S盒是通过有限域GF(28)上的乘法逆与1个可逆仿射变换合成的,它满足若干密码学性质,能够抵抗现有的各种攻击。但是由于构造AES的S盒的方法只能用8×8的形式,而不能生成输入输出位数不等的S盒,这种局限性限制了S盒研究的发展空间。文... S盒是通过有限域GF(28)上的乘法逆与1个可逆仿射变换合成的,它满足若干密码学性质,能够抵抗现有的各种攻击。但是由于构造AES的S盒的方法只能用8×8的形式,而不能生成输入输出位数不等的S盒,这种局限性限制了S盒研究的发展空间。文章在分析多进制转换机制的基础之上,给出了M进制与十六进制的转换方法,并将多进制与S盒进行组合,形成多进制组合多类S盒设计思想;通过C#语言实现了多进制组合加密算法和AES加密算法对图像加密的模拟实验,并对加密后的数据进行了测试分析,测试表明图像置乱效果增强。 展开更多
关键词 aes算法 S盒 图像加密 快速构造
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基于AES算法实现对数据的加密 被引量:18
9
作者 卜晓燕 张根耀 郭协潮 《电子设计工程》 2009年第3期86-87,90,共3页
随着计算机与网络的广泛应用,数据传输量逐渐增加,数据加密变的越来越重要,在研究现代密码学技术的基础上,重点描述了AES算法原理及实现流程,通过实例详细说明其加密过程。
关键词 公钥密码体制 私钥密码体制 加密 aes
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相关密钥Square攻击AES-192 被引量:3
10
作者 陈杰 胡予濮 +1 位作者 张跃宇 董晓丽 《电子科技大学学报》 EI CAS CSCD 北大核心 2013年第2期219-224,共6页
利用AES-192子密钥间的内在关系,完全确定了在特定相关密钥差分下的前8轮子密钥的所有确切的差分值,结合Asiacrypt’2010中的密钥桥技术可以确定部分初始密钥,从而发现AES-192的密钥编排方案存在一定缺陷。利用该缺陷,给出了一个相关密... 利用AES-192子密钥间的内在关系,完全确定了在特定相关密钥差分下的前8轮子密钥的所有确切的差分值,结合Asiacrypt’2010中的密钥桥技术可以确定部分初始密钥,从而发现AES-192的密钥编排方案存在一定缺陷。利用该缺陷,给出了一个相关密钥Square攻击7轮和8轮AES-192的新方法。新方法攻击8轮AES-192仅需244.5选择明文,244.5存储,以及2183.5的8轮AES-192加密。结合部分和技术进一步降低了攻击的计算复杂度。 展开更多
关键词 高级加密标准 分组密码 差分攻击 相关密钥攻击 SQUARE攻击
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一种新的6轮AES不可能差分密码分析方法 被引量:7
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作者 陈杰 张跃宇 胡予濮 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2006年第4期598-601,共4页
给出了一个4轮AES的不可能差分特性:如果输入的明文对只有一个S-盒不同,那么4轮之后相应的密文对在同一列不可能出现3个不同的S-盒.利用该性质,在原来4轮不可能差分密码分析的基础上,前后各加一轮,提出了一种不可能差分密码分析6轮AES... 给出了一个4轮AES的不可能差分特性:如果输入的明文对只有一个S-盒不同,那么4轮之后相应的密文对在同一列不可能出现3个不同的S-盒.利用该性质,在原来4轮不可能差分密码分析的基础上,前后各加一轮,提出了一种不可能差分密码分析6轮AES的新方法.该新方法需要299.5的选择明文,记忆存储空间为257分组,以及约286的6轮AES计算,且恢复密钥的错误概率仅为2-66.5. 展开更多
关键词 不可能差分密码分析 高级加密标准 密码分析
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不可能差分攻击AES中的新密钥筛选算法 被引量:2
12
作者 董晓丽 胡予濮 陈杰 《电子科技大学学报》 EI CAS CSCD 北大核心 2011年第3期396-400,共5页
提出了一种不可能差分攻击AES的新密钥筛选算法,该算法首先利用表查询技术筛掉一部分错误密钥,再使用分别征服攻击技术筛选剩余的密钥。研究结果表明,该算法在时间复杂度函数选择恰当的自变量时,时间复杂度低于已有的密钥筛选方法。同... 提出了一种不可能差分攻击AES的新密钥筛选算法,该算法首先利用表查询技术筛掉一部分错误密钥,再使用分别征服攻击技术筛选剩余的密钥。研究结果表明,该算法在时间复杂度函数选择恰当的自变量时,时间复杂度低于已有的密钥筛选方法。同时利用该算法改进了INDOCRYPT2008上针对AES的最新不可能差分攻击,给出了时间复杂度曲线,并且得出最佳点。攻击7轮AES-128、7轮AES-192、7轮AES-256、8轮AES-256在保持数据量不变的情况下,存储访问次数分别由2117.2、2118.8、2118.8、2229.7降低为2116.35、2116.54、2116.35、2228.21。 展开更多
关键词 高级加密标准 分组密码 密码分析 不可能差分 密钥筛选 时间复杂度
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基于增强型延时感知CSE算法的AES S盒电路优化设计 被引量:3
13
作者 戴强 戴紫彬 李伟 《电子学报》 EI CAS CSCD 北大核心 2019年第1期129-136,共8页
针对高级加密标准(AES) S-盒优化,提出了一种增强型延时感知公共项消除(CSE)算法.该算法能够在不同延时约束条件下优化多常数乘法运算电路,并给出从最小延时到最小面积全范围的面积-延时设计折中.采用该算法优化了基于冗余有限域算术的... 针对高级加密标准(AES) S-盒优化,提出了一种增强型延时感知公共项消除(CSE)算法.该算法能够在不同延时约束条件下优化多常数乘法运算电路,并给出从最小延时到最小面积全范围的面积-延时设计折中.采用该算法优化了基于冗余有限域算术的S盒实现电路,确定了延时最优、面积最优的两种S盒构造.实例优化结果表明所提出算法的优化效率高、优化结果整体延时小.所设计的S盒电路基于65nm CMOS工艺库综合,结果表明,对比于已有文献中S盒复合域实现电路,所提出面积最优S盒电路的面积-延时积最小,比目前最小面积与最短延时的S盒组合逻辑分别减少了17. 58%和19. 74%. 展开更多
关键词 高级加密标准(aes) S盒 复合域 延时感知公共项消除
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AES算法的研究与其密钥扩展算法改进 被引量:22
14
作者 刘艳萍 李秋慧 《现代电子技术》 北大核心 2016年第10期5-8,13,共5页
种子密钥是高级加密标准(AES)的关键参量,而密钥扩展算法则是保护种子密钥不被盗取的重要实现方法。首先对加密算法的实现方法与过程进行研究,然后详细分析密钥扩展算法的运算过程,最后针对原有算法存在的安全隐患和破解难度不高的缺点... 种子密钥是高级加密标准(AES)的关键参量,而密钥扩展算法则是保护种子密钥不被盗取的重要实现方法。首先对加密算法的实现方法与过程进行研究,然后详细分析密钥扩展算法的运算过程,最后针对原有算法存在的安全隐患和破解难度不高的缺点,通过循环移位对密钥扩展算法进行改进,提出一种具有"运算方向单一性"的密钥扩展实现策略;并在Keil环境、12 MHz条件下测试各算法。通过实验结果分析得到,在保证运算速率的前提下,这种新算法可以进一步改善AES算法中种子密钥的安全性,并且没有破坏与加密算法间的同步特性。 展开更多
关键词 高级加密标准 密钥扩展算法 种子密钥 循环移位
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AES的结构及其S-box分析 被引量:14
15
作者 王衍波 《解放军理工大学学报(自然科学版)》 EI 2002年第3期13-17,共5页
分析了 AES的加解密原理和密钥生成器的结构 ,S- box的分布特性。指出了 AES与其密钥生成器之间存在一种结构上的同步性 ,这种同步性可能成为 AES的弱点 ;AES的 S- box具有短周期 ,不具有良好的分布特性。这给 AES的密码分析提供了可能 ... 分析了 AES的加解密原理和密钥生成器的结构 ,S- box的分布特性。指出了 AES与其密钥生成器之间存在一种结构上的同步性 ,这种同步性可能成为 AES的弱点 ;AES的 S- box具有短周期 ,不具有良好的分布特性。这给 AES的密码分析提供了可能 ,也许会成为 AES的致命弱点。 展开更多
关键词 高级数据加密标准(aes) S-BOX 密钥生成器
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基于FPGA的AES密码协处理器的设计和实现 被引量:4
16
作者 吕晓斌 杨峰 赵志新 《微电子学与计算机》 CSCD 北大核心 2005年第5期121-123,127,共4页
文章基于FPGA设计了一种能完成AES算法加密的密码协处理器,设计中利用VirtexII系列FPGA的结构特点,对AES算法的实现做了优化。实验证明,这种实现方式用较少的电路资源达到了较高的数据吞吐率。该密码协处理器还提供了和ARM处理器的接口... 文章基于FPGA设计了一种能完成AES算法加密的密码协处理器,设计中利用VirtexII系列FPGA的结构特点,对AES算法的实现做了优化。实验证明,这种实现方式用较少的电路资源达到了较高的数据吞吐率。该密码协处理器还提供了和ARM处理器的接口逻辑,实现了用于加/解密和数据输入输出的协处理器指令,作为ARM微处理器指令集的扩展,大大提高了嵌入式系统处理数据加/解的效率,实现数据的安全传输。 展开更多
关键词 协处理器 高级加密标准 现场可编程门阵列 密钥扩展
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一种小面积的高吞吐率AES协处理器设计 被引量:5
17
作者 王海洋 陈弘毅 《微电子学与计算机》 CSCD 北大核心 2009年第6期12-16,共5页
提出了一种AES协处理器的结构设计,加解密部分采用加解密复用的单个轮函数迭代的无流水线结构,内含的密钥调度电路可进行128、192与256位密钥的动态双向密钥调度.该协处理器可配置在ECB、CBC或CTR工作模式下,工作模式与数据输入输出的... 提出了一种AES协处理器的结构设计,加解密部分采用加解密复用的单个轮函数迭代的无流水线结构,内含的密钥调度电路可进行128、192与256位密钥的动态双向密钥调度.该协处理器可配置在ECB、CBC或CTR工作模式下,工作模式与数据输入输出的处理不影响处理器的数据吞吐率.基于SMIC0.13μm CMOS工艺的综合结果表明,该电路的关键路径延时最短为4.45ns,在206MHz的最高时钟频率下,128位密钥长度下的数据吞吐率可达到2.4Gb/s.电路门数为7.848万门. 展开更多
关键词 高级加密标准 协处理器 可编程 密钥调度 工作模武
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低轮AES的插值攻击方法 被引量:2
18
作者 肖皇培 张国基 黄莹莹 《华南理工大学学报(自然科学版)》 EI CAS CSCD 北大核心 2008年第5期53-57,64,共6页
针对AES(Advanced Encryption Standard)算法3轮加密后的密文代数表达式具有的次数较低(低于255)的特点,提出了低轮AES密码的插值攻击方法.该方法利用255个函数值可惟一求出254次多项式的拉格朗日插值公式.文中分析了AES加密算法中的密... 针对AES(Advanced Encryption Standard)算法3轮加密后的密文代数表达式具有的次数较低(低于255)的特点,提出了低轮AES密码的插值攻击方法.该方法利用255个函数值可惟一求出254次多项式的拉格朗日插值公式.文中分析了AES加密算法中的密文代数表达式,并给出了相应的结论及证明.利用此攻击方法,通过选取28对明密文,即可还原4轮AES的密钥,利用211对明密文,可成功破译5轮AES密码,并可把此攻击扩展到6轮AES密码. 展开更多
关键词 密码学 分组密码 插值攻击 高级加密标准
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基于CMOS工艺的AES高速接口电路设计 被引量:1
19
作者 施佺 孙玲 陈海进 《电子器件》 CAS 2004年第3期413-415,396,共4页
为提高 AES加密电路的数据吞吐量 ,采用 0 .6μm CMOS工艺设计了输入接口单元电路。该接口电路接收串行的高速数据流 ,经过串并转换后 ,输出 1 2 8路低速并行数据流。CMOS互补逻辑结构降低了电路的功耗。手工版图布局优化了芯片面积 。
关键词 先进加密标准 串并转换 版图 CMOS互补逻辑
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基于FPGA和ARM的AES算法设计和实现 被引量:1
20
作者 朱敏玲 张仰森 +1 位作者 张伟 郭艳芬 《北京信息科技大学学报(自然科学版)》 2013年第3期9-13,共5页
针对于高级加密标准(AES,advanced encryption standard)硬件实现的可重构与效率问题,提出了一种基于现场可编程逻辑器件(FPGA,field programmable gate array)和微处理器ARM(advanced RISC machines)的AES设计方法。基于电子密码本(ECB... 针对于高级加密标准(AES,advanced encryption standard)硬件实现的可重构与效率问题,提出了一种基于现场可编程逻辑器件(FPGA,field programmable gate array)和微处理器ARM(advanced RISC machines)的AES设计方法。基于电子密码本(ECB,electronic code book)操作模式,可完成AES所有标准的加密和解密,并进行了工程实现与验证,可作为IP(intellectualproperty)核使用。为实现理想的数据吞吐率/面积比,结合AES和FPGA的特点,对字节替换和密钥扩展采用查表的优化算法,并提出了列混合的优化结构,在保证运算速度下节约了器件资源。利用FPGA内部自带的双端口可配置随机存取存储器(RAM,random access memory)作为信息与密钥的缓存,解决存储和ARM与FPGA时序问题。在进行资源与速度的分析和与3种典型设计比较后的结果表明,具有最好的吞吐率/面积比。 展开更多
关键词 高级加密标准 现场可编程逻辑器件 ARM微处理器 知识产权核
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