基于Wishbone-PCI Bridge核的红外图像高速采集系统 被引量：6

1

作者 徐江丰 张涌 +1 位作者 汤心溢 王世勇 《红外与激光工程》 EI CSCD 北大核心 2006年第6期713-716,共4页

论述了一种红外图像高速采集系统的原理、结构和特点。针对红外成像探测系统的应用要求,基于Wishbone片上总线和PCI总线技术,应用Wishbone-PCI Bridge的IP核在单片FPGA上设计实现了红外图像高速采集系统,解决了系统调试中探测器红外图... 论述了一种红外图像高速采集系统的原理、结构和特点。针对红外成像探测系统的应用要求,基于Wishbone片上总线和PCI总线技术,应用Wishbone-PCI Bridge的IP核在单片FPGA上设计实现了红外图像高速采集系统,解决了系统调试中探测器红外图像高速传输、实时显示与处理的问题。实验表明:红外图像高速采集系统应用方便、工作可靠,满足了性能指标要求。 展开更多

关键词 wishbone片上总线 红外图像 高速采集

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基于WISHBONE的可兼容存储器控制器设计 被引量：3

2

作者 陈双燕 王东辉 +1 位作者 张铁军 侯朝焕 《计算机工程》 EI CAS CSCD 北大核心 2006年第18期240-242,共3页

随着近年来高速计算机的快速发展,人们对存储器频宽及性能的要求越来越高。作为第2代DDR存储器的DDR2SDRAM具有高速、低功耗、高密度、高稳定性等特点,在未来的一二年里,它将逐步取代DDRSDRAM而成为内存的主流。尽管DDR2的地位正在不断... 随着近年来高速计算机的快速发展,人们对存储器频宽及性能的要求越来越高。作为第2代DDR存储器的DDR2SDRAM具有高速、低功耗、高密度、高稳定性等特点,在未来的一二年里,它将逐步取代DDRSDRAM而成为内存的主流。尽管DDR2的地位正在不断上升,但DDR仍是当前流行的高速存储器。该文通过对这两种存储器的分析比较,基于WISHBONE总线,提出并实现了一种可兼容DDR与DDR2存储器的控制器。 展开更多

关键词 DDP SDRAM DDR2 SDRAM wishbone 控制器

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基于Wishbone总线接口的LDPC码编码器设计 被引量：2

3

作者 王刚 李冰 +1 位作者 刘勇 丁恒 《合肥工业大学学报（自然科学版）》 CAS CSCD 北大核心 2011年第9期1324-1329,共6页

在传感器控制系统中,Wishbone是SOC的三大总线标准之一。文章采用可重构的方式设计了一种基于Wishbone总线的LDPC码编码器,可以运用到传感网的无线通讯中。该设计采用RU算法,减小了编码复杂度,将电路设计成流水线形式,可以根据编码器工... 在传感器控制系统中,Wishbone是SOC的三大总线标准之一。文章采用可重构的方式设计了一种基于Wishbone总线的LDPC码编码器,可以运用到传感网的无线通讯中。该设计采用RU算法,减小了编码复杂度,将电路设计成流水线形式,可以根据编码器工作状态自适应地响应总线上的信号。对码率为1/2,码长为255、510和1023的信息码,其编码器电路在Xilinx Virtex2P系列FPGA上进行了验证,频率分别达到158、1601、66 MHz,增大了系统的吞吐率。 展开更多

关键词 wishbone总线 可重构 低密度奇偶校验码 编码器

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双向AHB-WISHBONE总线桥的设计与验证 被引量：2

4

作者 夏宏 郝春娥 闫江毓 《计算机工程与设计》 CSCD 北大核心 2011年第6期2201-2204,共4页

为了方便不同的IP(intellectual property)核的连接,针对AHB与WISHBONE这两种总线的广泛性,提出了一种双向AHB-WISHBONE总线桥的设计方法。介绍了这两种总线协议的特点和结构,阐述了AHB-WISHBONE总线桥的设计结构和实现方法。该方法难... 为了方便不同的IP(intellectual property)核的连接,针对AHB与WISHBONE这两种总线的广泛性,提出了一种双向AHB-WISHBONE总线桥的设计方法。介绍了这两种总线协议的特点和结构,阐述了AHB-WISHBONE总线桥的设计结构和实现方法。该方法难点在于AHB总线突发传输的实现,且支持多个AHB设备与多个WISHBONE设备之间的相互访问。使用Verilog语言在modelsim工具下进行了验证,仿真结果表明总线桥的设计符合要求。 展开更多

关键词 AHB总线 wishbone总线 桥 双向 VERILOG语言

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基于WISHBONE的SoC接口设计 被引量：2

5

作者 陆洪毅 戴葵 王志英 《计算机工程与科学》 CSCD 2003年第5期90-92,96,共4页

本文讨论了WISHBONE体系结构及其在SoC中的应用,并描述了在TS-1嵌入式微处理器中WISHBONE的设计与实现技术。

关键词 嵌入式微处理器 wishbone 体系结构 SOC 接口 设计

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基于Wishbone SoC总线接口的高性能SDRAM控制器 被引量：2

6

作者 李争 李范鸣 +1 位作者 陈捷 庄良 《科学技术与工程》 2008年第12期3342-3345,共4页

介绍了一种基于Wishbone SoC总线接口的SDR SDRAM控制器的设计及在FPGA上的实现,对影响其性能的关键因素做了分析。与同类的设计相比,该控制器使用高性能、简单灵活、可复用性高的片上总线接口对SDRAM的控制命令进行了完全的封装,可以... 介绍了一种基于Wishbone SoC总线接口的SDR SDRAM控制器的设计及在FPGA上的实现,对影响其性能的关键因素做了分析。与同类的设计相比,该控制器使用高性能、简单灵活、可复用性高的片上总线接口对SDRAM的控制命令进行了完全的封装,可以进行无限长的Wishbone总线猝发传输,并自动插入刷新操作,当一次传输跨越不同的Bank和Row时,自动插入等待周期并进行切换,可达到很高的存取效率。 展开更多

关键词 SDRAM控制器 wishbone总线 FPGA

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基于Wishbone总线结构的情景式IP核测试方案 被引量：1

7

作者 周俊 张金艺 《上海大学学报（自然科学版）》 CAS CSCD 北大核心 2005年第5期460-464,471,共6页

随着集成电路技术的发展,IP核复用成为集成电路SOC设计的主流.该文通过对广泛应用于SOC设计中的Wishbone总线体系结构和国际上常用IP核测试方法的研究,提出一种基于Wishbone总线结构的情景式IP核测试方案.通过对该方案应用于实际项目后... 随着集成电路技术的发展,IP核复用成为集成电路SOC设计的主流.该文通过对广泛应用于SOC设计中的Wishbone总线体系结构和国际上常用IP核测试方法的研究,提出一种基于Wishbone总线结构的情景式IP核测试方案.通过对该方案应用于实际项目后所产生实验数据的分析,证明这种IP核测试方案能大大降低系统层测试难度,加快系统层设计速度,并能显著提高测试激励效率和可观电路结构测试覆盖率. 展开更多

关键词 SOC IP核测试 wishbone总线结构 情景式 测试覆盖率 测试激励效率

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基于WishBone总线Cache数据一致性方案 被引量：1

8

作者 夏宏 任捷 《计算机工程与应用》 CSCD 北大核心 2006年第9期93-95,110,共4页

Cache数据一致性问题是多处理器系统中必须解决的一个难点。作者在开发LX-1164安全微处理器过程中对WishBone总线标准以及MOESI协议进行了深入研究,提出了一种基于WishBone总线的Cache数据一致性设计方案,对WishBone总线标准进行了扩充... Cache数据一致性问题是多处理器系统中必须解决的一个难点。作者在开发LX-1164安全微处理器过程中对WishBone总线标准以及MOESI协议进行了深入研究,提出了一种基于WishBone总线的Cache数据一致性设计方案,对WishBone总线标准进行了扩充,实现了对MOESI协议支持。本设计采用SMIC公司的0.18um工艺标准单元库,经仿真测试在400MHz主频下达到设计要求。 展开更多

关键词 wishbone Cache数据一致性 MOESI

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基于Wishbone-PCI核的红外探测器注入式仿真系统

9

作者 杨龙 李范鸣 张涌 《红外技术》 CSCD 北大核心 2016年第12期1026-1031,共6页

介绍了一种基于Wishbone-PCI桥核和Spartan6系列FPGA的红外探测器注入式仿真系统。重点讨论了基于PCI总线的红外图像注入接口卡的设计与实现以及Wishbone-PCI桥核技术。该系统可以代替红外侦察告警设备的头部探测器将红外仿真图像数据... 介绍了一种基于Wishbone-PCI桥核和Spartan6系列FPGA的红外探测器注入式仿真系统。重点讨论了基于PCI总线的红外图像注入接口卡的设计与实现以及Wishbone-PCI桥核技术。该系统可以代替红外侦察告警设备的头部探测器将红外仿真图像数据注入到红外告警、红外搜索跟踪等设备的实时信息处理箱,用来实现对红外侦察告警设备目标探测与目标跟踪功能的验证与仿真。该注入式仿真系统通过将前期红外侦察告警设备采集的红外图像数据与自定义的目标图像相叠加,注入到实时信息处理箱,因此该注入式仿真系统具有图像数据真实连续的特点,能更加真实地模拟现实的场景,为实时信号处理箱提供真实可靠的数据来源,有利于加快红外侦察告警设备的研发进程,缩短系统开发周期。 展开更多

关键词 wishbone PCI FPGA 注入式仿真系统 红外探测器

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用户自定义Wishbone片上总线IP自动生成系统的实现 被引量：3

10

作者 徐晨明 晏渭川 彭澄廉 《计算机工程与设计》 CSCD 北大核心 2006年第14期2522-2526,共5页

Wishbone作为一种免费开放的SoC片上总线接口标准,当前有着十分广泛的应用。根据Wishbone的标准,使用Perl/Tk语言实现了一个用户自定义Wishbone总线的自动生成系统。它具有友好的GUI配置界面,简单易用,平台独立性较好。针对具体的应用,... Wishbone作为一种免费开放的SoC片上总线接口标准,当前有着十分广泛的应用。根据Wishbone的标准,使用Perl/Tk语言实现了一个用户自定义Wishbone总线的自动生成系统。它具有友好的GUI配置界面,简单易用,平台独立性较好。针对具体的应用,能灵活的配置Wishbone总线,自动生成不同语言风格的总线的IP模块,极大地提高了Wishbone总线IP的设计效率。 展开更多

关键词 wishbone IP 片上总线 自动生成

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基于Wishbone和端点IP的PCIE接口设计 被引量：2

11

作者 罗宣平 刘本源 卢再奇 《现代电子技术》 2012年第11期23-26,共4页

介绍了FPGA内嵌的PCI Express硬核端点模块和Wishbone片上总线规范。应用VHDL语言,编程实现了Wishbone总线的主从端口,以及TLP包的编码和解码功能。在FPGA上运行程序并使用Chipscope测试时序波形,验证了接口数据传输的稳定性和正确性。

关键词 PCI EXPRESS总线 FPGA PCIE端点模块 wishbone

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WISHBONE片上总线符号模型检测 被引量：1

12

作者 逄涛 段振华 《计算机研究与发展》 EI CSCD 北大核心 2014年第12期2759-2771,共13页

随着多核体系结构的出现和普及,片上总线逐渐成为影响片上系统功能和性能的关键部件.因此,片上总线的验证成为片上系统设计中一个重要组成部分.模型检测作为一种主流的形式化验证方法,可以自动化穷举搜索系统行为以决定片上系统的设计... 随着多核体系结构的出现和普及,片上总线逐渐成为影响片上系统功能和性能的关键部件.因此,片上总线的验证成为片上系统设计中一个重要组成部分.模型检测作为一种主流的形式化验证方法,可以自动化穷举搜索系统行为以决定片上系统的设计是否满足设计规范.然而,模型检测受制于状态空间爆炸问题,且现有规范语言如计算树逻辑和线性时序逻辑等的描述能力有限.提出了一种基于命题投影时序逻辑的WISHBONE片上总线符号模型检测方法.该方法将以Verilog硬件描述语言实现的WISHBONE总线转化为以NuSMV模型检测工具的建模语言SMV描述的系统模型,使用命题投影时序逻辑描述WISHBONE总线期望的性质,通过PLSMC工具验证系统模型是否满足期望的性质.实验结果表明该方法能够有效验证WISHBONE片上总线的定性性质,以及时间敏感和迭代性等定量性质. 展开更多

关键词 时序逻辑 符号模型检测 wishbone总线 片上系统 形式化验证

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WISHBONE总线在超光谱图像采集系统中的应用研究

13

作者 谢惜惜 何海波 王跃明 《科学技术与工程》 2008年第15期4112-4115,4120,共5页

WISHBONE总线是当前流行的片上总线标准,它具有技术规范完整,IP资源支持丰富等众多优点。基于FPGA及WISHBONE片上总线标准构建了一个超光谱图像采集系统,该系统具有串口通信、探测器驱动、图像采集与缓存、图像编码与传输等功能,系统可... WISHBONE总线是当前流行的片上总线标准,它具有技术规范完整,IP资源支持丰富等众多优点。基于FPGA及WISHBONE片上总线标准构建了一个超光谱图像采集系统,该系统具有串口通信、探测器驱动、图像采集与缓存、图像编码与传输等功能,系统可重用性高,对类似的数据采集及传输系统具有一定的借鉴意义。 展开更多

关键词 超光谱成像仪 wishbone总线 图像采集

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MIPS系统中北桥的FPGA设计 被引量：7

14

作者 武杰 乔崇 +4 位作者 张俊杰 杜学峰 唐世悦 张万生 王砚方 《小型微型计算机系统》 CSCD 北大核心 2004年第11期2028-2031,共4页

介绍了一个用 FPGA开发的用于 MIPS系统的北桥设计 ,主要包括北桥的结构框架、设计思想和技术特点等内容 ,并结合同类型的国外产品进行了性能上的比较和测试 。

关键词 MIPS 北桥 wishbone总线 总线仲裁

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嵌入式SOC系统设计 被引量：3

15

作者 徐涛 梁利平 汪东升 《计算机工程与设计》 CSCD 北大核心 2006年第11期2005-2007,共3页

作为目前集成电路设计的主流,虽然SOC结构趋同性很大并且有众多商用IP核,但由于嵌入式系统的针对性,这就意味着从体系结构设计到BIOS、操作系统移植,要花费大量的时间与精力。通过对目前各种SOC体系结构的调查研究,提出了一种嵌入式SOC... 作为目前集成电路设计的主流,虽然SOC结构趋同性很大并且有众多商用IP核,但由于嵌入式系统的针对性,这就意味着从体系结构设计到BIOS、操作系统移植,要花费大量的时间与精力。通过对目前各种SOC体系结构的调查研究,提出了一种嵌入式SOC系统架构,功能完整、结构简单、易于扩展,稍加改动就可以满足大多数嵌入系统应用,并提供了一系列软硬件解决方案。 展开更多

关键词 MIPS SOC wishbone总线 总线仲裁 存储管理

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基于龙芯平台的EBoot设计与实现 被引量：1

16

作者 吴少刚 丰大强 《计算机工程》 CAS CSCD 北大核心 2009年第19期236-238,共3页

在龙芯平台上支持Windows CE,对于龙芯处理器在更广泛领域的产业化应用具有重要意义。基于龙芯2E开发平台,设计一个具有可移植性的Windows CE的EBoot基本架构,并最终实现Windows CE的EBoot。实验结果表明,该方案在功能和稳定性上满足Win... 在龙芯平台上支持Windows CE,对于龙芯处理器在更广泛领域的产业化应用具有重要意义。基于龙芯2E开发平台,设计一个具有可移植性的Windows CE的EBoot基本架构,并最终实现Windows CE的EBoot。实验结果表明,该方案在功能和稳定性上满足WindowsCE的要求。 展开更多

关键词 以太网引导程序 龙芯 wishbone总线协议 嵌入式系统

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硬盘控制器的FPGA实现 被引量：1

17

作者 王星睿 林涛 《郑州轻工业学院学报（自然科学版）》 CAS 2006年第4期89-91,共3页

介绍了以FPGA为基础,以Verilog硬件描述语言为载体,实现对硬盘控制的方法.该方法能够实现IDE硬盘的PIO模式或DMA模式的数据存储,并利用WishBone片上总线实现和系统中其他部分的连接,可广泛应用于视频、音频等需要大量数据存储的系统中,... 介绍了以FPGA为基础,以Verilog硬件描述语言为载体,实现对硬盘控制的方法.该方法能够实现IDE硬盘的PIO模式或DMA模式的数据存储,并利用WishBone片上总线实现和系统中其他部分的连接,可广泛应用于视频、音频等需要大量数据存储的系统中,完成对数据的高速安全存储. 展开更多

关键词 硬盘控制器 现场可编程门陈列 IDE硬盘 wishbone片上总线 PIO模式 DMA模式

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SoC设计中支持软硬件划分的虚部件库设计

18

作者 夏新军 陈吉华 李思昆 《计算机工程》 CAS CSCD 北大核心 2004年第8期57-59,87,共4页

在传统的软硬件协同设计中，硬件采用的是RTL描述(用硬件设计语言HDL描述)，而软件通常采用C或者C++语言进行描述，这种语言描述的不一致会加大协同验证仿真的难度，从而导致系统设计过程的反复。文章提出了一种基于WISHBONE总线协议标... 在传统的软硬件协同设计中，硬件采用的是RTL描述(用硬件设计语言HDL描述)，而软件通常采用C或者C++语言进行描述，这种语言描述的不一致会加大协同验证仿真的难度，从而导致系统设计过程的反复。文章提出了一种基于WISHBONE总线协议标准的用SystemC语言描述的虚部件库设计与管理方法，可以降低SoC系统设计的复杂度，从而加快SoC系统设计的过程。 展开更多

关键词 SOC SYSTEMC wishbone总线 虚部件库

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SoC设计中支持软硬件划分的虚拟微处理器

19

作者 夏新军 文宏 陈吉华 《计算机工程》 CAS CSCD 北大核心 2004年第18期176-178,共3页

在SoC系统软硬件协同设计过程中,采用WISHBONE总线协议标准来构造虚部件级SoC系统,将经过软硬件划分后的软件和硬件在虚部件级进行协同仿真,再进行实部件级的综合。提出了一种基于ARMSim仿真内核的虚部件级微处理器(虚拟微处理器)的模... 在SoC系统软硬件协同设计过程中,采用WISHBONE总线协议标准来构造虚部件级SoC系统,将经过软硬件划分后的软件和硬件在虚部件级进行协同仿真,再进行实部件级的综合。提出了一种基于ARMSim仿真内核的虚部件级微处理器(虚拟微处理器)的模型构造方法,可以简化SoC系统的设计。 展开更多

关键词 SOC 虚拟微处理器 wishbone总线 ARMSim仿真内核

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一种基于总线控制器的SoC功耗分析方法

20

作者 郑伟 李东晓 《计算机工程》 CAS CSCD 北大核心 2006年第15期221-223,共3页

总线是观测数据流行为从而进行媒体处理SoC芯片系统级功耗分析的较佳研究对象。Wishbone总线具有简单、灵活、免费等特点,是具有较强竞争力的系统芯片总线(SoC Bus)标准之一。在媒体处理SoC芯片的Wishbone总线控制器中增加具有功耗分析... 总线是观测数据流行为从而进行媒体处理SoC芯片系统级功耗分析的较佳研究对象。Wishbone总线具有简单、灵活、免费等特点,是具有较强竞争力的系统芯片总线(SoC Bus)标准之一。在媒体处理SoC芯片的Wishbone总线控制器中增加具有功耗分析功能的专用模块,可以在不改变正常集成电路EDA设计流程的情况下较好地完成系统层次的功耗分析任务,在低功耗设计中具有广泛的应用前景。 展开更多

关键词 系统芯片总线 功耗分析 电子设计自动化 wishbone总线

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