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基于Cadence_Allegro的高速PCB设计信号完整性分析与仿真
被引量:
16
1
作者
覃婕
阎波
林水生
《现代电子技术》
2011年第10期169-171,178,共4页
信号完整性问题已成为当今高速PCB设计的一大挑战,传统的设计方法无法实现较高的一次设计成功率,急需基于EDA软件进行SI仿真辅助设计的方法以解决此问题。在此主要研究了常见反射、串扰、时序等信号完整性问题的基础理论及解决方法,并基...
信号完整性问题已成为当今高速PCB设计的一大挑战,传统的设计方法无法实现较高的一次设计成功率,急需基于EDA软件进行SI仿真辅助设计的方法以解决此问题。在此主要研究了常见反射、串扰、时序等信号完整性问题的基础理论及解决方法,并基于IBIS模型,采用Cadence_Allegro软件的Specctraquest和Sigxp组件工具对设计的高速14位ADC/DAC应用系统实例进行了SI仿真与分析,验证了常见SI问题解决方法的正确性。
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关键词
高速PCB设计
信号完整性
反射
串扰
时序
si分析及仿真
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职称材料
题名
基于Cadence_Allegro的高速PCB设计信号完整性分析与仿真
被引量:
16
1
作者
覃婕
阎波
林水生
机构
电子科技大学通信与信息工程学院
出处
《现代电子技术》
2011年第10期169-171,178,共4页
基金
国家"863"计划资助项目:<高速14位A/D
D/A转换器关键技术研究与芯片开发>之ADC/DAC验证演示平台设计(2009AA01Z259)
文摘
信号完整性问题已成为当今高速PCB设计的一大挑战,传统的设计方法无法实现较高的一次设计成功率,急需基于EDA软件进行SI仿真辅助设计的方法以解决此问题。在此主要研究了常见反射、串扰、时序等信号完整性问题的基础理论及解决方法,并基于IBIS模型,采用Cadence_Allegro软件的Specctraquest和Sigxp组件工具对设计的高速14位ADC/DAC应用系统实例进行了SI仿真与分析,验证了常见SI问题解决方法的正确性。
关键词
高速PCB设计
信号完整性
反射
串扰
时序
si分析及仿真
Keywords
high-speed PCB de
si
gn
si
gnal integrity(
si
)
reflection
erosstalk
timing
si
analy
si
s and
si
mulation
分类号
TN919-34 [电子电信—通信与信息系统]
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题名
作者
出处
发文年
被引量
操作
1
基于Cadence_Allegro的高速PCB设计信号完整性分析与仿真
覃婕
阎波
林水生
《现代电子技术》
2011
16
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