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基于主方程法单电子晶体管的Verilog-A行为模型
1
作者
卢刚
魏芬芬
《电子学报》
EI
CAS
CSCD
北大核心
2009年第2期342-346,共5页
基于单电子晶体管的主方程算法,在简化Lientschnig的单电子晶体管模型基础上,建立了基于Verilog-A的单电子晶体管行为描述模型,并利用Cadence Spectre仿真器对该模型进行了验证.通过单电子晶体管逻辑电路的设计和仿真,表明该模型具有合...
基于单电子晶体管的主方程算法,在简化Lientschnig的单电子晶体管模型基础上,建立了基于Verilog-A的单电子晶体管行为描述模型,并利用Cadence Spectre仿真器对该模型进行了验证.通过单电子晶体管逻辑电路的设计和仿真,表明该模型具有合理的精确度,且速度快,为单电子晶体管电路及混合电路的仿真提供了一种有效的方法.
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关键词
单电子晶体管
主方程法
VERILOG-A
set逻辑电路
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职称材料
题名
基于主方程法单电子晶体管的Verilog-A行为模型
1
作者
卢刚
魏芬芬
机构
西安理工大学电子工程系
出处
《电子学报》
EI
CAS
CSCD
北大核心
2009年第2期342-346,共5页
基金
陕西省教育厅计划项目(No.04JK250)
西安理工大学校特色研究基金(No.210402)
高学历人才基金(No.220410)
文摘
基于单电子晶体管的主方程算法,在简化Lientschnig的单电子晶体管模型基础上,建立了基于Verilog-A的单电子晶体管行为描述模型,并利用Cadence Spectre仿真器对该模型进行了验证.通过单电子晶体管逻辑电路的设计和仿真,表明该模型具有合理的精确度,且速度快,为单电子晶体管电路及混合电路的仿真提供了一种有效的方法.
关键词
单电子晶体管
主方程法
VERILOG-A
set逻辑电路
Keywords
single-electron transistor
master equation method
Verilog-A
set
logic circuit
分类号
TN32 [电子电信—物理电子学]
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题名
作者
出处
发文年
被引量
操作
1
基于主方程法单电子晶体管的Verilog-A行为模型
卢刚
魏芬芬
《电子学报》
EI
CAS
CSCD
北大核心
2009
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