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RS码译码器的VLSI设计
被引量：
5
1
作者
方立
吕昕
邓次平
《兵工学报》
EI
CAS
CSCD
北大核心
2002年第3期422-425,共4页
本文主要研究RS码译码器的VLSI设计优化方法。分析RS码译码算法的原理 ,将适合计算机仿真计算的算法转换成适合硬件实现的结构 ,并对其进行优化。设计并实现在FPGA上可以工作在 10MHz时钟频率下的单周期硬件译码器。
关键词
rs码译码器
VLSI设计
极高速集成电路硬件描述语言
现场可编程逻辑阵列
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职称材料
基于DCME算法的RS(255,223)码的译码器实现
2
作者
包涛
张会生
许家栋
《西北工业大学学报》
EI
CAS
CSCD
北大核心
2009年第4期549-553,共5页
针对RS(255,223)译码问题的特点,研究了一种新的DCME译码方法。相比于其它修正的Euclid算法,具有无需计算阶数,只需经过2t个时钟周期就可以完成关键方程求解的特点,有效地减少了硬件资源的开销及时序控制的复杂度。以错16位的极限情况为...
针对RS(255,223)译码问题的特点,研究了一种新的DCME译码方法。相比于其它修正的Euclid算法,具有无需计算阶数,只需经过2t个时钟周期就可以完成关键方程求解的特点,有效地减少了硬件资源的开销及时序控制的复杂度。以错16位的极限情况为例,完成了RS(255,223)译码器的FPGA实现,给出了译码过程中各步骤的仿真结果。采用此方法设计的RS(255,223)译码器具有控制单元简单、模块结构规则,易于FPGA实现,可用于高速场合等特点。
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关键词
译码
现场可编程门阵列
rs码译码器
DCME算法
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职称材料
题名
RS码译码器的VLSI设计
被引量：
5
1
作者
方立
吕昕
邓次平
机构
北京理工大学电子工程系
出处
《兵工学报》
EI
CAS
CSCD
北大核心
2002年第3期422-425,共4页
文摘
本文主要研究RS码译码器的VLSI设计优化方法。分析RS码译码算法的原理 ,将适合计算机仿真计算的算法转换成适合硬件实现的结构 ,并对其进行优化。设计并实现在FPGA上可以工作在 10MHz时钟频率下的单周期硬件译码器。
关键词
rs码译码器
VLSI设计
极高速集成电路硬件描述语言
现场可编程逻辑阵列
Keywords
rs
decoder, VHSIC hardware description language, field programing gray array
分类号
TN919.32 [电子电信—通信与信息系统]
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职称材料
题名
基于DCME算法的RS(255,223)码的译码器实现
2
作者
包涛
张会生
许家栋
机构
西北工业大学电子信息学院
出处
《西北工业大学学报》
EI
CAS
CSCD
北大核心
2009年第4期549-553,共5页
基金
国家高技术发展计划(863)-空间实验室高级在轨系统(AOS)关键技术研究及演示验证项目(2005AA741072)资助
文摘
针对RS(255,223)译码问题的特点,研究了一种新的DCME译码方法。相比于其它修正的Euclid算法,具有无需计算阶数,只需经过2t个时钟周期就可以完成关键方程求解的特点,有效地减少了硬件资源的开销及时序控制的复杂度。以错16位的极限情况为例,完成了RS(255,223)译码器的FPGA实现,给出了译码过程中各步骤的仿真结果。采用此方法设计的RS(255,223)译码器具有控制单元简单、模块结构规则,易于FPGA实现,可用于高速场合等特点。
关键词
译码
现场可编程门阵列
rs码译码器
DCME算法
Keywords
decoding
field programmable gate arrays
rs
（255
223） decoder
DCME（degree computationless modified Euclid） algorithm
分类号
TN911.2 [电子电信—通信与信息系统]
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职称材料
题名
作者
出处
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被引量
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1
RS码译码器的VLSI设计
方立
吕昕
邓次平
《兵工学报》
EI
CAS
CSCD
北大核心
2002
5
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职称材料
2
基于DCME算法的RS(255,223)码的译码器实现
包涛
张会生
许家栋
《西北工业大学学报》
EI
CAS
CSCD
北大核心
2009
0
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