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DDS激励PLL频率合成器的设计与实现
被引量：
3
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作者
王锐
《信息技术》
2009年第6期197-200,共4页
介绍了DDS(直接数字式频率合成器)激励PLL(锁相环)频率合成器的主要设计过程和设计参数。它的硬件设计是由控制器部分、DDS部分和锁相环路部分三部分的设计组成。跳频序列选择m序列,将之写入到DDS的PIR(相位增量寄存器)中,完成软件控制...
介绍了DDS(直接数字式频率合成器)激励PLL(锁相环)频率合成器的主要设计过程和设计参数。它的硬件设计是由控制器部分、DDS部分和锁相环路部分三部分的设计组成。跳频序列选择m序列,将之写入到DDS的PIR(相位增量寄存器)中,完成软件控制DDS输出的频率跳变过程。给出了实测数据表明满足设计要求。
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关键词
DDS(直接数字式频率合成器)
PLL(锁相环)
M序列
pir
(
相位
增量
寄存器
)
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职称材料
题名
DDS激励PLL频率合成器的设计与实现
被引量：
3
1
作者
王锐
机构
黑龙江省电子信息产品监督检验院
出处
《信息技术》
2009年第6期197-200,共4页
文摘
介绍了DDS(直接数字式频率合成器)激励PLL(锁相环)频率合成器的主要设计过程和设计参数。它的硬件设计是由控制器部分、DDS部分和锁相环路部分三部分的设计组成。跳频序列选择m序列,将之写入到DDS的PIR(相位增量寄存器)中,完成软件控制DDS输出的频率跳变过程。给出了实测数据表明满足设计要求。
关键词
DDS(直接数字式频率合成器)
PLL(锁相环)
M序列
pir
(
相位
增量
寄存器
)
Keywords
DDS （Direct Data frequency Synthesizer）
PLL （Phase-Locked Loop）
m sequence
pir
（Phase Increment Register）
分类号
TN914 [电子电信—通信与信息系统]
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题名
作者
出处
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1
DDS激励PLL频率合成器的设计与实现
王锐
《信息技术》
2009
3
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