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基于Wishbone和端点IP的PCIE接口设计
被引量：
2
1
作者
罗宣平
刘本源
卢再奇
《现代电子技术》
2012年第11期23-26,共4页
介绍了FPGA内嵌的PCI Express硬核端点模块和Wishbone片上总线规范。应用VHDL语言,编程实现了Wishbone总线的主从端口,以及TLP包的编码和解码功能。在FPGA上运行程序并使用Chipscope测试时序波形,验证了接口数据传输的稳定性和正确性。
关键词
PCI
EXPRESS总线
FPGA
pcie端点模块
WISHBONE
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职称材料
题名
基于Wishbone和端点IP的PCIE接口设计
被引量：
2
1
作者
罗宣平
刘本源
卢再奇
机构
国防科学技术大学ATR国家重点实验室
出处
《现代电子技术》
2012年第11期23-26,共4页
文摘
介绍了FPGA内嵌的PCI Express硬核端点模块和Wishbone片上总线规范。应用VHDL语言,编程实现了Wishbone总线的主从端口,以及TLP包的编码和解码功能。在FPGA上运行程序并使用Chipscope测试时序波形,验证了接口数据传输的稳定性和正确性。
关键词
PCI
EXPRESS总线
FPGA
pcie端点模块
WISHBONE
Keywords
PCI Express bus
FPGA
PCI Express endpoint module
Wishbone
分类号
TN711-34 [电子电信—电路与系统]
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作者
出处
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1
基于Wishbone和端点IP的PCIE接口设计
罗宣平
刘本源
卢再奇
《现代电子技术》
2012
2
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