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一种基于FPGA的UART IP核设计 被引量:1
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作者 刘贤明 赵侃 谢恺 《四川兵工学报》 CAS 2011年第3期64-66,共3页
针对大部分集成电路中的UART(通用异步收发器)芯片成本高、电路复杂、移植性较差等缺点,提出了一种基于FPGA的UART IP核设计方法,应用有限状态机设计了接收器、发送器等模块,并使用VerilogHDL硬件描述语言进行编程仿真试验。仿真结果表... 针对大部分集成电路中的UART(通用异步收发器)芯片成本高、电路复杂、移植性较差等缺点,提出了一种基于FPGA的UART IP核设计方法,应用有限状态机设计了接收器、发送器等模块,并使用VerilogHDL硬件描述语言进行编程仿真试验。仿真结果表明:该方法减小了系统体积,降低了功耗,提高了系统的稳定性和可靠性,增加了系统的灵活性,提高了可移植性。 展开更多
关键词 FPGA(现场可编程逻辑门阵列) UART(通用异步收发器) ip(知识产权) 状态机
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