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基于数组分块的FPGA高级综合编译优化算法
被引量：
2
1
作者
张茉莉
杨海钢
+1 位作者
崔秀海
李园强
《计算机应用研究》
CSCD
北大核心
2013年第11期3349-3352,共4页
针对FPGA高级综合中提高矩阵存储并行的问题,提出了一种基于数组分块的编译优化算法,用来优化以矩阵乘法为代表的矩阵应用。算法在LLVM编译器架构下对访存密集的数组进行分块,然后对迭代空间进行对应的合并,最后修改迭代空间与数据空间...
针对FPGA高级综合中提高矩阵存储并行的问题,提出了一种基于数组分块的编译优化算法,用来优化以矩阵乘法为代表的矩阵应用。算法在LLVM编译器架构下对访存密集的数组进行分块,然后对迭代空间进行对应的合并,最后修改迭代空间与数据空间之间的数据访问。与AutoESL循环展开算法的实验对比表明,在分块数目最优的情况下,矩阵乘法电路的延时平均被降低46%,资源平均被降低39%。因而该基于数组分块的高级综合编译优化算法能有效降低电路延时和资源使用量。
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关键词
现场可编程门阵列
高级综合
数组分块
编译优化
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职称材料
题名
基于数组分块的FPGA高级综合编译优化算法
被引量：
2
1
作者
张茉莉
杨海钢
崔秀海
李园强
机构
中国科学院大学
中国科学院电子学研究所可编程芯片与系统研究室
出处
《计算机应用研究》
CSCD
北大核心
2013年第11期3349-3352,共4页
基金
国家重大专项资助项目(2013ZX03006004)
国家自然科学基金资助项目(61106033)
国家"973"计划资助项目(2011CB933202)
文摘
针对FPGA高级综合中提高矩阵存储并行的问题,提出了一种基于数组分块的编译优化算法,用来优化以矩阵乘法为代表的矩阵应用。算法在LLVM编译器架构下对访存密集的数组进行分块,然后对迭代空间进行对应的合并,最后修改迭代空间与数据空间之间的数据访问。与AutoESL循环展开算法的实验对比表明,在分块数目最优的情况下,矩阵乘法电路的延时平均被降低46%,资源平均被降低39%。因而该基于数组分块的高级综合编译优化算法能有效降低电路延时和资源使用量。
关键词
现场可编程门阵列
高级综合
数组分块
编译优化
Keywords
fpga high-level synthesis matrix partitioning compile optimization
分类号
TP301.6 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于数组分块的FPGA高级综合编译优化算法
张茉莉
杨海钢
崔秀海
李园强
《计算机应用研究》
CSCD
北大核心
2013
2
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