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基于 FIFO 存储器的高速显微图像处理系统 被引量:4
1
作者 田志刚 吕俊杰 陈桂林 《光学精密工程》 EI CAS CSCD 1999年第1期46-50,共5页
论述了在显微成像系统中采用普通视频采集卡所存在的问题,并介绍了一种基于FIFO存储器结构的高速显微图像处理系统的原理和设计,进而从硬件和软件两个方面详细地说明了系统的体系结构。
关键词 fifo 显微成像 视频处理 存储器 图像处理 CCD
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高速FIFO存储芯片IDT7207在虚拟逻辑分析仪设计中的应用 被引量:11
2
作者 李爱华 王章瑞 《仪表技术与传感器》 CSCD 北大核心 2003年第3期39-42,共4页
IDT72 0 7是IDT公司生产的新型先进先出 (FIFO)双端口存储器 ,它具有 32k× 9bit的存储容量 ,外围电路简单 ,不需要地址发生器 ,它由标志控制位来控制其读写操作 ,因而其接口简单、方便 ,能对大容量的数据进行高速缓存。介绍了它的... IDT72 0 7是IDT公司生产的新型先进先出 (FIFO)双端口存储器 ,它具有 32k× 9bit的存储容量 ,外围电路简单 ,不需要地址发生器 ,它由标志控制位来控制其读写操作 ,因而其接口简单、方便 ,能对大容量的数据进行高速缓存。介绍了它的特点和功能 ;并分析了其字深与字长的扩展方法 ;给出了它在数据采集中的应用 ;另外还给出了在设计的虚拟逻辑分析仪中 ,IDT72 0 展开更多
关键词 先进先出存储器(fifo) 高速数据采集 虚拟逻辑分析仪
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基于FPGA的异步FIFO缓存数据溢出控制系统 被引量:2
3
作者 张伟 《兵工自动化》 北大核心 2024年第9期55-58,65,共5页
为获取更高效、稳定的缓存数据控制方法,设计基于现场可编程门阵列(field programmable gate array,FPGA)的异步FIFO缓存数据溢出控制系统。设计存储控制方案,得到基于FPGA的系统硬件;建立缓存数据存储溢出模型,得到数据节点剩余能量的... 为获取更高效、稳定的缓存数据控制方法,设计基于现场可编程门阵列(field programmable gate array,FPGA)的异步FIFO缓存数据溢出控制系统。设计存储控制方案,得到基于FPGA的系统硬件;建立缓存数据存储溢出模型,得到数据节点剩余能量的最小值最大化求解,在函数模型下判断存储数据是否溢出;设计数据溢出控制算法,得到缓存数据溢出控制系统的软件。分别对数据溢出的监测性能与控制性能进行测试。实验结果表明:使用该方法剩余的能耗较高,可见该方法对于缓存数据的监测与控制性能均较好。 展开更多
关键词 FPGA 异步fifo存储器 缓存数据 数据溢出控制 存储控制 数据节点
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高速CCD图像数据存储技术 被引量:26
4
作者 达选福 张伯珩 边川平 《光子学报》 EI CAS CSCD 北大核心 2003年第11期1393-1395,共3页
介绍了一种高速CCD图像数据的实时存储方法 利用FIFO缓存器使CCD输出的高速数据流和低速存储介质二者的速度匹配 ,将多路高速大容量图像数据实时记录到了存储介质中 ,为后期的图像恢复和图像处理提供了原始数据
关键词 fifo(先进先出)缓存器 高速数据存储 时序设计
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数字存储示波器触发电路的数字化技术研究 被引量:15
5
作者 李毅 师奕兵 +1 位作者 王厚军 田书林 《仪器仪表学报》 EI CAS CSCD 北大核心 2004年第3期385-387,405,共4页
提出了一种全数字化的数字存储示波器用的触发电路结构。采用先进先出存储器 FIFO,利用其存储数据先进先出的特性 ,结合高速数字比较器的比较特性 ,控制采样数据的存储 ,从而实现触发电路的多种功能。给出了数字触发电路原理框图以及在 ... 提出了一种全数字化的数字存储示波器用的触发电路结构。采用先进先出存储器 FIFO,利用其存储数据先进先出的特性 ,结合高速数字比较器的比较特性 ,控制采样数据的存储 ,从而实现触发电路的多种功能。给出了数字触发电路原理框图以及在 CPL D上的设计实现 。 展开更多
关键词 数字存储示波器 触发电路 先进先出存储器 数字化 CPLD
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基于DDR2 SDRAM的高速大容量异步FIFO的设计与实现 被引量:14
6
作者 徐欣 周舟 +1 位作者 李楠 孙兆林 《中国测试》 CAS 2009年第6期34-37,共4页
为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后... 为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后深入分析了FIFO控制器各部分的工作原理并对其进行了实验。经过测试,基于DDR2 SDRAM的FIFO实现了最高475MHz的总线速率,8~256位的总线位宽,2GB最大数据容量。该FIFO可以解决高速海量数据缓存的问题,在工程应用中有显著的参考价值。 展开更多
关键词 高速海量数据缓存 fifo存储器 DDR2 SDRAM技术 FPGA技术 分时复用
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FIFO在多级滤波图像处理ASIC芯片中的设计应用 被引量:3
7
作者 陈朝阳 洪功存 +1 位作者 沈绪榜 郑兆青 《红外与激光工程》 EI CSCD 北大核心 2005年第3期348-351,共4页
描述了多级滤波图像处理ASIC芯片的体系结构,针对该芯片的数据缓冲存储问题,通过控制模块对一个输入FIFO和三个输出FIFO的协调控制,高效地实现了多路数据的实时处理和传输。结合应用要求,一个异步FIFO对输入数据缓冲存储,使快速数据通... 描述了多级滤波图像处理ASIC芯片的体系结构,针对该芯片的数据缓冲存储问题,通过控制模块对一个输入FIFO和三个输出FIFO的协调控制,高效地实现了多路数据的实时处理和传输。结合应用要求,一个异步FIFO对输入数据缓冲存储,使快速数据通道与慢速数据输入相匹配;三个同步FIFO,分别对应单级1×3、两级1×3级联(相当于1×5)和三级1×3级联(相当于1×7)滤波模板的图像数据输出缓存,分时复用一路输出总线。仿真结果表明设计是正确且有效的。 展开更多
关键词 fifo 多级滤波 图像处理 存储器 芯片
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基于USB总线的高速数据采集存储测试系统的设计 被引量:11
8
作者 文丰 赵小珍 甄国涌 《电测与仪表》 北大核心 2007年第11期47-49,10,共4页
本系统采用USB接口芯片CY7C68013来完成采样控制并与PC机应用程序完成通信功能,由应用程序完成用户命令及数据显示。分别从方案设计、硬件实现、数据采集及存储等方面进行了详细研究和描述。之后,对大容量的FLASH存储器操作过程也进行... 本系统采用USB接口芯片CY7C68013来完成采样控制并与PC机应用程序完成通信功能,由应用程序完成用户命令及数据显示。分别从方案设计、硬件实现、数据采集及存储等方面进行了详细研究和描述。之后,对大容量的FLASH存储器操作过程也进行了详细介绍。 展开更多
关键词 USB 高速数据采集 存储测试系统 FLASH存储器 先进先出
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利用FPGA实现同步FIFO设置方法 被引量:7
9
作者 刘志杨 郭继昌 +1 位作者 关欣 黄彩彩 《电子测量技术》 2006年第1期65-66,共2页
文中在QuartusⅡ环境中,用VHDL作为编程语言,实现用FPGA器件对同步FIFO设置的方法,在基于DSP的图像处理系统中达到使同步FIFO高效完成数据缓冲作用的目的。这种方法对FIFO的使用具有很好的借鉴意义。
关键词 先进先出(fifo) 硬件描述语言 偏置寄存器
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基于FPGA中FIFO误码率软硬件测试方法 被引量:4
10
作者 王科 刘振安 +3 位作者 赵棣新 过雅南 徐昊 阴泽杰 《电子测量技术》 2004年第2期5-6,共2页
文中介绍用 FPGA中 FIFO的误码率软件和硬件测试方法,简介数据比较程序;说明硬件测试中伪随机码序列特点和生成原理,并对比较时如何使数据对应做出讨论。最后列出测试结果,比较这两种方法的优缺点。
关键词 FPGA fifo 误码率 先进先出寄存器 伪随机码 线性反馈移位寄存器 测试 数字通信
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采用FIFO级联实现可编程的采样预触发与缓存容量扩展 被引量:2
11
作者 张琦 宋民 +1 位作者 高梅国 杨静 《北京理工大学学报》 EI CAS CSCD 北大核心 2005年第11期985-988,共4页
为满足现代高分辨率雷达大容量高速缓存以及被动雷达和时差定位系统采样预触发的需要,提出了采用多片先进先出(F IFO)芯片级联的硬件结构实现可编程采样预触发和缓存容量扩展.分析了两级F IFO级联时芯片间接口的时序,给出了对F IFO可编... 为满足现代高分辨率雷达大容量高速缓存以及被动雷达和时差定位系统采样预触发的需要,提出了采用多片先进先出(F IFO)芯片级联的硬件结构实现可编程采样预触发和缓存容量扩展.分析了两级F IFO级联时芯片间接口的时序,给出了对F IFO可编程标志位的设置方法.实际应用证明,采用该结构可使系统的缓存容量达到2 M B,预触发量达到1 M B,且两种功能可由FPGA控制切换.该结构也适用于其它具有可编程标志的F IFO. 展开更多
关键词 先进先出存储器 存储容量扩展 采样预触发 可编程标志
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采用FPGA扩充PCI 9052外部FIFO 被引量:1
12
作者 王劲松 李飞 孙万忠 《计算机应用与软件》 CSCD 北大核心 2004年第6期118-119,32,共3页
本文讨论了利用FPGA扩充PCI 90 5 2外部FIFO的方法 ,同时给出了用FPGA实现的扩充FIFO的重要的性能评估参数。
关键词 PCI总线 fifo FGPA 先进先出队列 PCI9052 桥路芯片
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FIFO技术在SDH数字交叉连接芯片设计中的应用
13
作者 刘钊远 《电讯技术》 2006年第3期28-32,共5页
首先介绍了数字交叉设备中SDH数字交叉连接芯片的位置及作用,简要介绍了SDH数字交叉芯片的基本结构,并讨论了采用FIFO技术来解决该结构中多条高速链路之间交叉所面临的问题,对FIFO基本电路给予描述,重点讨论了FIFO技术在SDH数字交叉连... 首先介绍了数字交叉设备中SDH数字交叉连接芯片的位置及作用,简要介绍了SDH数字交叉芯片的基本结构,并讨论了采用FIFO技术来解决该结构中多条高速链路之间交叉所面临的问题,对FIFO基本电路给予描述,重点讨论了FIFO技术在SDH数字交叉连接芯片中的应用,最后给出了数字交叉连接芯片中FIFO技术的设计实现。 展开更多
关键词 先进先出队列 数字交叉连接 帧定位 双端口随机存储器
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FPGA内部时钟系统间的FIFO数据接口 被引量:3
14
作者 孙广彬 许媛媛 +1 位作者 何金田 赵书俊 《郑州大学学报(理学版)》 CAS 2003年第2期38-41,共4页
在现场可编程逻辑芯片的设计过程中 ,不同模块之间的数据接口 ,尤其是不同时钟系统的各个模块之间的数据接口是系统设计的一个关键 .用异步FIFO模块来实现接口 ,接口双方都在自己时钟的同步下进行工作 ,它们之间不需要互相握手 ,只需跟... 在现场可编程逻辑芯片的设计过程中 ,不同模块之间的数据接口 ,尤其是不同时钟系统的各个模块之间的数据接口是系统设计的一个关键 .用异步FIFO模块来实现接口 ,接口双方都在自己时钟的同步下进行工作 ,它们之间不需要互相握手 ,只需跟接口FIFO模块进行交互就可以了 ,即向接口FIFO模块中写入数据或从FIFO模块中读出数据 .用这样一个缓冲FIFO模块实现FPGA内部不同时钟系统之间的数据接口 ,使设计变得非常简单和容易 .所用的FIFO接口是XILINX公司提供的IP核 ,经过充分测试和优化 ,系统运行稳定 。 展开更多
关键词 现场可编程门阵列 FPGA 时钟系统 先进先出 fifo模块 数据接口 系统设计 可编程逻辑芯片
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基于FLASH的FIFO读写 被引量:1
15
作者 陈富龙 汪一鸣 《计算机工程与设计》 CSCD 北大核心 2009年第3期526-528,共3页
在FPGA工程设计中,经常需要用到大量的数据,由于FPGA片内存储器资源有限,一般利用SOPC开发的方法将数据烧写入Flash中,然后从Flash中读取数据进行处理。然而,读取Flash的时钟频率与处理模块的时钟频率往往不同,对这个问题进行了研究,采... 在FPGA工程设计中,经常需要用到大量的数据,由于FPGA片内存储器资源有限,一般利用SOPC开发的方法将数据烧写入Flash中,然后从Flash中读取数据进行处理。然而,读取Flash的时钟频率与处理模块的时钟频率往往不同,对这个问题进行了研究,采用FIFO的方法读取数据,增强了设计的性能和灵活性,并提出使用两个进程使读写同时进行,从而提高了读写的速度,更好的实现了系统的实时性。 展开更多
关键词 现场可编程门阵列 片上可编程系统 闪存烧写 先进先出存储器
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手持数字示波表技术研究 被引量:13
16
作者 叶芃 王厚军 田书林 《仪器仪表学报》 EI CAS CSCD 北大核心 2002年第z3期144-147,共4页
手持数字示波表是数字存储示波器的一个分支 ,在工业现场得到广泛应用。现介绍一种基于双路 10 0 MSPS高速数据采集系统的手持示波表实现方案。文中重点讨论了其中的关键技术 ,包括 2 0 0 MSPS高速数据采集的实现、FPGA内部实现数字触... 手持数字示波表是数字存储示波器的一个分支 ,在工业现场得到广泛应用。现介绍一种基于双路 10 0 MSPS高速数据采集系统的手持示波表实现方案。文中重点讨论了其中的关键技术 ,包括 2 0 0 MSPS高速数据采集的实现、FPGA内部实现数字触发电路、液晶显示控制电路和显示数据同步电路、采集控制和存储电路。 展开更多
关键词 手持数字示波表 先进先出存储器 数字触发电路
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基于USB2.0接口的高速视频采集系统设计 被引量:6
17
作者 王宏 鞠正喜 +1 位作者 杜国华 夏存东 《仪器仪表学报》 EI CAS CSCD 北大核心 2006年第z2期1423-1424,共2页
USB2.0串行接口具有连接简便、即插即用、传输速度快、通用性强的特点,近年来在各种数字设备中得到迅速发展。但由于其通讯协议复杂、技术开发难度大,不便于在基于单片机的小型嵌入式系统中应用。本文采用FIFO存储器作缓存.应用集成80... USB2.0串行接口具有连接简便、即插即用、传输速度快、通用性强的特点,近年来在各种数字设备中得到迅速发展。但由于其通讯协议复杂、技术开发难度大,不便于在基于单片机的小型嵌入式系统中应用。本文采用FIFO存储器作缓存.应用集成8051 MCU和USB2.0接口的高性能单片机技术,对高速视频采集系统进行了较深入的研究,提出了切实可行的解决方案。 展开更多
关键词 USB2.0 CMOS图像传感器 fifo存储器
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基于USB2.0和线阵CCD的高速数据采集系统设计 被引量:5
18
作者 余永辉 涂巧玲 +1 位作者 徐霞 彭宇兴 《压电与声光》 CSCD 北大核心 2009年第3期448-450,共3页
为了解决电荷耦合器件(CCD)图像数据高速采集和实时传输处理问题,设计了一种基于USB2.0的高速CCD数据采集系统。系统采用可编程逻辑(CPLD)实现时序控制和逻辑控制,专用视频信号处理芯片XRD4460实现高速A/D转换;为了保证CCD图像数据高速... 为了解决电荷耦合器件(CCD)图像数据高速采集和实时传输处理问题,设计了一种基于USB2.0的高速CCD数据采集系统。系统采用可编程逻辑(CPLD)实现时序控制和逻辑控制,专用视频信号处理芯片XRD4460实现高速A/D转换;为了保证CCD图像数据高速传输,采用先进先出(FIFO)作为CCD数据流与8051单片机之间的缓存区进行数据缓存,采用CY7C68013接口芯片的GPI接口模式完成控制信号的发送以及实现采集系统与计算机之间的数据高速传输。 展开更多
关键词 USB2.0 线阵电荷耦合器件 先进先出(fifo) 可编程逻辑(CPLD)
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基于FPGA的高速数据采集分析系统的设计 被引量:6
19
作者 麻志滨 廖雯 刘芳 《现代电子技术》 2014年第16期135-137,143,共4页
为了实现对模拟量的高速采集与快速傅里叶分析,提出了一种基于FPGA的高速数据采集分析系统的设计方案,系统采用Cyclone系列FPGA配合高速A/D转换器,并使用了Altera公司的定制快速傅里叶分析集成核,通信与上位机采用RS 232串行通信标准协... 为了实现对模拟量的高速采集与快速傅里叶分析,提出了一种基于FPGA的高速数据采集分析系统的设计方案,系统采用Cyclone系列FPGA配合高速A/D转换器,并使用了Altera公司的定制快速傅里叶分析集成核,通信与上位机采用RS 232串行通信标准协议配合基于Matlab GUI的上位机分析软件,并对多组高频模拟信号进行了高速数据采集与快速傅里叶分析实验,同时在上位机分析软件中实时显示出分析结果。实验结果验证了快速傅里叶分析理论,实现了低成本、高性能数据采集分析系统的设计完成。 展开更多
关键词 FPGA 高速数据采集 快速傅里叶分析 fifo存储器
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基于PCI总线的行波数据采集系统 被引量:2
20
作者 方力谦 李晓明 +1 位作者 高辉 熊友红 《电网技术》 EI CSCD 北大核心 2006年第3期80-84,共5页
在行波故障测距中,传统的数据采集系统无法满足采集高速变化的暂态电压、电流行波的要求,难以实现故障的精确定位。笔者研制了一种基于PCI总线的高速数据采集系统,介绍了系统原理和硬件电路。以现场可编程门阵列(Field Programmable Gat... 在行波故障测距中,传统的数据采集系统无法满足采集高速变化的暂态电压、电流行波的要求,难以实现故障的精确定位。笔者研制了一种基于PCI总线的高速数据采集系统,介绍了系统原理和硬件电路。以现场可编程门阵列(Field Programmable Gate Array,FPGA)作为中央处理器,通过高速A/D转换、同步动态随机存储器(Synchronous Dynamic Random Access Memory,SDRAM)和先进先出(First In First Out,FIFO)高速缓冲存储及PCI总线传输实现高速数据采集。该系统可实现高达100MHz的采样频率,能有效解决输电线路暂态行波的采集问题,在故障定位及微机保护中均能得到广泛应用。 展开更多
关键词 高速数据采集 现场可编程门阵列 PCI总线 行波 同步动态随机存储器 先进先出
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