基于DDR2 SDRAM的高速数据缓存技术研究 被引量：5

1

作者 吕文强 施睿 +1 位作者 任勇峰 武慧军 《电子测量技术》 2020年第18期6-10,共5页

针对高速数据传输系统中,图像数据采集的速率越来越高,而存储速率有限的问题,提出一种基于DDR2 SDRAM高速数据缓存技术。采用FPGA为主控制器,接收高速图像数据后写入DDR2 SDRAM缓存,在发送周期的空闲时间将数据读出并匹配存储设备的接... 针对高速数据传输系统中,图像数据采集的速率越来越高,而存储速率有限的问题,提出一种基于DDR2 SDRAM高速数据缓存技术。采用FPGA为主控制器,接收高速图像数据后写入DDR2 SDRAM缓存,在发送周期的空闲时间将数据读出并匹配存储设备的接收速率。为了简化对DDR2 SDRAM的操作,使用ISE软件的存储接口生成工具(MIG)生成DDR2 IP核,实现了在250 MHz时钟下对DDR2 SDRAM的读/写操作,经验证,数据无丢帧无误码,设计稳定可靠。 展开更多

关键词 FPGA ddr2 sdram ddr2 IP核 高速数据缓存

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基于DDR2 SDRAM缓存的CMOS图像数据采集与传输系统 被引量：11

2

作者 赵志刚 郭金川 +4 位作者 杜杨 黄建衡 牛憨笨 王健 曾清清 《仪表技术与传感器》 CSCD 北大核心 2010年第6期90-93,共4页

设计并实现了一套由大面阵CMOS图像传感器、FPGA、DDR2 SDRAM、ARM和PC机组成的CMOS图像数据采集与传输系统。该系统利用高数据带宽、大容量的DDR2 SDRAM存储器适时地对CMOS图像数据进行缓存,然后经以太网传输至PC机,从而完成图像的存... 设计并实现了一套由大面阵CMOS图像传感器、FPGA、DDR2 SDRAM、ARM和PC机组成的CMOS图像数据采集与传输系统。该系统利用高数据带宽、大容量的DDR2 SDRAM存储器适时地对CMOS图像数据进行缓存,然后经以太网传输至PC机,从而完成图像的存储、处理和显示。DDR2 SDRAM存储器的引入,增强了整个成像系统的灵活性和可扩充性。实测显示该系统能够满足对高端COMS图像传感器LUPA-4000进行远程控制和数据传输的要求。 展开更多

关键词 LUPA-4000 CMOS图像传感器 FPGA ddr2 sdram ARM

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基于DDR2 SDRAM的高速大容量异步FIFO的设计与实现 被引量：14

3

作者 徐欣 周舟 +1 位作者 李楠 孙兆林 《中国测试》 CAS 2009年第6期34-37,共4页

为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后... 为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后深入分析了FIFO控制器各部分的工作原理并对其进行了实验。经过测试,基于DDR2 SDRAM的FIFO实现了最高475MHz的总线速率,8～256位的总线位宽,2GB最大数据容量。该FIFO可以解决高速海量数据缓存的问题,在工程应用中有显著的参考价值。 展开更多

关键词 高速海量数据缓存 FIFO存储器 ddr2 sdram技术 FPGA技术 分时复用

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基于Verilog HDL的DDR2 SDRAM控制器设计 被引量：4

4

作者 周亮 王娟 +2 位作者 胡畅华 杨明武 高挺挺 《合肥工业大学学报（自然科学版）》 CAS CSCD 北大核心 2010年第8期1253-1256,共4页

文章对适用DDR2 SDRAM控制器的结构、接口和时序进行了深入研究与分析,总结出一些控制器的关键技术特性,然后采用了自顶向下(TOP-DOWN)的设计方法,用Verilog硬件描述语言实现控制器,随后在Modelsi m6.1上通过软件功能仿真,用Synopsys公... 文章对适用DDR2 SDRAM控制器的结构、接口和时序进行了深入研究与分析,总结出一些控制器的关键技术特性,然后采用了自顶向下(TOP-DOWN)的设计方法,用Verilog硬件描述语言实现控制器,随后在Modelsi m6.1上通过软件功能仿真,用Synopsys公司的DC进行综合,通过Altera公司的FPGA进行硬件验证,结果表明控制器能完全胜任对DDR2 SDRAM的控制。 展开更多

关键词 ddr2 sdram 控制器 VERILOG HDL FPGA

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DDR2 SDRAM控制器的FPGA实现 被引量：13

5

作者 须文波 胡丹 《江南大学学报（自然科学版）》 CAS 2006年第2期145-148,共4页

龙芯SoC第一版本(ICT-E32)中集成的是SDRAM控制器,但鉴于SDRAM性能的限制,使其成为提高龙芯SoC性能的瓶颈.为了进一步提高龙芯SoC性能,在新一款中集成了DDR2控制器.因为DDR2采用了新技术,使其实现相对于SDRAM更为复杂,因此预先在FPGA上... 龙芯SoC第一版本(ICT-E32)中集成的是SDRAM控制器,但鉴于SDRAM性能的限制,使其成为提高龙芯SoC性能的瓶颈.为了进一步提高龙芯SoC性能,在新一款中集成了DDR2控制器.因为DDR2采用了新技术,使其实现相对于SDRAM更为复杂,因此预先在FPGA上对其进行实现,以方便对其在整个SoC设计中的集成.目前,该控制器已经通过功能仿真,并在Xilinx公司的Virtex-4系列FPGA上得以实现. 展开更多

关键词 龙芯SoC 现场可编程逻辑门阵列 第二代DDR同步动态内存

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用于空间遥感相机模拟源系统的DDR2 SDRAM高速存储电路设计

6

作者 倪建军 李涛 王建宇 《中国科学院大学学报（中英文）》 CAS CSCD 北大核心 2013年第5期682-687,共6页

为了满足空间遥感相机电子学系统的功能验证需求,设计了一套由FPGA和DDR2 SDRAM等组成的空间遥感相机模拟源系统.针对DDR2 SDRAM在设计时的难度,从提高信号完整性出发,对DDR2 SDRAM的阻抗匹配形式和匹配电阻位置进行详细分析,并对PCB布... 为了满足空间遥感相机电子学系统的功能验证需求,设计了一套由FPGA和DDR2 SDRAM等组成的空间遥感相机模拟源系统.针对DDR2 SDRAM在设计时的难度,从提高信号完整性出发,对DDR2 SDRAM的阻抗匹配形式和匹配电阻位置进行详细分析,并对PCB布局布线及FPGA管脚约束设计给出可行性设计方案.实验结果表明,按照提出的设计方法,DDR2 SDRAM不论采用单端或差分时钟工作,均可保证数据以320 Mbps/pin来传输,信号质量依然理想. 展开更多

关键词 现场可编程门阵列 双倍速率同步动态随机存储器 管脚约束 空间遥感相机模拟源系统

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基于DDR2 SDRAM的SAR成像转置存储器的FPGA实现 被引量：1

7

作者 白海龙 全英汇 +1 位作者 王虹现 王彤 《现代电子技术》 2008年第1期48-50,56,共4页

转置存储器(CTM)是合成孔径雷达(SAR)实时处理器的一个重要组成部分,本文提出了在基于FPGA和DDR2 SDRAM的实时成像系统中CTM的设计方法,详述了其功能和设计思想,并使用ALTERA的EP2S60F1020C5 FPGA和SAMSUNG的M378T6553CZ3 DDR2 SDRAM进... 转置存储器(CTM)是合成孔径雷达(SAR)实时处理器的一个重要组成部分,本文提出了在基于FPGA和DDR2 SDRAM的实时成像系统中CTM的设计方法,详述了其功能和设计思想,并使用ALTERA的EP2S60F1020C5 FPGA和SAMSUNG的M378T6553CZ3 DDR2 SDRAM进行了实现和验证,同时给出了设计与实现中应注意的若干问题。 展开更多

关键词 转置存储器 合成孔径雷达 可编程逻辑器件 ddr2 sdram控制器

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DDR2 SDRAM控制器的数据通道设计

8

作者 吕亮 王厚军 付在明 《电子测量技术》 2011年第11期89-92,共4页

在DDR2SDRAM控制器的设计中,用户端与DDR2存储器端之间数据通道的设计是提高数据传输率的关键,也是控制器设计中的难点。首先简单介绍了DDR2SDRAM控制器的整体结构,然后分析了DDR2存储器的读写时序过程,并提出了双向数据DQ与同步信号DQ... 在DDR2SDRAM控制器的设计中,用户端与DDR2存储器端之间数据通道的设计是提高数据传输率的关键,也是控制器设计中的难点。首先简单介绍了DDR2SDRAM控制器的整体结构,然后分析了DDR2存储器的读写时序过程,并提出了双向数据DQ与同步信号DQS的相位关系要求,最后在阐述了数据通道要求实现的具体功能后直接使用Altera公司提供的IP核设计了1种高速数据通道,并在时序仿真后在硬件平台上通过了验证。 展开更多

关键词 ddr2 sdram 控制器 数据通道 IP核

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高速图像处理系统中DDR2-SDRAM接口的设计 被引量：15

9

作者 陈雨 陈科 安涛 《现代电子技术》 2011年第12期104-107,110,共5页

为了满足高速图像处理系统中需要高接口带宽和大容量存储的目的,采用了FPGA外接DDR2-SDRAM的设计方法,提出一种基于VHDL语言的DDR2-SDRAM控制器的方案,针对高速图像处理系统中的具体情况,在Xilinx的ML506开发板上搭建了简单的图像处理... 为了满足高速图像处理系统中需要高接口带宽和大容量存储的目的,采用了FPGA外接DDR2-SDRAM的设计方法,提出一种基于VHDL语言的DDR2-SDRAM控制器的方案,针对高速图像处理系统中的具体情况,在Xilinx的ML506开发板上搭建了简单的图像处理系统平台并进行了连续读/写标准VGA格式图像数据的实验,在显示端得到了清晰不掉帧的图像结果,具有结构简单和高速存取图像的特点。 展开更多

关键词 图像处理 ddr2-sdram控制器 FPGA 缓存设计

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基于DDR2的DSO分区交替深存储技术研究 被引量：1

10

作者 彭伟 张沁川 袁渊 《电子测量技术》 2013年第8期24-27,共4页

具有深存储功能的数字存储示波器(DSO),能够将大量的采集数据存储下来,大大提高了采集到的波形数据的信息含量,能够很好的再现波形细节,为工程师分析信号、解决问题提供了极大的便利。设计采用FPGA外挂DDR2SDRAM颗粒的方式来存储采集数... 具有深存储功能的数字存储示波器(DSO),能够将大量的采集数据存储下来,大大提高了采集到的波形数据的信息含量,能够很好的再现波形细节,为工程师分析信号、解决问题提供了极大的便利。设计采用FPGA外挂DDR2SDRAM颗粒的方式来存储采集数据,并利用FPGA内部的MCBIP核来控制其读写和刷新。以此为基础,研究了基于DDR2SDRAM颗粒的基本深存储设计方案,提出了分区交替深存储技术,并分析了该技术对提升DSO深存储性能的作用及具体实现方法。该技术解决了示波器停止状态下读取DDR2SDRAM颗粒数据与写DDR2SDRAM颗粒之间的矛盾,并在实际测试中取得了很好的效果。 展开更多

关键词 深存储 ddr2sdram MCB 分区交替存储

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基于DDR2的二维波形映射技术研究与实现

11

作者 许根泉 叶芃 邱渡裕 《电子测量技术》 2011年第9期54-57,共4页

波形捕获率是衡量示波器波形采集性能的1个重要指标,提高示波器的波形捕获率有助于提高对偶发信号的捕获能力。利用FPGA内部RAM资源或者外挂高速RAM作为映射缓冲区这一做法已经被广泛采用,但是成本高、局限性大。基于DDR2 SDRAM读写速... 波形捕获率是衡量示波器波形采集性能的1个重要指标,提高示波器的波形捕获率有助于提高对偶发信号的捕获能力。利用FPGA内部RAM资源或者外挂高速RAM作为映射缓冲区这一做法已经被广泛采用,但是成本高、局限性大。基于DDR2 SDRAM读写速度快、容量大、器件成熟的优点,设计了1种采集与显示并行处理的二维波形图像处理单元(WGPU)。映射结果表明利用本设计可以大大提高示波器的波形捕获率,改善示波器对偶发信号的捕获能力。 展开更多

关键词 死区时间 波形捕获率 ddr2sdram 状态机

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具有自动聚焦功能的视频处理器的设计 被引量：4

12

作者 张博 张刚 程永强 《液晶与显示》 CAS CSCD 北大核心 2010年第3期396-400,共5页

介绍了一种视频处理器的设计,该处理器接收数字YCbCr视频信号,利用一片DDR2SDRAM存储器作为帧缓存,对接收的视频信号进行格式转换、帧率提升、色空间转换。提出并实现一种改进的自动聚焦算法,实时计算当前帧图像的聚焦评价函数值,选用... 介绍了一种视频处理器的设计,该处理器接收数字YCbCr视频信号,利用一片DDR2SDRAM存储器作为帧缓存,对接收的视频信号进行格式转换、帧率提升、色空间转换。提出并实现一种改进的自动聚焦算法,实时计算当前帧图像的聚焦评价函数值,选用爬山搜索策略实现对聚焦电机的控制,使当前图像的聚焦函数值最大,实现图像的自动聚焦。该设计采用VHDL语言实现,在Xilinx XUPV5-LX110T FPGA开发板上验证。 展开更多

关键词 视频处理 ddr2sdram 帧率提升 自动聚焦 FPGA

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基于WISHBONE的可兼容存储器控制器设计 被引量：3

13

作者 陈双燕 王东辉 +1 位作者 张铁军 侯朝焕 《计算机工程》 EI CAS CSCD 北大核心 2006年第18期240-242,共3页

随着近年来高速计算机的快速发展,人们对存储器频宽及性能的要求越来越高。作为第2代DDR存储器的DDR2SDRAM具有高速、低功耗、高密度、高稳定性等特点,在未来的一二年里,它将逐步取代DDRSDRAM而成为内存的主流。尽管DDR2的地位正在不断... 随着近年来高速计算机的快速发展,人们对存储器频宽及性能的要求越来越高。作为第2代DDR存储器的DDR2SDRAM具有高速、低功耗、高密度、高稳定性等特点,在未来的一二年里,它将逐步取代DDRSDRAM而成为内存的主流。尽管DDR2的地位正在不断上升,但DDR仍是当前流行的高速存储器。该文通过对这两种存储器的分析比较,基于WISHBONE总线,提出并实现了一种可兼容DDR与DDR2存储器的控制器。 展开更多

关键词 DDP sdram ddr2 sdram WISHBONE 控制器

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基于FPGA的工业数字摄像机系统的设计 被引量：1

14

作者 汤伟 刘慧忠 +2 位作者 连钰洋 王震 裴之勇 《液晶与显示》 CAS CSCD 北大核心 2015年第1期103-108,共6页

针对传统工业数字摄像机的灵活性差、实时性差等缺点,设计了一种基于FPGA的工业数字摄像机系统。将工业数字摄像机与FPGA结合起来,利用FPGA通过I2 C总线接口控制器控制图像传感器采集图像数据,然后将Bayer格式图像转化为RGB格式图像,通... 针对传统工业数字摄像机的灵活性差、实时性差等缺点,设计了一种基于FPGA的工业数字摄像机系统。将工业数字摄像机与FPGA结合起来,利用FPGA通过I2 C总线接口控制器控制图像传感器采集图像数据,然后将Bayer格式图像转化为RGB格式图像,通过调用Altera IP核DDRII SDRAM controller with ALTMEMPHY和FIFO存储器设计了DDR2SDRAM的接口,将图像数据缓存到DDR2存储器中,最后通过SPI总线接口在液晶屏上显示图像,可达到53帧/s图像的速度。系统代码共需约5 000个逻辑单元,3 704个寄存器,117个引脚。将设计代码下载到系统芯片中后,系统可以清晰显示所拍到的画面。设计结果表明,基于FPGA的工业数字摄像机设计灵活,易于移植,可实现高速图像采集和传输。 展开更多

关键词 FPGA 图像传感器 液晶屏 ddr2sdram 控制器

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基于USB3.0高速图像数据传输系统设计 被引量：11

15

作者 王国忠 刘磊 +2 位作者 储成群 任勇峰 焦新泉 《仪表技术与传感器》 CSCD 北大核心 2019年第3期106-109,113,共5页

为了解决图像采集系统中实时数据的高速缓存与传输问题,提出了一种基于高数据带宽、大容量的DDR2 SDRAM存储器和支持突发传输的USB3.0数据传输接口的设计方案。在硬件设计中,采用CYUSB3014作为USB3.0的控制芯片实现FPGA与上位机之间高... 为了解决图像采集系统中实时数据的高速缓存与传输问题,提出了一种基于高数据带宽、大容量的DDR2 SDRAM存储器和支持突发传输的USB3.0数据传输接口的设计方案。在硬件设计中,采用CYUSB3014作为USB3.0的控制芯片实现FPGA与上位机之间高速图像数据传输,以及采用DDR2 SDRAM作为缓存器;在逻辑设计中采用手动DMA模式对数据流进行控制,避免数据的堵塞,提高了可靠性。经验证,该系统工作稳定,能有效解决海量图像数据的缓存与传输问题。 展开更多

关键词 高速缓存 ddr2sdram USB3.0 手动DMA 可靠性

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基于FPGA的机载综合显示系统的设计与实现 被引量：4

16

作者 李冰洋 贾银亮 张峰 《电子测量技术》 2016年第2期76-79,共4页

为了满足机载综合显示系统在数据存储量、显示实时性、芯片处理速度等方面的高要求,设计并实现一种机载综合显示系统。系统以FPGA为主要开发平台,利用其丰富的设计资源配合CMOS摄像头实现视频的采集,视频进行插值处理后通过DDR2SDRAM实... 为了满足机载综合显示系统在数据存储量、显示实时性、芯片处理速度等方面的高要求,设计并实现一种机载综合显示系统。系统以FPGA为主要开发平台,利用其丰富的设计资源配合CMOS摄像头实现视频的采集,视频进行插值处理后通过DDR2SDRAM实现数据的高速缓存。在图像处理过程中同时生成当前所需叠加的仪表图形,最终将仪表图形叠加到视频中并送入显示器显示。经验证,系统可以在60帧/秒的视频上进行全姿态指示仪和全罗盘仪表图形的叠加,每个像素大小为16bit,支持的最大分辨率可达1920×1080。 展开更多

关键词 FPGA技术 机载综合显示系统 ddr2sdram存储器 图形叠加

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基于PCI Express总线的光纤检测系统 被引量：2

17

作者 代孝森 张晋宁 沈辉 《现代雷达》 CSCD 北大核心 2011年第1期79-82,共4页

提出了一种基于高速外设互联组件总线的光纤检测系统的设计和实现方案,介绍了系统的基本结构,对系统软/硬件设计的关键技术进行了探讨,研究了现场可编程门阵列内嵌的高速外设互联组件硬核,Windows下WDM驱动程序的开发和Win32应用程序的... 提出了一种基于高速外设互联组件总线的光纤检测系统的设计和实现方案,介绍了系统的基本结构,对系统软/硬件设计的关键技术进行了探讨,研究了现场可编程门阵列内嵌的高速外设互联组件硬核,Windows下WDM驱动程序的开发和Win32应用程序的设计。软硬件合理结合,较好地满足了系统对外接口的要求。在雷达系统实际应用中效果显著,极大地提高了系统的调试效率。 展开更多

关键词 高速外设互联组件 动态随机存储器 现场可编程门阵列 软件设计

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高清CMOS图像传感器多通道数据传输系统设计 被引量：14

18

作者 张克寒 李明伟 《仪表技术与传感器》 CSCD 北大核心 2017年第2期54-57,共4页

针对大面阵CMOS图像传感器多通道、高数据速率的特点,设计了一款图像数据实时传输系统。采用CMV4000产生图像数据,通过FPGA主控完成多通道图像数据的硬件恢复,将DDR2 SDRAM虚拟成为大容量异步先入先出队列(FIFO)作为高速缓存,通过USB3.... 针对大面阵CMOS图像传感器多通道、高数据速率的特点,设计了一款图像数据实时传输系统。采用CMV4000产生图像数据,通过FPGA主控完成多通道图像数据的硬件恢复,将DDR2 SDRAM虚拟成为大容量异步先入先出队列(FIFO)作为高速缓存,通过USB3.0接口将数据发送到PC端,PC端进行图像显示处理。通过样机实测,系统传输接口的速率达2.16 Gb/s,系统运行稳定流畅。文中为此类CMOS传感器图像的数据实时传输提供了一种解决方案。 展开更多

关键词 多通道 CMOS ddr2 sdram 数据传输

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数字示波器中海量存储的实现 被引量：3

19

作者 陈鑫 高礼忠 《电子测量技术》 2008年第8期193-195,共3页

对于数字示波器,除了模拟带宽、实时采样率之外,存储深度也是一个重要技术指标。本文介绍了存储深度的提高对于数字示波器测量、调试信号的影响和意义,提出了采用DDR2SDRAM作为海量存储介质的方案,并成功在FPGA上进行验证实现。

关键词 数字示波器 海量存储深度 ddr2 sdram

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一种高速大容量图像存储装置的关键技术研究 被引量：3

20

作者 赵俊江 张会新 《现代电子技术》 北大核心 2017年第12期144-147,151,共5页

针对高速图像采集存储要求,设计一种高速大容量存储装置。该装置以FPGA为主控芯片,以FPGA内部集成的高速串行收发器Rocket I/O GTP作为图像数据接收单元,通过FPGA控制MCB硬核操作2片DDR2 SDRAM构成兵乓缓存单元,以32片NAND FLASH组成的... 针对高速图像采集存储要求,设计一种高速大容量存储装置。该装置以FPGA为主控芯片,以FPGA内部集成的高速串行收发器Rocket I/O GTP作为图像数据接收单元,通过FPGA控制MCB硬核操作2片DDR2 SDRAM构成兵乓缓存单元,以32片NAND FLASH组成的阵列为存储单元,采用交叉双平面页编程技术对FLASH进行数据存储。实现了对3个速率为50 MB/s的图像通道数据实时采集存储。通过对FLASH阵列中的图像数据进行回读分析,测试结果无误,验证了系统功能的有效性和可靠性。 展开更多

关键词 图像存储 RocketI/OGTP ddr2sdram 乒乓缓存 交叉双平面页编程

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