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基于FPGA的高效CTC译码器设计与实现
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作者 吕闻 张盛兵 《微电子学与计算机》 CSCD 北大核心 2007年第12期125-127,130,共4页
讨论了基于增强型Max-log-MAP算法的高效CTC译码器的FPGA实现方案,使译码器在较低复杂度的前提下具有较高的性能。建立了C语言软件仿真平台下对算法的整体编译码过程进行了验证。在用FPGA实现时,对译码器进行了模块划分,通过对算法流程... 讨论了基于增强型Max-log-MAP算法的高效CTC译码器的FPGA实现方案,使译码器在较低复杂度的前提下具有较高的性能。建立了C语言软件仿真平台下对算法的整体编译码过程进行了验证。在用FPGA实现时,对译码器进行了模块划分,通过对算法流程分析,通过优化设计,采用了交织器、滑动窗等技术提高了译码速度,减少了译码所需的存储量。整个设计用VerilogHDL语言描述,最后成功在Altera的CycloneII进行了FPGA实现。 展开更多
关键词 增强型Max—log—MAP算法 ctc译码器 交织器 滑动窗算法
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自适应Turbo码译码器的设计与硬件实现
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作者 张永强 范金宁 《移动通信》 2010年第14期69-71,共3页
通过有效地结合Constant-Log-MAP算法和En-Max-Log-MAP算法实现资源复用,文章研究了SNR自适应卷积Turbo码译码器的硬件设计,给出了关键模块的逻辑结构,并进行了硬件实现。逻辑综合和时序仿真验证表明,该设计在译码器的性能优化与节省片... 通过有效地结合Constant-Log-MAP算法和En-Max-Log-MAP算法实现资源复用,文章研究了SNR自适应卷积Turbo码译码器的硬件设计,给出了关键模块的逻辑结构,并进行了硬件实现。逻辑综合和时序仿真验证表明,该设计在译码器的性能优化与节省片上资源方面有着优异的表现。 展开更多
关键词 SNR自适应ctc译码器 Constant-Log-MAP En-Max-Log-MAP 片上资源
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