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基于斩波技术的CMOS运算放大器失调电压的消除设计
被引量：
17
1
作者
吴孙桃
林凡
+1 位作者
郭东辉
李静
《半导体技术》
CAS
CSCD
北大核心
2003年第8期60-64,共5页
实现传感器系统的高分辨率,要求其内部运算放大器具有低失调电压和低噪声的性能,为此介绍了一种可减少运算放大器的失调电压和低频噪声的斩波技术,并基于该技术进行温度传感器中CMOS运算放大电路失调电压的消除设计,最后通过SPICE仿真...
实现传感器系统的高分辨率,要求其内部运算放大器具有低失调电压和低噪声的性能,为此介绍了一种可减少运算放大器的失调电压和低频噪声的斩波技术,并基于该技术进行温度传感器中CMOS运算放大电路失调电压的消除设计,最后通过SPICE仿真分析来权衡电路各参数的设定。
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关键词
斩波技术
cmos
运算
放大器
失调
电压
消除设计
集成电路
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职称材料
高增益高驱动能力的基准电压缓冲芯片的设计
2
作者
王敏聪
刘成
《现代电子技术》
北大核心
2024年第16期33-38,共6页
为了解决当前CMOS基准电压缓冲器在驱动大电容负载电路时所面临的可靠性问题和性能瓶颈,提出一种高增益高驱动能力的基准电压缓冲芯片。该芯片采用CMOS缓冲放大器,结构包括折叠式共源共栅输入级、轨至轨Class AB输出级和推挽输出缓冲级...
为了解决当前CMOS基准电压缓冲器在驱动大电容负载电路时所面临的可靠性问题和性能瓶颈,提出一种高增益高驱动能力的基准电压缓冲芯片。该芯片采用CMOS缓冲放大器,结构包括折叠式共源共栅输入级、轨至轨Class AB输出级和推挽输出缓冲级。设计中加入了修调电路、Clamp电路及ESD防护电路。芯片面积为2390μm×1660μm。在SMIC 0.18μm CMOS工艺下进行了前仿真、版图绘制及Calibre后仿真。前仿结果显示:当负载电容为10μF时,电路实现了126 dB的高开环增益和97°的相位裕度,同时PSRR超过131 dB,噪声为448 nV/Hz@100 Hz及1 nV/Hz@100 Hz。后仿结果与前仿结果基本一致。总体结果表明,该电路具有高增益、高电源抑制比及低噪声等特点,同时拥有很高的输出驱动能力。因此,所提出的基准电压缓冲芯片可以用于驱动如像素阵列等具有大电容负载的电路。
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关键词
基准
电压
缓冲
芯片
cmos电压缓冲运算放大器
ESD防护电路
芯片版图
高增益
高驱动能力
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职称材料
一种新型高速高分辨率采样保持电路
被引量：
1
3
作者
陈红卫
吴建辉
《应用科学学报》
CAS
CSCD
北大核心
2005年第3期274-277,共4页
提出了一种新型的基于运算放大器的开关电容采样保持电路结构.采用速度补偿解决了高速高分辨采样保持电路对放大器要求增益高和速度快之间的矛盾.具体设计了采样保持电路,特别设计了其中的快速时间连续电压比较器.用Chart0.35μmCMOS工...
提出了一种新型的基于运算放大器的开关电容采样保持电路结构.采用速度补偿解决了高速高分辨采样保持电路对放大器要求增益高和速度快之间的矛盾.具体设计了采样保持电路,特别设计了其中的快速时间连续电压比较器.用Chart0.35μmCMOS工艺,进行HSPICE仿真,结果表明,本文设计的采样保持电路的分辨率为10位,采样速率高于70MHz s.
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关键词
采样保持电路
高分辨率
高速
SPICE仿真
cmos
工艺
运算
放大器
电压
比较器
速度补偿
电路结构
开关电容
采样速率
设计
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职称材料
题名
基于斩波技术的CMOS运算放大器失调电压的消除设计
被引量：
17
1
作者
吴孙桃
林凡
郭东辉
李静
机构
厦门大学萨本栋微机电研究中心物理学系
出处
《半导体技术》
CAS
CSCD
北大核心
2003年第8期60-64,共5页
基金
国家自然科学基金项目(No:60076015)
福建省自然科学基金项目
福建省高新技术项目
文摘
实现传感器系统的高分辨率,要求其内部运算放大器具有低失调电压和低噪声的性能,为此介绍了一种可减少运算放大器的失调电压和低频噪声的斩波技术,并基于该技术进行温度传感器中CMOS运算放大电路失调电压的消除设计,最后通过SPICE仿真分析来权衡电路各参数的设定。
关键词
斩波技术
cmos
运算
放大器
失调
电压
消除设计
集成电路
Keywords
chopper technology
cmos
operating amplifier
DC offset
分类号
TN722.77 [电子电信—电路与系统]
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职称材料
题名
高增益高驱动能力的基准电压缓冲芯片的设计
2
作者
王敏聪
刘成
机构
上海大学微电子学院
出处
《现代电子技术》
北大核心
2024年第16期33-38,共6页
基金
国家重点研发计划项目(2021YFB3200600)
国家重点研发计划项目(2021YFB3200602)。
文摘
为了解决当前CMOS基准电压缓冲器在驱动大电容负载电路时所面临的可靠性问题和性能瓶颈,提出一种高增益高驱动能力的基准电压缓冲芯片。该芯片采用CMOS缓冲放大器,结构包括折叠式共源共栅输入级、轨至轨Class AB输出级和推挽输出缓冲级。设计中加入了修调电路、Clamp电路及ESD防护电路。芯片面积为2390μm×1660μm。在SMIC 0.18μm CMOS工艺下进行了前仿真、版图绘制及Calibre后仿真。前仿结果显示:当负载电容为10μF时,电路实现了126 dB的高开环增益和97°的相位裕度,同时PSRR超过131 dB,噪声为448 nV/Hz@100 Hz及1 nV/Hz@100 Hz。后仿结果与前仿结果基本一致。总体结果表明,该电路具有高增益、高电源抑制比及低噪声等特点,同时拥有很高的输出驱动能力。因此,所提出的基准电压缓冲芯片可以用于驱动如像素阵列等具有大电容负载的电路。
关键词
基准
电压
缓冲
芯片
cmos电压缓冲运算放大器
ESD防护电路
芯片版图
高增益
高驱动能力
Keywords
reference voltage buffer chip
cmos
voltage buffer operational amplifier
ESD protection circuit
chip layout
high gain
high driving ability
分类号
TN402-34 [电子电信—微电子学与固体电子学]
TN722-34 [电子电信—电路与系统]
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职称材料
题名
一种新型高速高分辨率采样保持电路
被引量：
1
3
作者
陈红卫
吴建辉
机构
东南大学电子工程系
出处
《应用科学学报》
CAS
CSCD
北大核心
2005年第3期274-277,共4页
基金
国家863计划资助项目(2002AA1Z1230)
文摘
提出了一种新型的基于运算放大器的开关电容采样保持电路结构.采用速度补偿解决了高速高分辨采样保持电路对放大器要求增益高和速度快之间的矛盾.具体设计了采样保持电路,特别设计了其中的快速时间连续电压比较器.用Chart0.35μmCMOS工艺,进行HSPICE仿真,结果表明,本文设计的采样保持电路的分辨率为10位,采样速率高于70MHz s.
关键词
采样保持电路
高分辨率
高速
SPICE仿真
cmos
工艺
运算
放大器
电压
比较器
速度补偿
电路结构
开关电容
采样速率
设计
Keywords
analog-to-digital converter
Op Amp
sample-and-hold
分类号
TN929.11 [电子电信—通信与信息系统]
TP274.2 [自动化与计算机技术—检测技术与自动化装置]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于斩波技术的CMOS运算放大器失调电压的消除设计
吴孙桃
林凡
郭东辉
李静
《半导体技术》
CAS
CSCD
北大核心
2003
17
在线阅读
下载PDF
职称材料
2
高增益高驱动能力的基准电压缓冲芯片的设计
王敏聪
刘成
《现代电子技术》
北大核心
2024
0
在线阅读
下载PDF
职称材料
3
一种新型高速高分辨率采样保持电路
陈红卫
吴建辉
《应用科学学报》
CAS
CSCD
北大核心
2005
1
在线阅读
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职称材料
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