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CMOS/SOI工艺触发器单元的单粒子实验验证与分析 被引量:4
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作者 李海松 蒋轶虎 +2 位作者 杨博 岳红菊 唐威 《北京理工大学学报》 EI CAS CSCD 北大核心 2018年第1期63-67,共5页
针对定制设计中的触发器单元,提出了一种双移位寄存器链单粒子实验验证方法,利用该方法对基于0.35μm CMOS/SOI工艺、普通结构设计的抗辐射触发器,分别在北京串列加速器核物理国家实验室和兰州重离子加速器国家实验室进行了单粒子实验.... 针对定制设计中的触发器单元,提出了一种双移位寄存器链单粒子实验验证方法,利用该方法对基于0.35μm CMOS/SOI工艺、普通结构设计的抗辐射触发器,分别在北京串列加速器核物理国家实验室和兰州重离子加速器国家实验室进行了单粒子实验.实验结果表明,该抗辐射触发器不仅对单粒子闩锁效应免疫,而且具有非常高的抗单粒子翻转的能力. 展开更多
关键词 抗辐射集成电路 双移位寄存器链 cmos/soi 单粒子效应 单粒子闩锁单 粒子翻转
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超高速CMOS/SOI51级环振电路的研制 被引量:2
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作者 奚雪梅 张兴 +2 位作者 倪卫华 阎桂珍 王阳元 《电子学报》 EI CAS CSCD 北大核心 2000年第5期44-46,共3页
利用CMOS/SOI工艺在 4英寸SIMOX材料上成功制备出沟道长度为 1μm、器件性能良好的CMOS/SOI部分耗尽器件和电路 ,从单管的开关电流比看 ,电路可以实现较高速度性能的同时又可以有效抑制泄漏电流 .所研制的 5 1级CMOS/SOI环振电路表现出... 利用CMOS/SOI工艺在 4英寸SIMOX材料上成功制备出沟道长度为 1μm、器件性能良好的CMOS/SOI部分耗尽器件和电路 ,从单管的开关电流比看 ,电路可以实现较高速度性能的同时又可以有效抑制泄漏电流 .所研制的 5 1级CMOS/SOI环振电路表现出优越的高速度性能 ,5V电源电压下单门延迟时间达到 92ps,同时可工作的电源电压范围较宽 ,说明CMOS/SOI技术在器件尺寸降低后将表现出比体硅更具吸引力的应用前景 . 展开更多
关键词 cmos/soi 环振电路 集成电路
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薄膜全耗尽CMOS/SOI──下一代超高速Si IC主流工艺 被引量:3
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作者 张兴 王阳元 《电子学报》 EI CAS CSCD 北大核心 1995年第10期139-143,共5页
本文较为详细地分析了薄膜全耗尽CMOS/SOI技术的优势和国内外TFCMOS/SOI器件和电路的发展状况,讨论了SOI技术今后发展的方向,得出了全耗尽CMOS/SOI技术将成为下一代超高速硅集成电路主流工艺的结论。
关键词 cmos/soi 全耗尽 集成电路 工艺
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深亚微米薄膜CMOS/SOI电路的集成器件线路模拟
4
作者 张兴 石涌泉 黄敞 《电子学报》 EI CAS CSCD 北大核心 1996年第2期96-99,共4页
开发了适用于薄膜亚微米、深亚微米CMOS/SOI电路的集成器件线路模拟软件,该模拟软件采用集成数值模型,将薄膜SOI器件的数值模拟与电路模拟有机地结合在一起,实现了薄膜亚微米、深亚微米CMOS/SOI电路的精确数值模... 开发了适用于薄膜亚微米、深亚微米CMOS/SOI电路的集成器件线路模拟软件,该模拟软件采用集成数值模型,将薄膜SOI器件的数值模拟与电路模拟有机地结合在一起,实现了薄膜亚微米、深亚微米CMOS/SOI电路的精确数值模拟,利用这一软件较为详细地分析了硅层厚度为50~400nm、沟道长度为0.15~1.0μm的CMOS/SOI环形振荡器电路,使我们对深亚微米薄膜CMOS/SOI环振的特性及工作机理有了较为清晰的认识,模拟结果与实验结果进行了对照,两者吻合得较好。 展开更多
关键词 cmos/soi 集成数值模型 环振 薄膜电路
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CMOS/SOI电路模拟与参数提取
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作者 甘学温 奚雪梅 +1 位作者 李益民 王阳元 《电子学报》 EI CAS CSCD 北大核心 1995年第11期96-98,共3页
SOI-MOSFET主要模型参数得到一致的提取,因而该模型嵌入SPICE后能保证CMOS/SOI电路的正确模拟工作,从CMOS/SOI器件和环振电路的模拟结果和实验结果看,两者符合得较好,说明我们所采用的SOIMOS... SOI-MOSFET主要模型参数得到一致的提取,因而该模型嵌入SPICE后能保证CMOS/SOI电路的正确模拟工作,从CMOS/SOI器件和环振电路的模拟结果和实验结果看,两者符合得较好,说明我们所采用的SOIMOSFET器件模型及其参数提取都是成功的。 展开更多
关键词 cmos/soi电路横拟 器件参数提取
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