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基于DSP Builder的DDS设计及其FPGA实现 被引量：7
1
作者 王杰 马玲 +1 位作者 刘苇娜 王子旭 《现代电子技术》 2006年第14期11-12,15,共3页
直接数字合成器(DDS)具有较高的频率分辨率,可以实现频率快速切换,并且在频率改变时能保持相位的连续,很容易实现频率、相位和幅度的数字调制。从DDS的原理出发,介绍了一种基于DSP Builder查找表结构的DDS设计,并通过QuartusⅡ完成对FPG... 直接数字合成器(DDS)具有较高的频率分辨率,可以实现频率快速切换,并且在频率改变时能保持相位的连续,很容易实现频率、相位和幅度的数字调制。从DDS的原理出发,介绍了一种基于DSP Builder查找表结构的DDS设计,并通过QuartusⅡ完成对FPGA器件的配置下载过程。可编程逻辑器件具有器件规模大、工作速度快及可编程的硬件特点,非常适合用来实现DDS。 展开更多
关键词 直接数字合成器 现场可编程门阵列 DSP builder Quartus Ⅱ
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从Simulink模型自动生成VHDL代码——基于DSP Builder的FPGA设计流程 被引量：7
2
作者 张志亮 赵刚 齐星刚 《现代电子技术》 2004年第23期4-6,共3页
介绍了基于 Altera提供的 DSP Builder开发工具从 Simulink模型自动生成 VHDL 代码的一种新的 F PGA设计流程 ,并基于此流程实现了一个 7阶 F IR数字低通滤波器。
关键词 DSP builder SIMULINK 自动生成 fpga设计流程
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基于FPGA的MobileNetV1目标检测加速器设计 被引量：3
3
作者 严飞 郑绪文 +2 位作者 孟川 李楚 刘银萍 《现代电子技术》 北大核心 2025年第1期151-156,共6页
卷积神经网络是目标检测中的常用算法,但由于卷积神经网络参数量和计算量巨大导致检测速度慢、功耗高,且难以部署到硬件平台,故文中提出一种采用CPU与FPGA融合结构实现MobileNetV1目标检测加速的应用方法。首先,通过设置宽度超参数和分... 卷积神经网络是目标检测中的常用算法,但由于卷积神经网络参数量和计算量巨大导致检测速度慢、功耗高,且难以部署到硬件平台,故文中提出一种采用CPU与FPGA融合结构实现MobileNetV1目标检测加速的应用方法。首先,通过设置宽度超参数和分辨率超参数以及网络参数定点化来减少网络模型的参数量和计算量;其次,对卷积层和批量归一化层进行融合,减少网络复杂性,提升网络计算速度;然后,设计一种八通道核间并行卷积计算引擎,每个通道利用行缓存乘法和加法树结构实现卷积运算;最后,利用FPGA并行计算和流水线结构,通过对此八通道卷积计算引擎合理的复用完成三种不同类型的卷积计算,减少硬件资源使用量、降低功耗。实验结果表明,该设计可以对MobileNetV1目标检测进行硬件加速,帧率可达56.7 f/s,功耗仅为0.603 W。 展开更多
关键词 卷积神经网络 目标检测 fpga MobileNetV1 并行计算 硬件加速
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基于国产DSP和FPGA的高速信号处理板硬件电路设计 被引量：2
4
作者 孙艳萍 边晨通 +1 位作者 屈文涛 宋淑军 《仪表技术与传感器》 北大核心 2025年第5期33-38,共6页
针对目前高速信号处理板多选用国外芯片,国产化程度较低的问题,文中基于DSP和FPGA芯片完成了高速信号处理板国产化设计。首先考虑高速信号处理板应用于人工智能、图像处理等领域,是一种高精度和复杂运算的场景,因此选择DSP芯片FTDOC35BB... 针对目前高速信号处理板多选用国外芯片,国产化程度较低的问题,文中基于DSP和FPGA芯片完成了高速信号处理板国产化设计。首先考虑高速信号处理板应用于人工智能、图像处理等领域,是一种高精度和复杂运算的场景,因此选择DSP芯片FTDOC35BB_FT_M6678为主设计信号处理模块,选择FPGA芯片FMQL45T900为主设计控制单元模块;然后在CANDENCE软件中进一步采用分布式设计硬件电路,完成了高速信号接口模块、DDR3存储模块、EMIF模块的电路设计;最后使用CCS5.5集成开发环境对高速信号处理板各个接口及外设进行了测试。测试指标均达到要求,证明该高速信号处理板国产化设计切实可行,加速了高速信号处理板的国产化进程。 展开更多
关键词 国产化 fpga DSP 高速信号
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DSPbuilder在基于FPGA的DSP设计中的应用
5
作者 卢青 丁恩杰 张余峰 《工矿自动化》 北大核心 2005年第z1期99-101,共3页
本文介绍了一种基于FPGA的设计DSP的全新的设计软件DSPbuilder以及它的功能与特点,并且结合具体实例说明了设计流程.
关键词 DSPbuilder fpga DSP 系统
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基于FPGA的脉冲激光告警系统设计
6
作者 张瑞 武振涛 +3 位作者 薛鹏 杨帅 徐承雨 王志斌 《激光杂志》 北大核心 2025年第6期29-35,共7页
针对脉冲激光被广泛应用于编码通信、精确制导、高功率毁伤等激光武器的情况,且目前缺少对脉冲激光威胁进行有效告警的措施,为此提出了一种基于FPGA的脉冲激光告警系统。通过增加积分时间在帧周期内的占比来提高脉冲捕获概率,采用图像... 针对脉冲激光被广泛应用于编码通信、精确制导、高功率毁伤等激光武器的情况,且目前缺少对脉冲激光威胁进行有效告警的措施,为此提出了一种基于FPGA的脉冲激光告警系统。通过增加积分时间在帧周期内的占比来提高脉冲捕获概率,采用图像差分提高信噪比,并快速提取光斑坐标,最后以查表的形式读出来袭激光的方位、俯仰角度。利用FPGA并行处理的优势,能保证对脉冲激光的实时响应。实验结果表明,该系统在220 mW@1064 nm激光器模拟输入的条件下,对脉冲宽度范围为100 ns~100μs的脉冲激光实现告警,测量角度误差小于0.3°,对单脉冲的捕获概率能达到97%,并能实现1064 nm、1313 nm、1550 nm等常用激光波长的识别。 展开更多
关键词 激光告警 脉冲激光 数据处理 fpga
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基于DSP Builder的巴克码检出设计及FPGA实现 被引量：2
7
作者 任璟 张安堂 岳鸿鹏 《电光与控制》 北大核心 2010年第11期86-88,共3页
巴克码是最常用的帧同步码组。为了实现巴克码组的有效检出,利用DSP Builder设计了一种新的13位巴克码识别器电路。在Matlab/Simulink中对设计的电路进行了纯数字仿真,然后将设计的系统载入到FPGA芯片中,运用硬件在回路仿真技术进行半... 巴克码是最常用的帧同步码组。为了实现巴克码组的有效检出,利用DSP Builder设计了一种新的13位巴克码识别器电路。在Matlab/Simulink中对设计的电路进行了纯数字仿真,然后将设计的系统载入到FPGA芯片中,运用硬件在回路仿真技术进行半实物仿真。结果表明,基于DSP Builder设计的巴克码检出电路简单易行、稳定可靠,达到了预期的要求。 展开更多
关键词 信号传输 帧同步 巴克码识别器 DSP builder 硬件在回路仿真
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基于正规基的大规模S盒FPGA设计与实现
8
作者 张磊 李国元 +2 位作者 洪睿鹏 王建新 肖超恩 《密码学报(中英文)》 北大核心 2025年第4期854-869,共16页
传统上的分组密码S盒硬件实现采用查表法,其实现效果受到芯片资源的限制.针对16-bit大规模S盒在FPGA硬件实现中资源消耗大的问题,本文提出了基于复合域中正规基的S盒构造方法,研究使用较少的硬件资源实现16-bit S盒.首先,设计了基于复... 传统上的分组密码S盒硬件实现采用查表法,其实现效果受到芯片资源的限制.针对16-bit大规模S盒在FPGA硬件实现中资源消耗大的问题,本文提出了基于复合域中正规基的S盒构造方法,研究使用较少的硬件资源实现16-bit S盒.首先,设计了基于复合域的16-bit S盒构造实现方案,构建了线性的同构映射矩阵及其逆矩阵.其次,通过映射矩阵使有限域GF(2^(16))的乘法逆转换到复合域GF((((2^(2))^(2))^(2))^(2))上,进而将非线性的高维乘法逆简化为低维子域运算.然后,通过分析各级复合域不同参数对S盒实现的影响,筛选最优参数.最后,结合所提出的16-bit S盒构造实现框架,本文利用Xilinx公司的Vivado开发工具,以MK-3算法的16-bit S盒为例进行了FPGA仿真验证与性能分析.结果表明,本文构造方法实现的MK-3算法S盒需要186个LUT,时钟频率为114.129 MHz,在时钟频率/LUT的性能指标下达到了0.61360.同目前已公开文献同类方法中的最优实现性能0.43538相比,性能提升了40.93%.本文的16-bit S盒实现方案能够在降低硬件资源消耗的同时保持密码算法较高的运行频率,对有基于有限域构造的S盒的高效软硬件实现具有一定的参考价值. 展开更多
关键词 大规模S盒 复合域 正规基 MK-3算法 fpga
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基于FPGA-STM32的光谱高速采集与传输系统
9
作者 商祥年 黄善凯 +1 位作者 刘惠萍 程凯 《仪表技术与传感器》 北大核心 2025年第11期37-41,共5页
微型化是当前光谱探测仪器发展的重要趋势,为了解决微型光谱仪工作时采集传输速率较慢,传输途径较为单一,无法针对特定需求进行扩展等问题,提出了一种基于FPGA和STM32的光谱高速采集与传输系统。系统采用FPGA-STM32双核心架构,实现对CMO... 微型化是当前光谱探测仪器发展的重要趋势,为了解决微型光谱仪工作时采集传输速率较慢,传输途径较为单一,无法针对特定需求进行扩展等问题,提出了一种基于FPGA和STM32的光谱高速采集与传输系统。系统采用FPGA-STM32双核心架构,实现对CMOS图像传感器、AD芯片的时序驱动。系统通过串口和高速USB端口将数据传输到上位机,进行实时高速地采集、显示和处理。同时利用SPI将数据传输到STM32进行缓存和进一步处理,再利用STM32内置的全速USB端口将数据传输到上位机。实验结果表明:系统能够高速地采集和传输光谱数据,并且具备多条独立传输通道,保证了良好的工作稳定性和数据完整性。此外,系统还可以根据特定需求进行灵活扩展,为当前光谱探测仪器的发展提供新的思路。 展开更多
关键词 fpga STM32 微型光谱仪 高速采集
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基于FPGA的4K视频板间传输显示系统
10
作者 严飞 蒋晔 +2 位作者 张丽娟 王鹏 刘银萍 《液晶与显示》 北大核心 2025年第8期1145-1153,共9页
随着4K超高清视频技术在医疗、安防等领域的广泛应用,现场可编程门阵列(FPGA)常被协同用于处理大型的超高清视频图像任务。针对使用高速收发器8b/10b编码方式的数据带宽利用率低的问题,提出一种基于FPGA的4K视频板间传输显示系统。该系... 随着4K超高清视频技术在医疗、安防等领域的广泛应用,现场可编程门阵列(FPGA)常被协同用于处理大型的超高清视频图像任务。针对使用高速收发器8b/10b编码方式的数据带宽利用率低的问题,提出一种基于FPGA的4K视频板间传输显示系统。该系统设计以FPGA为核心,结合STM32微控制器与GSV2011编解码芯片实现对数据传输方式的控制,并对GTX的硬件接口进行了优化。多通道GTX收发器使用64b/66b编码方式,根据4K视频流时序设计编码发送、解码接收逻辑实现传输功能。此外,设计多通道数据同步、DDR多帧缓存等逻辑,有效解决因信道偏斜导致的多通道数据传输偏差与读写时钟速率不匹配导致的显示帧撕裂问题。实验结果表明,该系统能够高效稳定地实现4K@60 Hz视频的板间传输实时显示,硬件资源消耗较低,且相较8b/10b编码的有效带宽减少3.12 Gb/s,为多个FPGA协同处理超高清视频场景提供灵活高效、成本更低的传输方案,具有良好的工程应用价值。 展开更多
关键词 fpga 4K视频 GTX收发器 64b/66b编码
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基于ARM+FPGA的机载信息管理处理机设计
11
作者 王健 郭霖佯 +4 位作者 何自豪 周立辉 陈家福 李欣琦 周浩 《火力与指挥控制》 北大核心 2025年第4期85-92,共8页
为实现飞机在执行战术任务时对格式化链路消息的接收处理、态势信息综合处理、载机平台信息采集、指令应答与信息回传、雷达目标定位等功能,设计一种基于ARM+FPGA架构机载信息管理处理机。介绍机载信息管理处理机具体功能和应用,从硬件... 为实现飞机在执行战术任务时对格式化链路消息的接收处理、态势信息综合处理、载机平台信息采集、指令应答与信息回传、雷达目标定位等功能,设计一种基于ARM+FPGA架构机载信息管理处理机。介绍机载信息管理处理机具体功能和应用,从硬件和软件设计两个方面对系统结构进行详细阐述,完成机载信息综合处理模块、RS422和ARINC429相关接口的软硬件设计工作,使得机载信息管理处理机能够实时处理机载电台、显控机、雷达、导航系统等相关设备的信息,并根据系统通信协议的要求完成各类型系统数据的实时接收、解析、检索和发送任务。通过对系统的联调联试和测试工作,发现达到系统各项指标要求并验证了其可行性和稳定性。 展开更多
关键词 机载处理机 RS422 ARINC429 fpga ARM
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基于FPGA的SM4异构加速系统
12
作者 张全新 李可 +1 位作者 邵雨洁 谭毓安 《信息网络安全》 北大核心 2025年第7期1021-1031,共11页
国密SM4算法是WAPI无线网络标准中广泛使用的加密算法。目前,针对SM4加解密的研究主要集中于硬件实现结构优化,以提高吞吐量和安全性。同时,大数据和5G通信技术的发展对数据加解密的带宽和实时性提出了更高的要求。基于此背景,文章提出... 国密SM4算法是WAPI无线网络标准中广泛使用的加密算法。目前,针对SM4加解密的研究主要集中于硬件实现结构优化,以提高吞吐量和安全性。同时,大数据和5G通信技术的发展对数据加解密的带宽和实时性提出了更高的要求。基于此背景,文章提出一种基于FPGA的SM4异构加速系统,使用硬件实现SM4算法,并优化加解密性能;采用流式高速数据传输架构,支持多个SM4核并行工作,充分利用系统带宽;设计可配置接口,连接SM4与传输架构,提供足够的灵活性。系统于Xilinx XCVU9P FPGA上实现,支持随时更改SM4的负载和模式。测试得到SM4的最大工作频率为462 MHz,系统吞吐量高达92 Gbit/s,延迟仅为266μs。实验结果表明,与其他现有工作相比,该系统能获得更高的SM4工作频率和系统吞吐量,满足高带宽和低延迟的SM4加速需求。 展开更多
关键词 国密SM4算法 fpga 硬件加速 传输架构
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基于FPGA的大点数脉压模块设计与实现
13
作者 刘国满 刘雨玄 +3 位作者 付琦允 冯易 汪奕 王俊岭 《北京理工大学学报》 北大核心 2025年第5期539-546,共8页
针对雷达系统长脉宽信号的大点数脉冲压缩内存占用过大、计算过程复杂的问题,提出一种可避免数据转置的脉冲压缩处理流程及一种适用于FPGA的实现方法和延时计算模型,并以此为基础设计和实现了支持128K点窗长的脉冲压缩模块.实验结果表明... 针对雷达系统长脉宽信号的大点数脉冲压缩内存占用过大、计算过程复杂的问题,提出一种可避免数据转置的脉冲压缩处理流程及一种适用于FPGA的实现方法和延时计算模型,并以此为基础设计和实现了支持128K点窗长的脉冲压缩模块.实验结果表明,模块处理延时低于1700μs,可支持最大脉宽4 ms、带宽10 MHz的信号,与传统IP核方法相比,减少至少50%处理延时和至少40%内存资源消耗,仅适度增加了乘法器资源消耗,提高了大点数脉压算法在FPGA中的可实现性. 展开更多
关键词 脉冲压缩 fpga 大点数FFT FFT级联
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一种用于高性能FPGA的多功能I/O电路
14
作者 罗旸 刘波 +3 位作者 曹正州 谢达 张艳飞 单悦尔 《半导体技术》 北大核心 2025年第3期265-272,共8页
为了满足等效系统门数为亿门级现场可编程门阵列(FPGA)的高速率、多功能数据传输需求,设计了一种用于高性能FPGA的多功能输入输出(I/O)电路,工作电压为0.95 V,单个I/O电路的最高数据传输速率为2 Gbit/s。通过在输入逻辑电路中设计同一... 为了满足等效系统门数为亿门级现场可编程门阵列(FPGA)的高速率、多功能数据传输需求,设计了一种用于高性能FPGA的多功能输入输出(I/O)电路,工作电压为0.95 V,单个I/O电路的最高数据传输速率为2 Gbit/s。通过在输入逻辑电路中设计同一边沿流水技术的双倍数据速率(DDR)电路,可以使数据不仅能在相同的时钟沿输出,而且能在同一个时钟周期输出。通过分级采样结合时钟分频和偏移技术,仅需4个时钟周期即可完成8∶1数据的转换。另外,该I/O电路还可以对数据输入输出的延时进行调节,采用粗调和细调相结合的方式,共提供512个延时抽头,并且延时的分辨率达到4 ps。仿真和实测结果表明,该多功能I/O电路能为高性能FPGA提供灵活、多协议的高速数据传输功能。 展开更多
关键词 现场可编程门阵列(fpga) 输入输出(I/O)电路 多电平标准 双倍数据速率(DDR) 串并转换器(SerDes)
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基于FPGA的功率器件封装缺陷实时检测
15
作者 谭会生 吴文志 张杰 《半导体技术》 北大核心 2025年第10期1048-1056,共9页
针对基于机器视觉的功率器件封装缺陷检测技术实时性差、计算资源消耗较高的问题,基于现场可编程门阵列(FPGA)设计了一种功率器件封装缺陷实时检测器。首先,提出一种基于深度可分离卷积(DSConv)的轻量化Mini-DSCNet卷积网络,使用深度卷... 针对基于机器视觉的功率器件封装缺陷检测技术实时性差、计算资源消耗较高的问题,基于现场可编程门阵列(FPGA)设计了一种功率器件封装缺陷实时检测器。首先,提出一种基于深度可分离卷积(DSConv)的轻量化Mini-DSCNet卷积网络,使用深度卷积和逐点卷积代替标准卷积。仿真结果表明,该模型的浮点运算量(FLOPs)和参数量(Params)分别约为MobileNetV1的4.375%和0.021%,准确率约为91.80%。其次,采用定点量化算法将浮点数权重量化为有符号定点数,测试结果表明,其平均误差约为0.483%。最后,采用多通道并行流水线架构优化设计,降低了系统的资源消耗,提高了系统的处理速度。实验结果显示,在100 MHz时钟频率下,该检测器的推理速度分别约为CPU的17.10倍、GPU的2.47倍,显著提升了功率器件封装缺陷检测的实时性。 展开更多
关键词 功率器件 封装缺陷检测 Mini-DSCNet卷积网络 现场可编程门阵列(fpga) 硬件加速
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基于FPGA和双ADC架构的L频段信号采集回放系统
16
作者 王忠勇 谌毅炜 《仪表技术与传感器》 北大核心 2025年第10期84-90,共7页
为实现L频段(950~2150 MHz)信号的实时分析与后续测试,设计了一种以FPGA和ADC/DAC为核心架构的信号采集与回放系统。系统采用2块高精度ADC,分别用于全景频谱分析和指定频段高分辨率采集,以满足不同应用场景的需求。宽带采集数据和中频... 为实现L频段(950~2150 MHz)信号的实时分析与后续测试,设计了一种以FPGA和ADC/DAC为核心架构的信号采集与回放系统。系统采用2块高精度ADC,分别用于全景频谱分析和指定频段高分辨率采集,以满足不同应用场景的需求。宽带采集数据和中频采集数据通过FPGA内部初步处理后,AXI DataMover通过PCIe接口将高速数据流传输至主板的DDR中缓存并最终存入NVMe固态硬盘,回放时通过PCIe接口将数据传输至DAC进行回放。以双音信号为测试对象,完成了系统功能测试,并将测试结果与芯片手册进行对比。结果表明:系统在功能和稳定性方面均符合设计目标,为L频段信号的分析与测试提供了一种高效可靠的解决方案。 展开更多
关键词 L频段 ADC/DAC 采集回放 fpga DataMover
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基于FPGA的改进Sobel算子图像实时边缘检测系统
17
作者 于波 田亚洲 +1 位作者 任金贝 李华宇 《仪表技术与传感器》 北大核心 2025年第3期116-121,共6页
为了解决嵌入式软件不能对图像进行实时处理以及对带有噪声的图像处理效果不佳的问题,设计了基于改进Sobel算子的图像实时边缘检测系统,该系统在传统Sobel算子的基础上增加了检测方向和角度模板,并结合SCCB传输协议进行实时图像边缘检测... 为了解决嵌入式软件不能对图像进行实时处理以及对带有噪声的图像处理效果不佳的问题,设计了基于改进Sobel算子的图像实时边缘检测系统,该系统在传统Sobel算子的基础上增加了检测方向和角度模板,并结合SCCB传输协议进行实时图像边缘检测,进一步提高视频图像的传输速度和质量。系统以FPGA作为数字主控核心,使用OV5640摄像头采集图像,将采集的图像数据缓存到视频图像处理模块,对该模块进行色彩空间转换和Sobel边缘检测工作,将边缘检测的图像数据缓存到SDRAM读写控制模块,VGA驱动模块从SDRAM中读取数据并控制VGA显示器对边缘检测结果进行显示。实验结果表明:该系统能够完成对图像边缘检测的实时快速精确识别,相较于传统的Sobel算法,改进后的算法在处理复杂图像和噪声点较多的图像方面更有优势,适合低延时以及噪声干扰较为严重的场合。 展开更多
关键词 实时边缘检测 fpga SCCB SOBEL算子 SDRAM
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基于FPGA的PCB缺陷检测系统设计与实现
18
作者 任喜伟 刘嘉玥 +1 位作者 余杰 孙悦 《仪表技术与传感器》 北大核心 2025年第3期58-64,71,共8页
为应对传统印刷电路板(PCB)缺陷检测方法存在的检测速度慢、准确率低等问题,设计了基于FPGA的PCB缺陷检测系统。系统采用CMOS OV5640传感器采集PCB图像数据,并对采集的图像进行灰度化、滤波及边缘检测等图像预处理。提出了改进的灰度拉... 为应对传统印刷电路板(PCB)缺陷检测方法存在的检测速度慢、准确率低等问题,设计了基于FPGA的PCB缺陷检测系统。系统采用CMOS OV5640传感器采集PCB图像数据,并对采集的图像进行灰度化、滤波及边缘检测等图像预处理。提出了改进的灰度拉伸算法,通过整体线性拉伸灰度值,图像对比度显著增强;提出了改进的边缘检测算法,扩展传统Sobel边缘检测2算子至8算子边缘检测,提高图像边缘信息的清晰度,增强图像分析与识别的准确性。系统将预处理后的PCB图像和标准模板图像存储在SDRAM中,采用背景差分比算法进行缺陷检测,并选用EP4CE10F17C8N芯片实现系统各模块的FPGA设计。实验结果表明:改进的检测系统在检测精度方面较其他方法显著提升,且相比于PCB缺陷检测软件,FPGA硬件处理速度明显提高。 展开更多
关键词 图像处理 fpga 背景差分算法 缺陷检测
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基于FPGA的SATA图像采集系统的设计与实现
19
作者 王振 黄春平 陈威威 《电子测量技术》 北大核心 2025年第14期26-34,共9页
本文设计并实现了一个基于FPGA的高速图像采集与存储系统,旨在解决高速图像数据采集和存储过程中的性能瓶颈。系统通过Camera Link接口接收高速图像数据,并利用FPGA实现SATA协议控制器以高效稳定地存储至SATA硬盘。图像采集模块采用Xili... 本文设计并实现了一个基于FPGA的高速图像采集与存储系统,旨在解决高速图像数据采集和存储过程中的性能瓶颈。系统通过Camera Link接口接收高速图像数据,并利用FPGA实现SATA协议控制器以高效稳定地存储至SATA硬盘。图像采集模块采用Xilinx FPGA内置的LVDS收发器及特定原语(如IDELAYE3和ISERDESE3)直接处理Camera Link协议,取代传统专用芯片。在MicroBlaze中设计了一个轻量级文件系统,以实现SATA控制器的配置和数据流的控制。通过集成以太网模块,系统能够实时导出数据至上位机。开发了C#上位机软件,提供可视化的文件系统界面,用于管理和监控磁盘及文件操作。实验验证表明,SATA控制器实现了高达504.8 MB/s的写入速率和542.0 MB/s的读取速率。在400 MB/s的数据采集速率下,系统表现出了优异的性能和可靠性,适用于高性能图像采集与存储应用。 展开更多
关键词 fpga 图像采集 SATA 高速存储 文件系统
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基于三维混沌系统的图像加密及FPGA实现
20
作者 闫少辉 姜嘉伟 崔宇 《计算机工程与科学》 北大核心 2025年第4期686-694,共9页
提出一种基于FPGA的混沌系统实现方法,并成功将其应用在图像加密任务。基于改进的Bao混沌系统,利用改进的欧拉算法对混沌系统进行离散化,使用Verilog语言进行硬件设计;通过寄存器传输级RTL电路及ModelSim时序仿真验证混沌系统在软件设... 提出一种基于FPGA的混沌系统实现方法,并成功将其应用在图像加密任务。基于改进的Bao混沌系统,利用改进的欧拉算法对混沌系统进行离散化,使用Verilog语言进行硬件设计;通过寄存器传输级RTL电路及ModelSim时序仿真验证混沌系统在软件设计层面的准确性。利用离散化的混沌序列在FPGA中对图像进行加密和相应密钥的解密,并通过VGA正确显示,验证了加密方案的可行性。在硬件层面成功实现混沌系统及图像加解密,为混沌加密技术在FPGA中的进一步应用奠定了基础。 展开更多
关键词 混沌系统 fpga实现 Verilog设计 图像加密
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