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基于网络处理器及协处理器的高速网IDS的研究 被引量:5
1
作者 范华春 王颖 +3 位作者 杨彬 李雪莹 陈宇 许榕生 《计算机工程与应用》 CSCD 北大核心 2005年第1期124-126,138,共4页
随着高速网技术的不断成熟,网络数据的传输速度与传统IDS(入侵检测系统)的检测能力之间的差距越来越大,已成为在高速网络环境中实现网络安全所要解决的一个重要问题。文章提出了一种基于网络处理器及应用层匹配查找协处理器的硬件解决方... 随着高速网技术的不断成熟,网络数据的传输速度与传统IDS(入侵检测系统)的检测能力之间的差距越来越大,已成为在高速网络环境中实现网络安全所要解决的一个重要问题。文章提出了一种基于网络处理器及应用层匹配查找协处理器的硬件解决方案,来实现高速网络环境的入侵检测。此架构易于升级,针对于实现千兆带宽的网络入侵检测具有很强的应用前景。 展开更多
关键词 高速 IDS 网络处理器 处理器
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基于DSP高速信号处理器的空间电压矢量PWM技术的研究与实现 被引量:21
2
作者 王晶晶 徐国卿 +2 位作者 徐铁柱 程曙 王麾 《电力系统及其自动化学报》 CSCD 2002年第6期27-31,共5页
本文详述了空间电压矢量 PWM的原理 ,并对每一扇区矢量作用时间进行推导 ,最后在 TI公司生产的TMS3 2 0 F2 40 DSP高速信号处理器上进行了实现 。
关键词 电力电子逆变技术 正弦脉宽调制 DSP 高速信号处理器 空间电压矢量 PWM技术
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基于交叉开关互连的多核堆栈处理器架构设计
3
作者 刘欢庆 周永录 +1 位作者 刘宏杰 代红兵 《计算机工程与设计》 北大核心 2024年第7期2212-2219,共8页
为满足堆栈处理器对于并行化程序应用的需求,提出一种多核堆栈处理器架构。在单核堆栈处理器的基础上,以交叉开关作为核间互连结构,通过对指令集、高速缓存器、一致性协议以及中断机制的设计,可在一个时钟周期内完成取指、译码、执行、... 为满足堆栈处理器对于并行化程序应用的需求,提出一种多核堆栈处理器架构。在单核堆栈处理器的基础上,以交叉开关作为核间互连结构,通过对指令集、高速缓存器、一致性协议以及中断机制的设计,可在一个时钟周期内完成取指、译码、执行、核间数据传输和中断响应操作。在Xilinx FPGA芯片上进行单核、双核和四核堆栈处理器的实现,通过矩阵乘法计算进行性能实验验证,在100 MHz时钟频率的情况下,四核堆栈处理器的最大性能相当于单核堆栈处理器的3.99倍。实验结果表明,基于交叉开关互连的多核堆栈处理器架构可较好发挥多核堆栈处理器中每一个核心的性能。 展开更多
关键词 堆栈处理器 多核处理器 交叉开关 高速缓存 一致性协议 中断控制器 现场可编程门阵列
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轻小型高速信号处理器及其在飞行器中的应用
4
作者 李军伟 朱振福 +1 位作者 刘忠领 陈良瑜 《红外与激光工程》 EI CSCD 北大核心 2007年第z2期241-245,共5页
基于多DSP的高速信号处理器,研制成功了一种飞行器载的轻小型、高精度电视跟踪观测设备,详细介绍了该设备的工作原理、主要软硬件组成及其推广应用价值。
关键词 高速信号处理器 图像压缩 大容量存储 跟踪观测设备
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密码嵌入式处理器中高速缓存的研究与设计
5
作者 王晓燕 杨先文 陈海民 《计算机工程与设计》 CSCD 北大核心 2012年第8期3000-3005,共6页
为了提高密码嵌入式处理器的运行效率,给出了一种哈佛结构的高速缓存(Cache)设计,包括指令Cache(iCache)和数据Cache(dCache)。采用双端口RAM和较低的硬件开销设计了标签存储器和指令/数据存储器,并描述了iCache和dCache控制流程。实现... 为了提高密码嵌入式处理器的运行效率,给出了一种哈佛结构的高速缓存(Cache)设计,包括指令Cache(iCache)和数据Cache(dCache)。采用双端口RAM和较低的硬件开销设计了标签存储器和指令/数据存储器,并描述了iCache和dCache控制流程。实现时配置iCache容量为4KB、dCache容量为8KB,并完成了向密码嵌入式处理器的集成。FPGA验证结果表明其满足处理器的应用要求;性能分析结果表明,采用Cache比处理器直接访问主存在速度上至少提高5.26倍。 展开更多
关键词 密码嵌入式处理器 哈佛结构 高速缓存 双端口RAM 现场可编程逻辑
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一种基于网络处理器的高速信息处理系统
6
作者 石曙东 李之棠 《计算机工程与应用》 CSCD 北大核心 2002年第6期140-141,176,共3页
基于网络处理器的高速信息处理系统是一个用网络处理器硬件来实现网络实时数据采集和高速信息审计的专用设备,可为公安、安全、政府、教育和企业等提供一个对网上传播信息进行信息审计的工具,文中具体介绍了系统的硬件结构、软件结构和... 基于网络处理器的高速信息处理系统是一个用网络处理器硬件来实现网络实时数据采集和高速信息审计的专用设备,可为公安、安全、政府、教育和企业等提供一个对网上传播信息进行信息审计的工具,文中具体介绍了系统的硬件结构、软件结构和性能指标。 展开更多
关键词 网络处理器 信息审计 高速信息处理系统 计算机网络
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基于软件的网络处理器的路由高速缓存算法研究 被引量:2
7
作者 刘祯 刘斌 郑凯 《软件学报》 EI CSCD 北大核心 2007年第12期3115-3123,共9页
路由器需要以较低的代价灵活、高速地实现路由查找这一基本功能.为网络处理器设计了一种基于软件的路由查找高速缓存算法.网络处理器片上高速存储器中的一部分空间被划分出来,由指令代码来维护一个路由查找结果缓存表.通过选择合适的哈... 路由器需要以较低的代价灵活、高速地实现路由查找这一基本功能.为网络处理器设计了一种基于软件的路由查找高速缓存算法.网络处理器片上高速存储器中的一部分空间被划分出来,由指令代码来维护一个路由查找结果缓存表.通过选择合适的哈希函数,平衡表项之间的冲突并刷新复杂度,该算法可以缩短路由查找的延迟,减少多处理单元对存储器总线的竞争,为其他网络应用提供更多的处理时间.基于真实网络流量的实验表明,即便每个处理单元中仅有少量表项,网络处理器的吞吐量仍然可以得到有效的提升. 展开更多
关键词 路由高速缓存 网络处理器 路由查找
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基于网络处理器IXP2400的组播包高速转发技术 被引量:1
8
作者 何小明 张永福 戴紫彬 《电讯技术》 2007年第4期56-59,共4页
传统的IP报文的组播技术,由于在处理过程中需要把整个报文的内容报文复制多份,因此处理器需要对缓存报文的外部存储空间进行多次I/O操作,这严重制约了当前处理器,特别是网络处理器的高速报文处理能力,转发效率不高。为此,提出了一种新... 传统的IP报文的组播技术,由于在处理过程中需要把整个报文的内容报文复制多份,因此处理器需要对缓存报文的外部存储空间进行多次I/O操作,这严重制约了当前处理器,特别是网络处理器的高速报文处理能力,转发效率不高。为此,提出了一种新的技术——"零拷贝"转发技术。该技术只修改报文头,报文体不复制,减少了大量的I/O操作,提高了转发效率。 展开更多
关键词 网络处理器 组播 高速转发
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基于网络处理器的高速网络计费管理系统 被引量:1
9
作者 刘奖 安常青 +2 位作者 何涛 李星 李学农 《小型微型计算机系统》 CSCD 北大核心 2005年第9期1491-1494,共4页
网络的正常运营离不开网络计费管理,高速网络上计费管理系统的设计与实现一直受到各个ISP的密切关注.本文介绍了一套基于网络处理器的计费管理系统的设计与实现,该系统运行在1Gbps的网络环境下,实现了大型园区网网络用户的上网控制、网... 网络的正常运营离不开网络计费管理,高速网络上计费管理系统的设计与实现一直受到各个ISP的密切关注.本文介绍了一套基于网络处理器的计费管理系统的设计与实现,该系统运行在1Gbps的网络环境下,实现了大型园区网网络用户的上网控制、网络计费等功能.实验室测试结果和实际运行情况充分证实了系统的高性能、稳定性与可靠性. 展开更多
关键词 计费管理 网络处理器 IXP1200 高速网络
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高速数字信号处理器ADSP-2181及其在数据采集处理卡中的应用
10
作者 刘丽萍 《电讯技术》 北大核心 2000年第6期55-58,共4页
本文就ADSP - 2 1 81的基本结构与性能做一简要介绍 ,然后根据我们开发的一种数据采集处理卡 ,介绍一下ADSP - 2 1 81在实际中的应用 ,最后就应用该信号处理器中所应注意的一些问题谈几点体会。
关键词 高速数字信号处理器 数据采集 IDMA ADSP-2181
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采用光学互连的极高速处理器
11
作者 Jeongda LKim Andrew Kostrzewski 王子滨 《航空兵器》 1998年第4期39-45,共7页
光学互连已经被设计、制造和测试通过,并且已设计出了基于现场可编程门阵列(FPGA)的图形处理器。电路板到电路板的连接方法是基于带有新型光电有源连接器的多通道集成光学波导,允许在许多电路板之间同时传输多个数据。数据在集成电路(IC... 光学互连已经被设计、制造和测试通过,并且已设计出了基于现场可编程门阵列(FPGA)的图形处理器。电路板到电路板的连接方法是基于带有新型光电有源连接器的多通道集成光学波导,允许在许多电路板之间同时传输多个数据。数据在集成电路(IC)芯片之间的传输是通过IC芯片中的光学数据通道进行的。在电子处理系统方面,我们改进了适合于单指令多数据(SIMD)和多指令多数据(MIMD)的多处理器系统原始设计,并将视频随机存取存储器(VRAM)和静态随机存取存储器(SRAM)用于主存储器、查寻表格处理和显示接口。 展开更多
关键词 光学互连 高速 处理器 FPGA
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NAT技术在网络处理器IXP2400上的设计与实现 被引量:2
12
作者 刘朝晖 李雪莹 +1 位作者 陈宇 许榕生 《计算机工程与应用》 CSCD 北大核心 2004年第34期148-150,221,共4页
网络地址翻译(NAT)技术是目前最常见的网络技术之一,论文就如何在高速网络中实现NAT技术进行了探讨,并给出了利用网络处理器IXP2400开发NAT技术的具体设计实现。
关键词 NAT技术 网络处理器 高速网络
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基于查找表的像素处理器新算法 被引量:2
13
作者 郝建新 谢剑斌 +1 位作者 蔡宣平 孙茂印 《国防科技大学学报》 EI CAS CSCD 1998年第5期81-85,共5页
本文在基本的像素处理算法的基础上,提出了一种基于查找表的快速平滑插值算法。该算法不仅运算量小、精度较高,而且易于硬件实现,适合于高速显示处理系统中。
关键词 查找表 高速显示处理 像素处理器 算法 图形处理
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基于超标量处理器的高效FFT映射方法 被引量:2
14
作者 高立宁 朱亮 +1 位作者 刘腾飞 刘峰 《北京理工大学学报》 EI CAS CSCD 北大核心 2016年第9期940-946,共7页
针对超标量处理器的结构特点,研究新的映射方法,实现高效FFT运算.对现代超标量结构处理器进行建模,分析FFT算法在其上执行情况,得出内存访问是FFT算法执行的关键点.并进一步对FFT的内访问过程进行建模分析,最终实现了一种基于cache优化... 针对超标量处理器的结构特点,研究新的映射方法,实现高效FFT运算.对现代超标量结构处理器进行建模,分析FFT算法在其上执行情况,得出内存访问是FFT算法执行的关键点.并进一步对FFT的内访问过程进行建模分析,最终实现了一种基于cache优化的高效FFT映射方法,该方法将FFT进行拆分实现,充分发挥了cache的作用,进而提高了处理性能.最后在ADI公司的TS201数字信号处理器上,以该映射方法为指导实现了基2FFT算法,实验结果显示在处理点数超出cache容量时,本映射方法可以大幅度提高处理性能. 展开更多
关键词 快速傅里叶变化(FFT) 高速缓存(cache) 超标量处理器
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三维众核片上处理器存储架构研究 被引量:3
15
作者 李丽 张宇昂 +3 位作者 傅玉祥 潘红兵 韩峰 郑维山 《南京大学学报(自然科学版)》 CAS CSCD 北大核心 2014年第3期330-335,共6页
三维众核片上处理器的研究近年来逐渐引起了学术界的广泛关注.三维集成电路技术可以支持将不同工艺的存储器层集成到一颗芯片上,三维众核片上处理器可以集成更大的片上缓存以及主存储器.研究三维众核片上处理器存储架构,探索了集成SRAM ... 三维众核片上处理器的研究近年来逐渐引起了学术界的广泛关注.三维集成电路技术可以支持将不同工艺的存储器层集成到一颗芯片上,三维众核片上处理器可以集成更大的片上缓存以及主存储器.研究三维众核片上处理器存储架构,探索了集成SRAM L2cache层,DRAM主存储器层等,对三维众核片上处理器性能的影响.从仿真结果可知,相比集成1层L2cache,集成2层L2cache的三维众核片上处理器性能最大提高了55%,平均提高34%.将DRAM主存储器集成到片上最大可以提高三维众核片上处理器80%的系统性能,平均改善34.2%. 展开更多
关键词 三维集成电路 三维片上众核多处理器 非均匀高速缓存 存储器架构
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一种嵌入式处理器的动态可重构Cache设计 被引量:3
16
作者 张毅 汪东升 《计算机工程与应用》 CSCD 北大核心 2004年第8期94-96,232,共4页
一般的处理器芯片都有片上高速缓存Cache,它一般是由固定大小的一级Cache(L1)和二级Cache(L2)构成,文章介绍了一种在嵌入式处理器设计中实现的动态可重构Cache。动态可重构Cache的思想最早是罗彻斯特大学(UniversityofRochester)的学者... 一般的处理器芯片都有片上高速缓存Cache,它一般是由固定大小的一级Cache(L1)和二级Cache(L2)构成,文章介绍了一种在嵌入式处理器设计中实现的动态可重构Cache。动态可重构Cache的思想最早是罗彻斯特大学(UniversityofRochester)的学者在他们的一篇关于存储层次的论文1中提出的,当时主要是针对高性能的超标量通用处理器。在此嵌入式处理器设计过程中,笔者创造性地继承了这一思想。通过增加少量硬件以及编译器的配合,在嵌入式处理器中L1Cache和L2Cache总体大小不变的情况下,L1Cache和L2Cache的大小可以根据具体的应用程序动态配置。通过对高速缓存的动态配置,不仅可以有效地提高Cache的命中率,还能够有效降低处理器的功耗。 展开更多
关键词 高速缓存 嵌入式处理器 动态可重构 命中率
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基于龙芯3A处理器的雷达终端实现 被引量:2
17
作者 张晓明 《现代雷达》 CSCD 北大核心 2013年第10期81-83,共3页
阐述了一种基于龙芯3A处理器的雷达终端的系统架构、设计和实现。文中设计采用国产化处理器和高性能图形处理器,结合大规模可编程器件应用,通过高速总线实现TV/IR视频、雷达视频采集、分类传输处理和高分辨率显示。该设计具有处理器国... 阐述了一种基于龙芯3A处理器的雷达终端的系统架构、设计和实现。文中设计采用国产化处理器和高性能图形处理器,结合大规模可编程器件应用,通过高速总线实现TV/IR视频、雷达视频采集、分类传输处理和高分辨率显示。该设计具有处理器国产化、高性能、多功能、一体化的特点,信息安全性好、便于保障和维护,可适用于地面、车载等显控终端中。 展开更多
关键词 雷达终端 显示 国产化处理器 现场可编程门阵列 电视/红外 高速外设部件互联接口 嵌入式
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MACT:高通量众核处理器离散访存请求批量处理机制
18
作者 李文明 叶笑春 +5 位作者 王达 郑方 李宏亮 林晗 范东睿 孙凝晖 《计算机研究与发展》 EI CSCD 北大核心 2015年第6期1254-1265,共12页
网络服务等新型高通量应用的迅速兴起给传统处理器设计带来了巨大的挑战.高通量众核处理器作为面向此类应用的新型处理器结构成为研究热点.然而,随着片上处理核数量的剧增,加之高通量应用的数据密集型特点,"存储墙"问题进一... 网络服务等新型高通量应用的迅速兴起给传统处理器设计带来了巨大的挑战.高通量众核处理器作为面向此类应用的新型处理器结构成为研究热点.然而,随着片上处理核数量的剧增,加之高通量应用的数据密集型特点,"存储墙"问题进一步加剧.通过分析高通量应用访存行为,发现此类应用存在着大量的细粒度访存,降低了访存带宽的有效利用率.基于此分析,在高通量处理器设计中通过添加访存请求收集表(memory access collection table,MACT)硬件机制,结合消息式内存机制,用于收集离散的访存请求并进行批量处理.MACT硬件机制的实现,提高了访存带宽的有效利用率,同时也提高了执行效率;并通过时间窗口机制,确保访存请求在最晚期限之前发送出去,保证任务的实时性.实验以典型高通量应用WordCount,TeraSort,Search为基准测试程序.添加MACT硬件机制后,访存数量减少约49%,访存带宽提高约24%,平均执行速度提高约89%. 展开更多
关键词 高通量处理器 访存请求收集表 时间窗口机制 高速缓冲存储器 便签式存储器
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解决中央处理器运算速度与内存系统性能矛盾的一种方案
19
作者 续敏 汪小涓 《计算机工程与应用》 CSCD 北大核心 2002年第6期86-89,共4页
中央处理器-存储器集成是解决当前处理器运算速度与传统的存储器系统性能滞后的一种新思路。文章运用一个简单的评价模型和模拟运行,分析了几种处理器-存储器集成的方案。
关键词 中央处理器 存储器 高速缓存 集成 性能 运算速度 内存系统
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北京三号A/B卫星数传智能处理器在轨处理关键技术及应用 被引量:3
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作者 王元乐 张建华 +8 位作者 杨玉辰 方火能 李潇然 韩婷 朱红 袁素春 韩宇 赵魏 刘聪聪 《航天器工程》 CSCD 北大核心 2023年第3期138-144,共7页
针对北京三号A/B卫星高速数据处理和传输需求,采用全路由总线互联架构,全新设计了第五代数传基带处理设备智能处理器,给出了相关功能、指标和特点;重点介绍了智能处理器中软件定义功能的高性能异构计算单元、高性能遥感影像在轨处理技... 针对北京三号A/B卫星高速数据处理和传输需求,采用全路由总线互联架构,全新设计了第五代数传基带处理设备智能处理器,给出了相关功能、指标和特点;重点介绍了智能处理器中软件定义功能的高性能异构计算单元、高性能遥感影像在轨处理技术、数传任务自主管理技术等在轨处理关键技术;最后,给出了智能处理器试验验证和应用情况,其具备硬件平台通用、软件定义功能,大幅提升了常规数传能力,创新实践了多种智能数传功能,通过北京三号A/B卫星成功在轨验证及应用,智能处理器可作为成熟产品应用于后续空间高速数传任务。 展开更多
关键词 智能化 高速数传 智能数传 智能处理器 在轨处理
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