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基于频差倍增技术的陡脉冲上升时间测量系统
被引量：
3
1
作者
王士彬
孙才新
+3 位作者
杜林
米彦
姚陈果
李成祥
《重庆大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2006年第8期29-32,共4页
阐述了高速计数器测量陡(快)脉冲上升时间的原理,提出了基于频差倍增技术的计数方案,实现了由较低频率计数器进行较高频率计数,进而提高陡脉冲上升时间测量精度的目的.把高密度可编程逻辑器件(CPLD)的外接100 MHz晶振作为系统低频时钟,...
阐述了高速计数器测量陡(快)脉冲上升时间的原理,提出了基于频差倍增技术的计数方案,实现了由较低频率计数器进行较高频率计数,进而提高陡脉冲上升时间测量精度的目的.把高密度可编程逻辑器件(CPLD)的外接100 MHz晶振作为系统低频时钟,利用D触发器组对时钟信号进行分频、倒相,经过二级倍频后混频器输出200 MHz的脉冲作为计数脉冲,将计数精度提高至5 ns左右,满足了测量要求且降低了测量成本,并可推广应用于测量脉冲的下降时间、脉冲宽度和周期等.
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关键词
陡脉冲
上升时间
高速计数器
频率差值倍增
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职称材料
题名
基于频差倍增技术的陡脉冲上升时间测量系统
被引量：
3
1
作者
王士彬
孙才新
杜林
米彦
姚陈果
李成祥
机构
重庆大学电气工程学院高电压与电工新技术教育部重点实验室
出处
《重庆大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2006年第8期29-32,共4页
基金
国家自然科学基金资助项目(50377046)
文摘
阐述了高速计数器测量陡(快)脉冲上升时间的原理,提出了基于频差倍增技术的计数方案,实现了由较低频率计数器进行较高频率计数,进而提高陡脉冲上升时间测量精度的目的.把高密度可编程逻辑器件(CPLD)的外接100 MHz晶振作为系统低频时钟,利用D触发器组对时钟信号进行分频、倒相,经过二级倍频后混频器输出200 MHz的脉冲作为计数脉冲,将计数精度提高至5 ns左右,满足了测量要求且降低了测量成本,并可推广应用于测量脉冲的下降时间、脉冲宽度和周期等.
关键词
陡脉冲
上升时间
高速计数器
频率差值倍增
Keywords
steep pulse
rise time
high-speed counter
frequency difference multiply
分类号
TM835.1 [电气工程—高电压与绝缘技术]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于频差倍增技术的陡脉冲上升时间测量系统
王士彬
孙才新
杜林
米彦
姚陈果
李成祥
《重庆大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2006
3
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