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以基本块为单位的非顺序指令预取
被引量：
4
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作者
沈立
戴葵
王志英
《计算机工程与科学》
CSCD
2003年第4期94-98,共5页
取指令能力的高低对微处理器的性能有很大影响。指令预取技术能够有效地降低指令Cache的访问失效率,提高微处理器的取指令能力,进而提高微处理器的性能。本文提出了一种由分支指令指导的、以基本块为单位的非顺序指令预取技术,每次预取...
取指令能力的高低对微处理器的性能有很大影响。指令预取技术能够有效地降低指令Cache的访问失效率,提高微处理器的取指令能力,进而提高微处理器的性能。本文提出了一种由分支指令指导的、以基本块为单位的非顺序指令预取技术,每次预取将一个完整的基本块读入指令Cache。这种方法使用静态策略分析程序行为,实现所需的硬件复杂度低。模拟结果显示,该方法能够有效地提高指令Cache访问的命中率。
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关键词
微处理器
指令
处理模块
基本块
非顺序指令预取
执行模块
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职称材料
题名
以基本块为单位的非顺序指令预取
被引量：
4
1
作者
沈立
戴葵
王志英
机构
国防科技大学计算机学院
出处
《计算机工程与科学》
CSCD
2003年第4期94-98,共5页
基金
国家自然科学基金资助项目(60173040
6993303)
文摘
取指令能力的高低对微处理器的性能有很大影响。指令预取技术能够有效地降低指令Cache的访问失效率,提高微处理器的取指令能力,进而提高微处理器的性能。本文提出了一种由分支指令指导的、以基本块为单位的非顺序指令预取技术,每次预取将一个完整的基本块读入指令Cache。这种方法使用静态策略分析程序行为,实现所需的硬件复杂度低。模拟结果显示,该方法能够有效地提高指令Cache访问的命中率。
关键词
微处理器
指令
处理模块
基本块
非顺序指令预取
执行模块
Keywords
basic block
instruction cache
instruction prefetching
branch prediction
分类号
TP332 [自动化与计算机技术—计算机系统结构]
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题名
作者
出处
发文年
被引量
操作
1
以基本块为单位的非顺序指令预取
沈立
戴葵
王志英
《计算机工程与科学》
CSCD
2003
4
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