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集成电路封装级失效及其定位 被引量:5
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作者 张蓬鹤 陈选龙 +2 位作者 刘丽媛 林道谭 何胜宗 《半导体技术》 CAS CSCD 北大核心 2015年第6期455-459,477,共6页
失效分析中有许多类型的封装级失效。由于封装材料限制或者无损检测要求,无法从外观直接观察到失效点,需要借助于设备进行失效定位才能快速、准确地进行分析。总结了集成电路封装级失效的几种常见失效机理和失效原因,提出三种有效的分... 失效分析中有许多类型的封装级失效。由于封装材料限制或者无损检测要求,无法从外观直接观察到失效点,需要借助于设备进行失效定位才能快速、准确地进行分析。总结了集成电路封装级失效的几种常见失效机理和失效原因,提出三种有效的分析手段和分析方法进行失效定位:X射线检测、超声扫描声学显微镜以及热激光激发光致电阻变化(OBIRCH)技术,分别用于元器件结构观察、不同材料界面特性分析和键合损伤位置定位。从倒装芯片封装、陶瓷封装、塑料封装和金铝键合短路四个失效分析的实际案例出发,阐明三种封装级失效定位手段应用的领域、特点和局限性。结果表明在封装级失效中,通孔断裂开路、焊料桥连短路、键合损伤和界面分层等缺陷能够准确地被定位进而分析。 展开更多
关键词 集成电路 封装级失效 光致电阻变化(OBIRCH) 失效分析 失效定位 扫描声学显微镜 ( SAM)
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集成电路失效定位技术现状和发展趋势 被引量:5
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作者 陈选龙 王有亮 +2 位作者 方建明 林晓玲 倪毅强 《半导体技术》 CAS 北大核心 2020年第5期329-337,370,共10页
集成电路(IC)失效分析包含了不同的分析流程,但所有的步骤都是以失效定位和故障隔离作为第一步工作。失效定位指的是不断地缩小半导体器件故障范围直至可以进行破坏性物理分析的过程。根据IC的结构特点和分析思路,将整个失效分析流程中... 集成电路(IC)失效分析包含了不同的分析流程,但所有的步骤都是以失效定位和故障隔离作为第一步工作。失效定位指的是不断地缩小半导体器件故障范围直至可以进行破坏性物理分析的过程。根据IC的结构特点和分析思路,将整个失效分析流程中失效定位分为封装级失效定位、器件级失效定位和物理分析失效定位。通过定位技术结合案例分析的形式,重点介绍了时域反射、X射线断层扫描、扫描声学分析、锁相红外成像、光发射分析、激光激发技术和电压衬度等关键的失效定位技术原理和方法。总结了不同失效定位技术的适用范围和面临的挑战。同时,也对未来失效分析技术发展趋势进行了展望。 展开更多
关键词 集成电路(ic)失效定位 物理失效分析 电压衬度 光发射显微镜 热激光激发
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OBIRCH用于集成电路短路的背面失效定位 被引量:9
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作者 陈选龙 刘丽媛 +1 位作者 孙哲 李庆飒 《半导体技术》 CAS CSCD 北大核心 2015年第11期856-860,共5页
基于光束感生电阻变化(OBIRCH)的热激光激发定位技术广泛应用于半导体器件的失效分析,特别是大规模集成电路的短路失效定位。详细介绍了OBIRCH技术在芯片背面失效定位时的原理和方法,通过精密研磨、抛光等先进制样手段对失效样品进行开... 基于光束感生电阻变化(OBIRCH)的热激光激发定位技术广泛应用于半导体器件的失效分析,特别是大规模集成电路的短路失效定位。详细介绍了OBIRCH技术在芯片背面失效定位时的原理和方法,通过精密研磨、抛光等先进制样手段对失效样品进行开封、芯片背面减薄。采用OBIRCH方法从芯片背面进行激光成像,成功对0.18μm工艺6层金属化布线的集成电路gg NMOS结构保护网络二次击穿和PMOS电容栅氧化层损伤进行了失效定位,并对背面定位图像和正面定位图像、In Ga As CCD成像进行了对比分析。结果表明,In Ga As CCD成像模糊并无法定位,OBIRCH背面定位成像比正面成像清楚,可以精确定位并观察到缺陷点。因此,OBIRCH技术用于集成电路短路的背面失效定位是准确的,可解决多层结构的正面定位难题。 展开更多
关键词 热激光激发技术 光束感生电阻变化(OBIRCH) 集成电路(ic) 失效分析 失效定位 传输线脉冲(TLP)
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3D叠层封装集成电路的缺陷定位方法 被引量:1
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作者 林晓玲 恩云飞 姚若河 《华南理工大学学报(自然科学版)》 EI CAS CSCD 北大核心 2016年第5期36-41,47,共7页
三维(3D)叠层封装集成电路是高性能器件的一种重要封装形式,其独特的封装形式为失效定位带来了新的挑战.文中融合实时锁定热成像和X射线探测技术,提出了一种3D叠层封装集成电路缺陷定位方法.该方法首先利用X射线探测技术从器件的正面、... 三维(3D)叠层封装集成电路是高性能器件的一种重要封装形式,其独特的封装形式为失效定位带来了新的挑战.文中融合实时锁定热成像和X射线探测技术,提出了一种3D叠层封装集成电路缺陷定位方法.该方法首先利用X射线探测技术从器件的正面、侧面获取电路内部结构并成像,进而确定芯片的装配位置及面积、芯片叠层层数、引线键合方式;然后利用锁定热成像技术获得缺陷在封装内部传播的延迟信息及在封装内部xy平面上的信息,通过计算不同频率下的相移来确定叠层封装中缺陷在z轴方向的位置信息.对某型号塑料封装存储器SDRAM中缺陷的定位及对缺陷部位的物理分析表明,锁定热成像与X射线探测技术相结合,可以在不开封的前提下进行3D叠层封装集成电路内部缺陷的定位. 展开更多
关键词 三维叠层封装 集成电路 缺陷定位 失效分析
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集成电路多层互连结构故障定位方法 被引量:3
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作者 龚瑜 黄彩清 刘颖 《电子显微学报》 CAS CSCD 北大核心 2020年第2期206-213,共8页
随着超大规模集成电路特征尺寸的不断缩小,晶圆级失效点的尺寸也随之不断减小,使得常规的失效定位方法EMMI,OBIRCH已无法满足深亚微米级别故障定位的要求。为了能够实现更精准定位缺陷位置,本文提出了一种先进的深层互连缺陷探测技术:... 随着超大规模集成电路特征尺寸的不断缩小,晶圆级失效点的尺寸也随之不断减小,使得常规的失效定位方法EMMI,OBIRCH已无法满足深亚微米级别故障定位的要求。为了能够实现更精准定位缺陷位置,本文提出了一种先进的深层互连缺陷探测技术:微探针测试定位方法。同时,将故障区域划分为浅层金属,底层金属,深层金属及互连通孔缺陷,提出了根据多层互连金属的结构选择对应定位分析技术的方法,分析和讨论了这几种位置缺陷探测的特点以及推荐的故障定位技术。通过实例分析揭示集成电路多层金属互连失效的主要失效机理,对提高失效分析的成功率以及深亚微米的集成电路的设计有着重要的参考作用。 展开更多
关键词 失效定位 热成像分析 微探针测试 微光显微镜 集成电路
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集成电路在要害系统应用的相关技术
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作者 杨江 路荣先 李治 《半导体技术》 CAS CSCD 北大核心 2003年第1期16-19,共4页
介绍了IC在要害系统的应用现状。对IC在要害系统的应用特点、应用策略、相关支持技术、IC的失效分析及故障测试技术进行了探讨。该技术对在要害系统IC的使用者会有很大的帮助。
关键词 集成电路 要害系统 应用 ic应用 失效分析 ic测试
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多模计数器静电放电损伤的失效分析 被引量:3
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作者 席善斌 裴选 +3 位作者 刘玮 高兆丰 彭浩 黄杰 《半导体技术》 CSCD 北大核心 2017年第10期784-789,共6页
静电放电(ESD)损伤会降低半导体器件和集成电路的可靠性并导致其性能退化。针对一款国产2-32型多模计数器的失效现象,通过分析该计数器的电路结构,利用X射线成像、显微红外热成像、光束感生电阻变化以及钝化层、金属化层去除等技术对计... 静电放电(ESD)损伤会降低半导体器件和集成电路的可靠性并导致其性能退化。针对一款国产2-32型多模计数器的失效现象,通过分析该计数器的电路结构,利用X射线成像、显微红外热成像、光束感生电阻变化以及钝化层、金属化层去除等技术对计数器进行了失效分析,将失效点准确定位至输出端口逻辑单元电路的2只晶体管上。分析结果表明,多模计数器的ESD损伤使输出端口驱动晶体管以及为负载晶体管提供栅偏置的前级电路晶体管同时受损,导致计数器端口高、低电平输出均失效而丧失计数功能。对相关的失效机理展开了讨论,同时提出了在电路研制和使用过程中的ESD防护措施。 展开更多
关键词 多模计数器 单片微波集成电路(MMic) 静电放电(ESD) 失效分析 失效定位
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彩虹缺陷的失效验证方法及机理分析 被引量:2
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作者 龚瑜 黄彩清 《电子显微学报》 CAS CSCD 北大核心 2021年第3期311-319,共9页
随着集成电路特征尺寸的不断缩小,对晶圆制造工艺提出来更大挑战。彩虹效应是指晶圆局部或边缘处因异物,膜内分层,镀层厚度等原因导致晶粒表面所呈现的变色现象。本文基于模拟开关芯片开展失效分析,在芯片内晶粒局部检测到彩虹效应。并... 随着集成电路特征尺寸的不断缩小,对晶圆制造工艺提出来更大挑战。彩虹效应是指晶圆局部或边缘处因异物,膜内分层,镀层厚度等原因导致晶粒表面所呈现的变色现象。本文基于模拟开关芯片开展失效分析,在芯片内晶粒局部检测到彩虹效应。并通过应用失效验证,电学参数测试,依据EMMI,OBIRCH的漏电流定位结果及电路原理图分析验证了彩虹效应对集成电路的电性能参数的影响。同时,借用FIB,EDS,XPS等物理分析方法,揭示了彩虹效应的失效机理。该案例展示了EMMI,OBIRCH在集成电路内部缺陷无损定位和分析的作用,为边缘缺陷的验证提供技术手段。 展开更多
关键词 彩虹效应 失效定位 集成电路 微光显微镜 光诱导电阻变化
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