一种逐次逼近寄存器型模数转换器 被引量：5

1

作者 石蓝 居水荣 +1 位作者 丁瑞雪 朱樟明 《半导体技术》 CAS 北大核心 2020年第12期916-923,共8页

设计了一种逐次逼近寄存器型模数转换器(SAR ADC)。提出了一种新型全动态钟控比较器结构,消除了比较器的亚稳态误差,解决了ADC输出不稳定的问题,实现了失调和噪声之间良好的折中,提升了ADC的动态性能;设计了一种全新的自举开关,在确保... 设计了一种逐次逼近寄存器型模数转换器(SAR ADC)。提出了一种新型全动态钟控比较器结构,消除了比较器的亚稳态误差,解决了ADC输出不稳定的问题,实现了失调和噪声之间良好的折中,提升了ADC的动态性能;设计了一种全新的自举开关,在确保采样保持电路性能的同时提高了其可靠性;提出了一种新颖的正反馈结构的动态逻辑单元,并应用在逐次逼近逻辑电路中,在降低功耗的同时消除了误码问题;改进了共模电平产生电路结构,提高了共模电平的产生速度和稳定性。电路采用0.18μm DB S-BCD工艺设计实现,芯片面积约为360μm×560μm,10 bit分辨率模式下的功耗和信噪失真比(SNRD)分别为21.1μW和58.64 dB。 展开更多

关键词 模数转换器(adc) 逐次逼近寄存器(sar) 比较器 自举开关 动态逻辑单元 共模电平

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用于植入式医疗装置的逐次逼近式模数转换器 被引量：9

2

作者 张鸿 张牡丹 +2 位作者 张杰 赵阳 张瑞智 《西安交通大学学报》 EI CAS CSCD 北大核心 2015年第2期43-48,129,共7页

针对植入式医疗装置对模数转换器（ADC）的超低功耗和高精度要求,提出了一种共模恒定型分段混合编码结构的逐次逼近式模数转换器（SAR-ADC）。该SAR-ADC的电容数模转换器DAC中采用分段混合编码结构,兼具了分段二进制编码的低功耗优势和... 针对植入式医疗装置对模数转换器（ADC）的超低功耗和高精度要求,提出了一种共模恒定型分段混合编码结构的逐次逼近式模数转换器（SAR-ADC）。该SAR-ADC的电容数模转换器DAC中采用分段混合编码结构,兼具了分段二进制编码的低功耗优势和分段温度计编码的高线性度优势。共模恒定型控制方式具有极低的动态功耗。采用HHNEC 0.35μm CMOS工艺完成了10位共模恒定型分段混合编码SAR-ADC的电路和版图设计。后仿真结果表明：所设计的SARADC的电源电压范围为1.8~3V;在采样率为103 s-1的条件下,其有效位数为9.4位;整个SARADC所消耗的电流仅为60nA,在同等工艺条件下具有更低的功耗;所设计的转换器能够满足心脏起搏器等植入式医疗装置的需求。 展开更多

关键词 医疗装置 植入式 超低功耗 逐次逼近型 模数转换器

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面向WSN结点SoC的逐次逼近模数转换器 被引量：1

3

作者 刘珂 杜占坤 +3 位作者 马骁 邵莉 毕见鹏 傅健 《半导体技术》 CAS CSCD 北大核心 2013年第1期1-5,15,共6页

设计了一种适合于无线传感网(WSN)结点SoC芯片传感器接口电路应用的12 bit精度逐次逼近型(SAR)模数转换器(ADC)。为了实现高精度、低成本,并兼容射频CMOS工艺的要求,利用全差分结构和带有Auto-zero失调消除功能的比较器提高转换精度。... 设计了一种适合于无线传感网(WSN)结点SoC芯片传感器接口电路应用的12 bit精度逐次逼近型(SAR)模数转换器(ADC)。为了实现高精度、低成本,并兼容射频CMOS工艺的要求,利用全差分结构和带有Auto-zero失调消除功能的比较器提高转换精度。采用分段式电容阵列DAC减小芯片占用面积,通过构造符合精度要求的MOM电容单元,使电容阵列符合射频CMOS的工艺特点,利于嵌入式应用。同时,采取增加辅助电容的办法扩大输入信号范围。该ADC在0.18μm 1P6M标准CMOS工艺下实现,版图面积为0.9 mm2,最高采样速率为1 MS/s,在1.8 V电源电压下,整体功耗仅为2 mW。 展开更多

关键词 逐次逼近型 模数转换器 无线传感网 片上系统 低功耗

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SAR型模数转换器前端信号调理电路设计 被引量：2

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作者 范明明 杨录 任超瑛 《中国测试》 CAS 北大核心 2014年第6期79-83,共5页

为设计出与逐次逼近型(SAR)ADC输入适配且性能优良的信号调理电路,综合考虑分析模拟输入信号、SAR型ADC接口的前端、基准电压源和数字接口,根据噪声分析理论给出前端RC滤波器的详细设计公式和设计过程,并根据滤波器的带宽和系统噪声容... 为设计出与逐次逼近型(SAR)ADC输入适配且性能优良的信号调理电路,综合考虑分析模拟输入信号、SAR型ADC接口的前端、基准电压源和数字接口,根据噪声分析理论给出前端RC滤波器的详细设计公式和设计过程,并根据滤波器的带宽和系统噪声容限选择前端驱动放大器。通过对比芯片官方参考电路和实际测试效果表明:计算公式有效可行,放大器的分析选择科学合理,为SAR型ADC前端信号调理电路的设计提供可靠依据。 展开更多

关键词 逐次逼近型adc 模拟输入前端 信号调理电路 滤波器设计 放大器选择

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面向CMOS图像传感器应用的列级模数转换器研究进展 被引量：1

5

作者 廖文丽 张植潮 +2 位作者 张九龄 蔡铭嫣 陈铖颖 《半导体技术》 CAS 北大核心 2023年第11期961-971,共11页

随着有源像素工艺以及互补金属氧化物半导体(CMOS)集成电路技术迅速发展,CMOS图像传感器(CIS)朝着高分辨率、高动态范围、低功耗、小体积的方向不断发展,在数码相机、汽车驾驶、安防监控、医学等多个领域中逐渐取代原市场主流的电荷耦... 随着有源像素工艺以及互补金属氧化物半导体(CMOS)集成电路技术迅速发展,CMOS图像传感器(CIS)朝着高分辨率、高动态范围、低功耗、小体积的方向不断发展,在数码相机、汽车驾驶、安防监控、医学等多个领域中逐渐取代原市场主流的电荷耦合器件(CCD)图像传感器。模数转换器(ADC)作为模拟信号和数字信号的转换端口,是CMOS图像传感器中的重要组成部分,其性能的优劣直接决定了CMOS图像传感器的成像质量。对应用于CMOS图像传感器的模数转换器进行了综述,分析了几种主流架构的优缺点,阐述了面临的挑战以及解决方案,最后对未来的发展前景进行了展望。 展开更多

关键词 CMOS图像传感器(CIS) 模数转换器(adc) 单斜(SS)adc 逐次逼近寄存器(sar)adc 循环adc Sigma-Delta adc

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一种基于两步式SAR ADC架构的智能温度传感器

6

作者 曹亦栋 陈雷 +3 位作者 初飞 李建成 张健 李全利 《半导体技术》 北大核心 2025年第6期603-611,共9页

针对高速接口芯片的局部结温监测问题,设计了一种基于两步式逐次逼近型模数转换器(SAR ADC)的片上智能温度传感器,该传感器可配合上位机实现对全芯片温度的实时监测,并输出数字温度码。电路对横向pnp管的基极-发射极电压进行采样,设计... 针对高速接口芯片的局部结温监测问题,设计了一种基于两步式逐次逼近型模数转换器(SAR ADC)的片上智能温度传感器,该传感器可配合上位机实现对全芯片温度的实时监测,并输出数字温度码。电路对横向pnp管的基极-发射极电压进行采样,设计了温度监测模块进行量化比较。电路采用了两步式SAR ADC进行10 bit数字温度码的转换输出,两步式SAR ADC通过调节电阻阵列实现粗量化,调节比较器输入管阵列进行细量化。电路基于28 nm CMOS工艺设计,模块面积为0.049 mm^(2)。仿真结果表明,27℃、1.8 V电源电压下温度传感器的最大动态功耗为379μW,在10 MHz参考时钟下的输出响应时间为37.1μs。测试结果表明,芯片温度为62.8~124.5℃时温度传感器温度测量的误差为±1.5℃。 展开更多

关键词 高速接口芯片 温度传感器 横向pnp管 温度监测模块 两步式逐次逼近型模数转换器(sar adc)

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一种基于蓝牙射频电路可测性设计的8位逐次逼近型ADC

7

作者 陈坚 洪志良 《应用科学学报》 CAS CSCD 2004年第4期475-478,共4页

介绍一种基于蓝牙射频电路可测性设计的8位逐次逼近型ADC.该电路的核心由采用rail-to-rail输入的比较器和R-2R网络结构的DAC组成.针对可测性设计的要求,电路结构简单紧凑,功耗低,芯片面积小.同时也提出,基于该ADC的一种适合于蓝牙射频... 介绍一种基于蓝牙射频电路可测性设计的8位逐次逼近型ADC.该电路的核心由采用rail-to-rail输入的比较器和R-2R网络结构的DAC组成.针对可测性设计的要求,电路结构简单紧凑,功耗低,芯片面积小.同时也提出,基于该ADC的一种适合于蓝牙射频电路的测试方法,通过该方法可以较好地对蓝牙射频电路的功能和性能进行监控和测试.芯片采用TSMC的0.35μm标准CMOS工艺制造,面积仅为0.15mm2.测试结果显示,在3.3V工作电压下,分辨率可达7位,且在高频工作环境下表现出很好的抗干扰特性. 展开更多

关键词 射频电路 蓝牙 逐次逼近型 adc 可测性设计 RAIL-TO-RAIL 芯片 抗干扰特性 显示 紧凑

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一种带片上校准的16 bit两级逐次逼近型ADC 被引量：1

8

作者 冯景彬 胡伟波 +4 位作者 国千崧 秦克凡 胡毅 李振国 侯佳力 《半导体技术》 CAS 北大核心 2022年第5期403-409,共7页

为实现16 bit的同步模数转换器(ADC),提出了一种基于电阻比例增益的级间残差放大器(RA)的两级逐次逼近型(SAR)ADC。第一级ADC(STGADC1)的剩余电压由RA放大,再由第二级ADC(STGADC2)采样和量化。采用片上一次性校准用于处理电容式数模转换... 为实现16 bit的同步模数转换器(ADC),提出了一种基于电阻比例增益的级间残差放大器(RA)的两级逐次逼近型(SAR)ADC。第一级ADC(STGADC1)的剩余电压由RA放大,再由第二级ADC(STGADC2)采样和量化。采用片上一次性校准用于处理电容式数模转换器(CDAC)和RA中的非理想特性。STGADC1、STGADC2内部和两级之间均采用冗余。校准后,该ADC在测量中实现了88 dB的信噪比(SNR)、87.5 dB的信噪失真比(SNDR)和-96 dB的总谐波失真(THD)。测量的微分非线性(DNL)和积分非线性(INL)分别为-0.66/+0.82 LSB和-1.98/+1.84 LSB。电路采用180 nm CMOS工艺流片,芯片面积0.69 mm^(2),供电电压为5 V/1.8 V,功耗为3 mW。 展开更多

关键词 模数转换器(adc) 残差放大器(RA) 逐次逼近型(sar) 冗余 一次性校准

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基于分段电容阵列的改进型逐次逼近型ADC

9

作者 胡毅 李振国 +3 位作者 侯佳力 国千崧 邓新伟 胡伟波 《半导体技术》 CAS 北大核心 2022年第2期126-133,共8页

为缩短高速模数转换器(ADC)中高位(MSB)电容建立时间以及减小功耗,提出了一种基于分段式电容阵列的改进型逐次逼近型(SAR)ADC结构,通过翻转小电容阵列代替翻转大电容阵列以产生高位数字码,并利用180 nm CMOS工艺实现和验证了此ADC结构... 为缩短高速模数转换器(ADC)中高位(MSB)电容建立时间以及减小功耗,提出了一种基于分段式电容阵列的改进型逐次逼近型(SAR)ADC结构,通过翻转小电容阵列代替翻转大电容阵列以产生高位数字码,并利用180 nm CMOS工艺实现和验证了此ADC结构。该结构一方面可以缩短产生高位数码字过程中的转换时间,提高量化速度;另一方面其可以延长大电容的稳定时间,减小参考电压的负载。通过缩小比较器输入对管的面积以减小寄生电容带来的误差,提升高位数字码的准确度。同时,利用一次性校准技术减小比较器的失配电压。最终,采用180 nm CMOS工艺实现该10 bit SAR ADC,以验证该改进型结构。结果表明,在1.8 V电源电压、780μW功耗、有电路噪声和电容失配情况下,该改进型SAR ADC得到了58.0 dB的信噪失真比(SNDR)。 展开更多

关键词 分段电容阵列 失配电压 锁存式比较器 一次性校准 逐次逼近型(sar)模数转换器(adc)

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一种10位200kS/s 65nm CMOS SAR ADC IP核 被引量：9

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作者 杨银堂 佟星元 +1 位作者 朱樟明 管旭光 《电子与信息学报》 EI CSCD 北大核心 2010年第12期2993-2998,共6页

该文基于65nm CMOS低漏电工艺,设计了一种用于触摸屏SoC的8通道10位200kS/s逐次逼近寄存器型(Successive Approximation Register,SAR)A/D转换器(Analog-to-Digital Converter,ADC)IP核。在D/A转换电路的设计上,采用"7MSB(Most-Sig... 该文基于65nm CMOS低漏电工艺,设计了一种用于触摸屏SoC的8通道10位200kS/s逐次逼近寄存器型(Successive Approximation Register,SAR)A/D转换器(Analog-to-Digital Converter,ADC)IP核。在D/A转换电路的设计上,采用"7MSB(Most-Significant-Bit)+3LSB(Least-Significant-Bit)"R-C混合D/A转换方式,有效减小了IP核的面积,并通过采用高位电阻梯复用技术有效减小了系统对电容的匹配性要求。在比较器的设计上,通过采用一种低失调伪差分比较技术,有效降低了输入失调电压。在版图设计上,结合电容阵列对称布局以及电阻梯伪电阻包围的版图设计方法进行设计以提高匹配性能。整个IP核的面积为322μm×267μm。在2.5V模拟电压以及1.2V数字电压下,当采样频率为200kS/s,输入频率为1.03kHz时,测得的无杂散动态范围(Spurious-Free Dynamic Range,SFDR)和有效位数(Effective Number Of Bits,ENOB)分别为68.2dB和9.27,功耗仅为440μW,测试结果表明本文ADC IP核非常适合嵌入式系统的应用。 展开更多

关键词 模数转换器(adc) 逐次逼近寄存器(sar) 触摸屏SoC CMOS 低功耗

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一种性能指标可配置的SAR ADC的设计与实现 被引量：5

11

作者 居水荣 谢亚伟 +1 位作者 王津飞 朱樟明 《半导体技术》 CAS 北大核心 2019年第5期335-341,348,共8页

提出了一种分辨率、电源电压等性能指标可配置的逐次逼近寄存器型(SAR)模数转换器(ADC)的设计思想和实现方式。分析了SAR ADC的采样速率、精度、功耗和能量效率等主要性能指标之间的关系,提出了性能参数可配置SAR ADC的设计构想。介绍... 提出了一种分辨率、电源电压等性能指标可配置的逐次逼近寄存器型(SAR)模数转换器(ADC)的设计思想和实现方式。分析了SAR ADC的采样速率、精度、功耗和能量效率等主要性能指标之间的关系,提出了性能参数可配置SAR ADC的设计构想。介绍了性能指标可配置SAR ADC的实现方式,包括分辨率的配置、采样速率的可变以及电源电压的可调等。基于0.18μm CMOS工艺完成了ADC的版图设计、工艺加工和性能参数测试,ADC核心部分芯片面积仅为360μm×550μm。测试结果表明,SAR ADC的分辨率为6～10 bit、电源电压为0.5～0.9 V,在10 bit模式以及0.5 V电源电压下,该SAR ADC信噪失真比(SNDR)和无杂散动态范围(SFDR)分别可达到56.36 dB和67.96 dB,采样速率可达到2 MS/s,能量效率优值(FOM)为20.6 fJ/conversion-step。 展开更多

关键词 模数转换器(adc) 逐次逼近寄存器(sar) 低功耗 分辨率可配置 电源电压可变

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一种基于电压窗口技术的超低功耗SAR ADC 被引量：4

12

作者 汪正锋 宁宁 +4 位作者 吴霜毅 杜翎 蒋旻 闫小艳 王伟 《电子学报》 EI CAS CSCD 北大核心 2016年第1期211-215,共5页

本文提出了一种应用于生物医学的超低功耗逐次逼近型模数转换器(SAR ADC).针对SAR ADC主要模块进行超低功耗设计.数模转换(DAC)电路采用vcm-based以及分段电容阵列结构来减小其总电容,从而降低了DAC功耗.同时提出了电压窗口的方法在不... 本文提出了一种应用于生物医学的超低功耗逐次逼近型模数转换器(SAR ADC).针对SAR ADC主要模块进行超低功耗设计.数模转换(DAC)电路采用vcm-based以及分段电容阵列结构来减小其总电容,从而降低了DAC功耗.同时提出了电压窗口的方法在不降低比较器精度的情况下减小其功耗.此外,采用堆栈以及多阈值晶体管结构来减小低频下的漏电流.在55nm工艺下进行设计和仿真,在0.6V电源电压以及10k S/s的采样频率下,ADC的信噪失真比(SNDR)为73.3d B,总功耗为432n W,品质因数(FOM)为11.4f J/Conv. 展开更多

关键词 模数转换器(adc) 逐次逼近寄存器(sar) 电压窗口 超低功耗

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工艺-电压-温度综合稳健的亚1 V 10位SAR ADC 被引量：1

13

作者 张畅 佟星元 《电子学报》 EI CAS CSCD 北大核心 2023年第8期2050-2057,共8页

采用0.11-μm CMOS工艺设计了一款10位亚1 V工艺-电压-温度(Process-Voltage-Temperature,PVT)综合稳健的逐次逼近寄存器型(Successive-Approximation-Register,SAR)模数转换器(Analog-to-Digital Converter,ADC)IP核.由于SAR ADC数字... 采用0.11-μm CMOS工艺设计了一款10位亚1 V工艺-电压-温度(Process-Voltage-Temperature,PVT)综合稳健的逐次逼近寄存器型(Successive-Approximation-Register,SAR)模数转换器(Analog-to-Digital Converter,ADC)IP核.由于SAR ADC数字化程度较高,为了降低整体功耗,采用小于标准电压的亚1 V供电.然而,对于异步SAR ADC,在低压下面临严峻的PVT不稳健问题,传统采用固定延迟电路的方式无法应对所有的PVT偏差,会导致ADC良率下降.提出一种用于异步SAR ADC的可配置延迟调控技术,采用3输入译码器调节延迟电路的电流,以满足ADC在多种PVT组合下所需的延时,在TT,SS,FF,SF,FS这5种工艺角,0.9~1 V供电范围和-40~85℃的温度范围下,均取得了良好的动态特性.在0.95 V供电,采样速率为200 kS/s时,总功耗为2.24μW,FoM值仅为16.46 fJ/Conv.-step. 展开更多

关键词 模数转换器(adc) 逐次逼近寄存器(sar) 工艺-电压-温度(PVT) 低压 低功耗

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高精度SAR ADC电容阵列设计及校准算法

14

作者 金鹏展 丁晟 +2 位作者 黄玮 朱樟明 居水荣 《半导体技术》 CAS 北大核心 2023年第11期1020-1029,共10页

在高精度逐次逼近寄存器模数转换器(SAR ADC)中,电容阵列是SAR ADC的核心之一。电容阵列中的电容失配问题是导致转换精度降低的一个重要原因。为了尽可能改善这一问题,设计了一种6+6+6分段电容阵列,并且基于这种阵列设计了权重迭代算法... 在高精度逐次逼近寄存器模数转换器(SAR ADC)中,电容阵列是SAR ADC的核心之一。电容阵列中的电容失配问题是导致转换精度降低的一个重要原因。为了尽可能改善这一问题,设计了一种6+6+6分段电容阵列,并且基于这种阵列设计了权重迭代算法的前台数字校准。该方法不需要额外的电容阵列,利用自身的电容阵列与比较器量化出电容失配,计算出每一位输出码的权重校准系数,用来对正常量化出的输出码进行编码,实现校准功能。仿真结果表明,引入电容失配的18 bit SAR ADC经过该算法校准后,信噪比(SNR)从77.6 dB提升到107.6 dB,无杂散动态范围(SFDR)从89.8 dB提升到125.6 dB,有效位数(ENOB)从12.54 bit提升到17.54 bit。在SMIC 0.18μm工艺下,该校准算法对高精度SAR ADC的动态性能具有较大提升。 展开更多

关键词 逐次逼近寄存器模数转换器(sar adc) 电容失配 电容阵列 校准 有效位数(ENOB) 信噪比(SNR)

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用于植入式医用芯片的低电压低功耗SAR ADC

15

作者 刘旸 秦琳 赵梦恋 《江南大学学报（自然科学版）》 CAS 2013年第4期424-428,共5页

为适应植入式医用芯片的使用要求,给出一低电压低功耗逐次逼近型模数转换器(SARADC)的设计。从降低功耗出发,提出了一种新的能量高效开关策略。与传统开关策略相比,电容阵列的平均开关能量减少了68%,电容阵列的面积仅为传统开关策略的5... 为适应植入式医用芯片的使用要求,给出一低电压低功耗逐次逼近型模数转换器(SARADC)的设计。从降低功耗出发,提出了一种新的能量高效开关策略。与传统开关策略相比,电容阵列的平均开关能量减少了68%,电容阵列的面积仅为传统开关策略的50%;采用带校正的动态比较器,在提高精度的同时可以降低功耗;采用异步时钟,省略了高频时钟产生器,进一步降低了功耗。提出的5 Ms-111位SAR ADC采用SMIC 0.18μm CMOS混合信号工艺流片。供电电压低至1 V,功耗仅为0.236 mW,SNDR,SFDR分别达到55.1,68.38 dB。核心面积为650μm×1 000μm,符合植入式系统的要求。 展开更多

关键词 植入式 逐次逼近型 模数转换器 低电压 低功耗

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