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一种新型忆阻乘法器 被引量:1
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作者 严利民 解于丰 《半导体技术》 CAS 北大核心 2023年第9期793-799,811,共8页
在众多存算一体化技术中,忆阻因为其纳米级尺寸和非易失性受到了广泛的关注,而忆阻状态逻辑由于其输入、输出均由忆阻阻值表示的特性被认为是真正实现存算一体化的忆阻数字逻辑。基于前人忆阻状态逻辑的研究,提出了新型的单循环广播操... 在众多存算一体化技术中,忆阻因为其纳米级尺寸和非易失性受到了广泛的关注,而忆阻状态逻辑由于其输入、输出均由忆阻阻值表示的特性被认为是真正实现存算一体化的忆阻数字逻辑。基于前人忆阻状态逻辑的研究,提出了新型的单循环广播操作方法和反向进位保存加法移位(ICSAS)乘法器,通过在传统的进位保存加法移位乘法器中插入反向输入和输出的进位保存加法器优化延迟和忆阻数量消耗。基于VTEAM模型使用LTspice进行仿真验证,仿真结果证明,与存内乘法器(MultPIM)相比,提出的ICSAS乘法器在忆阻数量和所用循环数上均有较大提升,对比N bit乘法器,可将消耗循环数从O(Nlog_(2)N)降低至O(N),消耗忆阻数量从14N-7减少至10N-4。 展开更多
关键词 存算一体化 忆阻 状态逻辑 法器 反向进位保存加法器
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基于Parallel_CORDIC的高精度高速度直接数字频率合成器的FPGA实现 被引量:13
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作者 祁艳杰 刘章发 《电子学报》 EI CAS CSCD 北大核心 2014年第7期1392-1397,共6页
本文提出了一种直接数字频率合成器(DDFS)的设计,以Parallel_CORDIC(COrdinate Rotation Digital Computer)算法模块替代传统的查找表方式,实现了相位与幅度的一一对应,输出相位完全正交的正余弦波形;同时应用旋转角度预测及4:2的进位... 本文提出了一种直接数字频率合成器(DDFS)的设计,以Parallel_CORDIC(COrdinate Rotation Digital Computer)算法模块替代传统的查找表方式,实现了相位与幅度的一一对应,输出相位完全正交的正余弦波形;同时应用旋转角度预测及4:2的进位保存加法器(CSA)技术,将速度比传统CORDIC算法提高41.7%,精度提高到10-4.最后以Xilinx的FPGA硬件实现整个设计. 展开更多
关键词 直接数字频率合成技术(DDFS) PARALLEL CORDIC 进位保存加法器(CSA) FPGA
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高速整数开方电路的流水线设计 被引量:2
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作者 朱维乐 钱贵锁 +1 位作者 杨刚 陈伟 《电子科技大学学报》 EI CAS CSCD 北大核心 2008年第2期229-231,共3页
对一个位宽为32位整数的开方硬件电路的结构进行设计,介绍了应用流水线技术设计了一个高速求平方根电路,考虑FPGA的内部结构,对采用流水线技术之后占用的硬件资源进行了分析。提出了利用流水线实现开方问题的新算法,在一个时钟周期内对3... 对一个位宽为32位整数的开方硬件电路的结构进行设计,介绍了应用流水线技术设计了一个高速求平方根电路,考虑FPGA的内部结构,对采用流水线技术之后占用的硬件资源进行了分析。提出了利用流水线实现开方问题的新算法,在一个时钟周期内对32位整数进行处理,计算出相应的平方根和余数并送出,在算法上具有精度高、速度快、易实现等优点。与传统的算法相比,它完全避免了除法的迭代,从而开方速度提高了一倍左右。 展开更多
关键词 进位保存加法器 现场可编程门阵列 流水线结构 平方根
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