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高速数字设计中的信号完整性问题
被引量：
9
1
作者
夏军成
《舰船电子对抗》
2003年第4期10-11,19,共3页
随着集成电路输出开关速度的提高以及PCB板密度的增加 ,信号完整性已经成为高速数字设计必须关心的问题之一。如何在设计过程中充分考虑到信号完整性的因素 ,并采取有效的控制措施 ,已经成为当今高速设计业界的一个热门课题。
关键词
集成电路
输出开关速度
信号完整性
高速数字设计
SPICE模型
IBIS模型
解决方法
Verilog-AMS模型
VHDL-AMS模型
在线阅读
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职称材料
题名
高速数字设计中的信号完整性问题
被引量：
9
1
作者
夏军成
机构
船舶重工集团公司
出处
《舰船电子对抗》
2003年第4期10-11,19,共3页
文摘
随着集成电路输出开关速度的提高以及PCB板密度的增加 ,信号完整性已经成为高速数字设计必须关心的问题之一。如何在设计过程中充分考虑到信号完整性的因素 ,并采取有效的控制措施 ,已经成为当今高速设计业界的一个热门课题。
关键词
集成电路
输出开关速度
信号完整性
高速数字设计
SPICE模型
IBIS模型
解决方法
Verilog-AMS模型
VHDL-AMS模型
分类号
TN402 [电子电信—微电子学与固体电子学]
TN702 [电子电信—电路与系统]
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作者
出处
发文年
被引量
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1
高速数字设计中的信号完整性问题
夏军成
《舰船电子对抗》
2003
9
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