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CCD图像采集系统的低功耗流水线ADC设计
被引量:
3
1
作者
徐美华
樊裕乐
李科
《微电子学与计算机》
CSCD
北大核心
2010年第7期164-167,共4页
设计了一个适用于面阵CCD图像采集系统的10位、90MSPS流水线ADC.通过采用低功耗动态比较器和省略输入级采样/保持模块使得该高速ADC具有低功耗的优点.电路设计使用Charter0.35μm3.3V2P4M CMOS工艺.仿真结果表明:90MHz的采样速率、3.3MH...
设计了一个适用于面阵CCD图像采集系统的10位、90MSPS流水线ADC.通过采用低功耗动态比较器和省略输入级采样/保持模块使得该高速ADC具有低功耗的优点.电路设计使用Charter0.35μm3.3V2P4M CMOS工艺.仿真结果表明:90MHz的采样速率、3.3MHz正弦信号输入下,该ADC模块具有9.3bit的有效分辨率,最大DNL为0.5LSB,最大INL为0.8LSB,整个ADC功耗仅为35.4mW.
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关键词
CCD
流水线ADC
动态比较器
输入级采样/保持模块
低功耗
栅压自举开关
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职称材料
题名
CCD图像采集系统的低功耗流水线ADC设计
被引量:
3
1
作者
徐美华
樊裕乐
李科
机构
上海大学微电子研究与开发中心
上海大学机电工程与自动化学院
出处
《微电子学与计算机》
CSCD
北大核心
2010年第7期164-167,共4页
基金
国家自然科学基金项目(60773081)
国家"八六三"计划项目(2008AA03A336)
文摘
设计了一个适用于面阵CCD图像采集系统的10位、90MSPS流水线ADC.通过采用低功耗动态比较器和省略输入级采样/保持模块使得该高速ADC具有低功耗的优点.电路设计使用Charter0.35μm3.3V2P4M CMOS工艺.仿真结果表明:90MHz的采样速率、3.3MHz正弦信号输入下,该ADC模块具有9.3bit的有效分辨率,最大DNL为0.5LSB,最大INL为0.8LSB,整个ADC功耗仅为35.4mW.
关键词
CCD
流水线ADC
动态比较器
输入级采样/保持模块
低功耗
栅压自举开关
Keywords
CCD
pipeline ADC
dynamic comparator
input-stage S/H
low power dissipation
bootstrap
分类号
TN431.1 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
CCD图像采集系统的低功耗流水线ADC设计
徐美华
樊裕乐
李科
《微电子学与计算机》
CSCD
北大核心
2010
3
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