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基于FPGA的以太网与E1网中的同步动态随机存储控制器设计
被引量：
1
1
作者
符世龙
陈松岩
《厦门大学学报（自然科学版）》
CAS
CSCD
北大核心
2013年第3期360-365,共6页
为了实现不同速率数据链路通信的相互转换,提出了一种利用现场可编程门序列(FPGA)设计并实现可对同步动态随机存储器(SDRAM)进行数据缓存并高速读写的控制器.该控制器采取状态机和令牌环机制,通过对SDRAM操作,实现了双向4路的跨时钟域...
为了实现不同速率数据链路通信的相互转换,提出了一种利用现场可编程门序列(FPGA)设计并实现可对同步动态随机存储器(SDRAM)进行数据缓存并高速读写的控制器.该控制器采取状态机和令牌环机制,通过对SDRAM操作,实现了双向4路的跨时钟域的匹配.该控制器适用于任意长度的以太网帧和其他类型的数据相互转换.
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关键词
同步动态随机存储器
跨时钟域通信
现场可编程门序列
以太网帧
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职称材料
题名
基于FPGA的以太网与E1网中的同步动态随机存储控制器设计
被引量：
1
1
作者
符世龙
陈松岩
机构
厦门大学物理与机电工程学院
出处
《厦门大学学报（自然科学版）》
CAS
CSCD
北大核心
2013年第3期360-365,共6页
基金
福建省自然科学基金项目(2012H0038)
文摘
为了实现不同速率数据链路通信的相互转换,提出了一种利用现场可编程门序列(FPGA)设计并实现可对同步动态随机存储器(SDRAM)进行数据缓存并高速读写的控制器.该控制器采取状态机和令牌环机制,通过对SDRAM操作,实现了双向4路的跨时钟域的匹配.该控制器适用于任意长度的以太网帧和其他类型的数据相互转换.
关键词
同步动态随机存储器
跨时钟域通信
现场可编程门序列
以太网帧
Keywords
synehronous dynamic random access memory
asynchronous clock
FPGA
ethernet frame
分类号
TP333.8 [自动化与计算机技术—计算机系统结构]
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题名
作者
出处
发文年
被引量
操作
1
基于FPGA的以太网与E1网中的同步动态随机存储控制器设计
符世龙
陈松岩
《厦门大学学报（自然科学版）》
CAS
CSCD
北大核心
2013
1
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