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超大规模集成电路的板级测试研究 被引量:3
1
作者 李志威 潘中良 叶小敏 《重庆理工大学学报(自然科学)》 CAS 北大核心 2019年第9期170-175,共6页
为检测以超大规模集成电路为核心的电子设备,设计了基于边界扫描技术的电路测试系统。对超大规模集成电路进行板级测试,并提出在互连网络两端的边界扫描单元分别做输出操作的针对互连测试和簇测试过程的测试方法。测试结果表明:利用该方... 为检测以超大规模集成电路为核心的电子设备,设计了基于边界扫描技术的电路测试系统。对超大规模集成电路进行板级测试,并提出在互连网络两端的边界扫描单元分别做输出操作的针对互连测试和簇测试过程的测试方法。测试结果表明:利用该方法,提高了超大规模集成电路板级故障的分辨能力,获得了更好的测试效果。 展开更多
关键词 超大规模集成电路 板级测试 互连测试 测试
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超大规模集成电路内装测试生成模式新方法
2
作者 徐秀兰 《计算机研究与发展》 EI CSCD 北大核心 1993年第11期61-65,F004,共6页
本文阐述一种由片内二进制计数与“异或”门阵列组成的内装测试电路产生测试模式的新方法。根据线性变换的基本原理对电路设计的“异或”门阵列进一步简化,可以实现在有限的硬件支持下达到预期故障覆盖率的效果,从而促进了内装测试技术... 本文阐述一种由片内二进制计数与“异或”门阵列组成的内装测试电路产生测试模式的新方法。根据线性变换的基本原理对电路设计的“异或”门阵列进一步简化,可以实现在有限的硬件支持下达到预期故障覆盖率的效果,从而促进了内装测试技术的推广和应用。 展开更多
关键词 集成电路 vlsi 测试
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大规模数字集成电路标准矩阵功能测试新方法 被引量:2
3
作者 徐拾义 《计算机工程与科学》 CSCD 2005年第4期31-35,91,共6页
本文提出了一种对 VLSI电路功能测试的方法,可以同时检测和定位 VLSI电路输入和输出端上的固定故障和桥接故障,而不需要知道它们的内部逻辑结构。因而,对于简化测试过程、降低测试成本, 具有十分重要的实际意义。
关键词 大规模数字集成电路 vlsi 列交换算法 标准矩阵 功能测试
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高效率集成电路测试芯片设计方法 被引量:2
4
作者 胡龙跃 史峥 +1 位作者 刘得金 邵康鹏 《计算机工程与应用》 CSCD 2013年第11期54-57,共4页
对生成测试芯片效率进行研究,提出了一种采用版图编辑器作图和批量参数化建模设计方法。缩短了设计周期,降低了设计难度。依据该方法,开发了一套针对工艺开发包的测试芯片,实验结果验证了其高效性。
关键词 超大规模集成电路 测试芯片 开尔文结构 工艺开发包 组件描述格式
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集成电路设计、验证、测试系统的研究 被引量:1
5
作者 林争辉 《上海交通大学学报》 EI CAS CSCD 北大核心 1995年第1期119-127,共9页
本文对“LSI/VLSI设计、验证、测试系统”进行了理论总结.文中分别阐述了该系统中的设计子系统、验证子系统和测试子系统,以及它们所包含的软件概况和主要技术成果.
关键词 vlsi 集成电路 LSI 设计 验证 测试
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征稿通知 第15届国际专用集成电路会议
6
《半导体技术》 CAS 北大核心 2023年第1期80-80,共1页
第十五届IEEE国际专用集成电路会议(ASICON 2023)将于2023年10月24日—27日在江苏南京白金汉爵大酒店举行。这次会议旨在为VLSI电路设计者、ASIC用户、系统集成工程师、IC制造厂商、工艺和器件工程师以及CAD/CAE工具开发者提供一个国际... 第十五届IEEE国际专用集成电路会议(ASICON 2023)将于2023年10月24日—27日在江苏南京白金汉爵大酒店举行。这次会议旨在为VLSI电路设计者、ASIC用户、系统集成工程师、IC制造厂商、工艺和器件工程师以及CAD/CAE工具开发者提供一个国际论坛,介绍他们在各自领域获得的最新进步和研发成果。四天的会议将汇集中外著名专家关于VLSI电路、器件、工艺设计与制造等技术最新发展的主题演讲、论文报告以及资深专家的讲课。大会将评选出优秀学生与青年学者论文,并安排EDA工具、制造厂商、IC工艺、器件测试仪器以及最新ASIC产品的展示。 展开更多
关键词 专用集成电路 IC工艺 vlsi电路 EDA工具 ASIC 江苏南京 系统集成 器件测试
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数字VLSI电路测试技术-BIST方案 被引量:15
7
作者 高平 成立 +2 位作者 王振宇 祝俊 史宜巧 《半导体技术》 CAS CSCD 北大核心 2003年第9期29-32,共4页
分析了数字VLSI电路的传统测试手段及其存在问题,通过对比的方法,讨论了内建自测试(BIST)技术及其优点,简介了多芯片组件(MCM)内建自测试的目标、设计和测试方案。
关键词 数字vlsi电路 测试技术 BIST 内建自测试 多芯片组件 超大规模集成
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一种新的LSI/VLSI电路测试方法
8
作者 高建华 《中国纺织大学学报》 CSCD 1995年第1期116-123,共8页
本文提出一种根据输出端值的变化频度测试LSI/VLSI电路I/O线上的固定故障的方法。该方法的优点是不需待测电路功能函数,也不需标准电路作比较。文章同时讨论用软件和硬件的实现方法。
关键词 LSI vlsi 集成电路 测试
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VLSI电路可测性设计技术及其应用综述 被引量:26
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作者 成立 王振宇 +1 位作者 高平 祝俊 《半导体技术》 CAS CSCD 北大核心 2004年第5期20-24,34,共6页
综述了超大规模集成电路的几种主要的可测试性设计技术,如扫描路径法、内建自测试法和边界扫描法等,并分析比较了这几种设计技术各自的特点及其应用方法和策略。
关键词 vlsi 可测性设计 内建自测试 自动测试设备 超大规模集成电路 扫描路径法
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基于IDDQ测试的VLSI门内电阻式桥接故障仿真 被引量:2
10
作者 许爱强 唐小峰 +1 位作者 牛双诚 杨智勇 《北京工业大学学报》 CAS CSCD 北大核心 2016年第1期128-133,共6页
为真实模拟集成电路中的桥接故障并评价测试集质量,提出一种基于静态电源电流(IDDQ)测试的逻辑电路门内电阻式桥接故障仿真算法.首先,针对该故障类型,提出一种覆盖率评价标准;其次,利用电路级故障注入与仿真方法构造基本逻辑门单元的故... 为真实模拟集成电路中的桥接故障并评价测试集质量,提出一种基于静态电源电流(IDDQ)测试的逻辑电路门内电阻式桥接故障仿真算法.首先,针对该故障类型,提出一种覆盖率评价标准;其次,利用电路级故障注入与仿真方法构造基本逻辑门单元的故障字典;最后,通过在逻辑电路功能仿真中查询故障信息实现门级的故障仿真.仿真实验表明:相比于传统方法,所提方法能更好地反映测试集对真实桥接故障的覆盖效果,并具备良好的仿真效能. 展开更多
关键词 超大规模集成电路(vlsi)测试 电阻式桥接故障 静态电源电流(IDDQ)测试 故障仿真 故障覆盖率
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一种在VLSI电路物理设计中减小串扰的优化算法 被引量:2
11
作者 张徐亮 赵梅 +3 位作者 范明钰 李春辉 虞厥邦 黄劲 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2001年第4期289-293,共5页
通过研究调整线段和线间距对串扰的影响 ,提出了一种在布线时通过采取作线段摄动和压缩线间距的措施来减小串扰的优化算法 .计算机仿真结果表明 ,该算法能有效地减少芯片中的串扰 .此外 。
关键词 超大规模集成电路 物理设计 串扰最小化 优化算法 vlsi 计算机仿真
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基于遗传算法的VLSI电路划分方法 被引量:2
12
作者 王小港 吴福炜 +2 位作者 李铁 姚林声 甘骏人 《计算机工程》 CAS CSCD 北大核心 2002年第2期13-14,254,共3页
电路划分是降低超大规模集成电路设计复杂性的有效方法。提出了一种基于遗传算法的电路划分算法,该算法不仅适用于电路的二划分和划分问题,而且可以满足划分对子集的大小和面积等多约束的要求。
关键词 遗传算法 vlsi 超大规模集成电路 电路划分算法
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蚂蚁算法在时序电路测试生成中的应用研究 被引量:4
13
作者 许川佩 李智 莫玮 《仪器仪表学报》 EI CAS CSCD 北大核心 2005年第2期187-190,共4页
数字集成电路的发展对测试提出了日益紧迫的要求 ,测试已成为妨碍LSI/VLSI付诸应用的瓶颈问题。尤其时序电路的测试生成 ,理论上是个没有完全解决的问题。通过结合电路的结构信息 ,提出了基于蚂蚁算法的时序电路自动测试生成 ,该算法分... 数字集成电路的发展对测试提出了日益紧迫的要求 ,测试已成为妨碍LSI/VLSI付诸应用的瓶颈问题。尤其时序电路的测试生成 ,理论上是个没有完全解决的问题。通过结合电路的结构信息 ,提出了基于蚂蚁算法的时序电路自动测试生成 ,该算法分初始化和故障检测两个阶段实现。实验结果表明 ,基于蚂蚁算法的测试生成能取得较好的故障覆盖率 ,并且测试生成所耗费的CPU时间非常短 ,说明这是个值得探索的方法。 展开更多
关键词 测试生成 时序电路 蚂蚁算法 应用 数字集成电路 故障覆盖率 CPU时间 瓶颈问题 vlsi 结构信息 结合电路 故障检测 完全解 初始化
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VLSI并行测试生成系统的一种动态层次框架 被引量:2
14
作者 刘蓬侠 曾芷德 李思昆 《计算机工程与科学》 CSCD 2001年第2期79-83,共5页
随着 VLSI技术的发展和计算机性能的提高 ,并行测试生成系统不仅必需而且可行。本文在总结已有并行技术的基础上 ,提出了并行测试生成系统的一种动态层次框架 。
关键词 vlsi 并行测试生成系统 超大规模集成电路 并行计算机
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VLSI芯片的可测试性、可调试性、可制造性和可维护性设计 被引量:6
15
作者 沈理 《计算机工程与科学》 CSCD 2003年第1期92-97,共6页
CMOS器件进入深亚微米阶段,VLSI集成电路(IC)继续向高集成度、高速度、低功耗发展,使得IC在制造、设计、封装、测试上都面临新的挑战。测试已从IC设计流程的后端移至前端,VLSI芯片可测试性设计已成为IC设计中必不可少的一部分。本文介... CMOS器件进入深亚微米阶段,VLSI集成电路(IC)继续向高集成度、高速度、低功耗发展,使得IC在制造、设计、封装、测试上都面临新的挑战。测试已从IC设计流程的后端移至前端,VLSI芯片可测试性设计已成为IC设计中必不可少的一部分。本文介绍近几年来VLSI芯片可测试性设计的趋势,提出广义可测试性设计(TDMS技术)概念,即可测试性、可调试性、可制造性和可维护性设计,并对可调试性设计方法学和广义可测试性设计的系统化方法作了简单介绍。 展开更多
关键词 vlsi芯片 测试 可调试性 可制造性 可维护性 设计 超大规模集成电路
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用于亚微米模拟VLSI中的实用串级电流镜电路 被引量:2
16
作者 成立 《半导体技术》 CAS CSCD 北大核心 1998年第6期31-34,40,共5页
对亚微米模拟VLSI中使用的电流镜电路进行了改进。借助于PSpice4.03软件设计了几个实用的电流镜电路。
关键词 亚微米 电流镜 超大规模 集成电路 vlsi
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数字电路多加权集随机测试生成方法 被引量:2
17
作者 谢永乐 陈光■ 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2002年第6期571-573,共3页
提出一种基于确定性完备测试集的数字集成电路多加权集随机测试生成方法 .通过引入搜索与迭代算法 ,将完备测试集分成若干测试子集 ,每一子集对应一个权集 ,即产生该子集中测试矢量的被测电路各主输入端取‘1’值的概率组合 .该方法与文... 提出一种基于确定性完备测试集的数字集成电路多加权集随机测试生成方法 .通过引入搜索与迭代算法 ,将完备测试集分成若干测试子集 ,每一子集对应一个权集 ,即产生该子集中测试矢量的被测电路各主输入端取‘1’值的概率组合 .该方法与文献 [2 - 3]的结果相比 ,在测试序列长度或硬件开销上获得了改善 。 展开更多
关键词 数字电路 多加权集 随机测试生成方法 超大规模集成电路
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组合电路随机测试的一种新方法 被引量:1
18
作者 徐拾义 《计算机工程与科学》 CSCD 2002年第2期84-87,共4页
本文在随机测试的基础上提出了逆随机测试 (ART)的新概念。在该测试序列的集合中各测试码之间的海明距离为尽可能的大 ,这样可以使不同的测试码检测到更多不同的故障 ,从而提高了测试效率和故障覆盖率。本文给出了构造逆随机测试序列 (A... 本文在随机测试的基础上提出了逆随机测试 (ART)的新概念。在该测试序列的集合中各测试码之间的海明距离为尽可能的大 ,这样可以使不同的测试码检测到更多不同的故障 ,从而提高了测试效率和故障覆盖率。本文给出了构造逆随机测试序列 (ARTS)的详细过程 ,并且严格证明了该序列的高效和正确性 ,同时还给出了用Benchmark和其它电路作为例子的实验结果。 展开更多
关键词 组合电路 随机测试 超大规模集成电路 逆随机测试 故障覆盖率
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VLSI功能测试的最佳测试序列的选取
19
作者 曾成碧 陈光 《电子科技大学学报》 EI CAS CSCD 北大核心 2000年第2期178-181,共4页
介绍了VLSI功能测试向量生成的Petri网模型和Petri网模拟测试序列中指令的关系,构造了压缩存储网络的拓扑信息的Petri网简约矩阵。用Petri网简约矩阵检查测试序列的不确定度,使测试序列不确定度最小,从而优... 介绍了VLSI功能测试向量生成的Petri网模型和Petri网模拟测试序列中指令的关系,构造了压缩存储网络的拓扑信息的Petri网简约矩阵。用Petri网简约矩阵检查测试序列的不确定度,使测试序列不确定度最小,从而优化了测试序列,即从给定的指令中选出了最佳测试序列。 展开更多
关键词 最佳测试序列 功能测试 集成电路 vlsi
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新型VLSI直流参数自动测试系统 被引量:2
20
作者 马秀莹 刘明亮 高剑 《电子测量技术》 2005年第5期15-16,共2页
文中基于测试器件AD5520和测量放大器AD524,设计并实现超大规模集成电路直流参数自动测试系统,该系统具有结构紧凑,编程灵活等特点。实际应用表明,该系统自动化程度高,测试精度高,可靠性好。
关键词 直流参数测试 超大规模集成电路 复杂可编程逻辑器件 自动测试系统 直流参数 vlsi 测量放大器 自动化程度 结构紧凑 测试精度
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