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利用数据预取机制降低块执行模型的访存延迟
被引量：
2
1
作者
从明
安虹
+1 位作者
张军
任永青
《小型微型计算机系统》
CSCD
北大核心
2010年第8期1692-1696,共5页
块执行模型通过将串行程序划分成一系列可并行执行的指令块来挖掘应用中潜在的指令级并行性.访存延迟是阻碍块执行模型提高指令级并行性的主要因素之一,而数据预取技术在传统执行模型中可有效降低访存延迟,对块执行模型也同样具有较强...
块执行模型通过将串行程序划分成一系列可并行执行的指令块来挖掘应用中潜在的指令级并行性.访存延迟是阻碍块执行模型提高指令级并行性的主要因素之一,而数据预取技术在传统执行模型中可有效降低访存延迟,对块执行模型也同样具有较强的适应性.本文分析了在块执行模型中引入数据预取机制的可行性,并从cache命中率、访存指令的延迟等方面验证了数据预取在块执行模型中的作用,仿真结果表明数据预取可有效降低块执行模型中的访存延迟.
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关键词
数据预取
块执行模型
分片式处理器
访
存
延迟
访存命中率
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职称材料
题名
利用数据预取机制降低块执行模型的访存延迟
被引量：
2
1
作者
从明
安虹
张军
任永青
机构
中国科学技术大学计算机科学与技术学院
中国科学院计算机体系结构重点实验室
出处
《小型微型计算机系统》
CSCD
北大核心
2010年第8期1692-1696,共5页
基金
国家自然科学基金项目(60633040
60736012)资助
+3 种基金
国家"九七三"重点基础研究发展计划基金项目(2005CB321601)资助
国家"八六三"高技术研究发展计划项目(2006AA01A102
2009AA01Z106)资助
教育部-英特尔信息技术专项科研基金项目(MOE-INTEL-08-07)资助
文摘
块执行模型通过将串行程序划分成一系列可并行执行的指令块来挖掘应用中潜在的指令级并行性.访存延迟是阻碍块执行模型提高指令级并行性的主要因素之一,而数据预取技术在传统执行模型中可有效降低访存延迟,对块执行模型也同样具有较强的适应性.本文分析了在块执行模型中引入数据预取机制的可行性,并从cache命中率、访存指令的延迟等方面验证了数据预取在块执行模型中的作用,仿真结果表明数据预取可有效降低块执行模型中的访存延迟.
关键词
数据预取
块执行模型
分片式处理器
访
存
延迟
访存命中率
Keywords
data prefetch
block execution model
tiled processor
memory-access latency
cache hit rate
分类号
TP303 [自动化与计算机技术—计算机系统结构]
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1
利用数据预取机制降低块执行模型的访存延迟
从明
安虹
张军
任永青
《小型微型计算机系统》
CSCD
北大核心
2010
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